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電子發(fā)燒友網(wǎng)>嵌入式技術>嵌入式設計應用>基于CPLD的高速數(shù)據(jù)采集系統(tǒng)的實現(xiàn)

基于CPLD的高速數(shù)據(jù)采集系統(tǒng)的實現(xiàn)

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換體DMA高速數(shù)據(jù)采集電路原理及其CPLD實現(xiàn)

摘要:介紹了換體DMA高速數(shù)據(jù)采集電路原理及其CPLD實現(xiàn)。用CPLD設計雙端口RAM緩存、控制譯碼、時序邏輯電路,很好地解決了電路元件所占體積大、電路復雜、不能實現(xiàn)在線
2009-06-20 15:12:07878

高速數(shù)據(jù)采集系統(tǒng)中精確時標的CPLD實現(xiàn)方法

高速數(shù)據(jù)采集系統(tǒng)中精確時標的CPLD實現(xiàn)方法 本文介紹一種利用復雜可編程邏輯器件給高速數(shù)據(jù)采集系統(tǒng)中的采集數(shù)據(jù)貼上精確時間標簽的方法,并
2009-07-20 12:42:23609

高速USB數(shù)據(jù)采集系統(tǒng)的設計

高速USB數(shù)據(jù)采集系統(tǒng)的設計 在圖像處理、瞬態(tài)信號測量等一些高速、高精度的應用中,需要進行高速數(shù)據(jù)采集。USB 2.0接口以其高速率等優(yōu)點漸有取
2009-09-26 18:05:46677

基于CPLD和嵌入式系統(tǒng)高速數(shù)據(jù)采集系統(tǒng)的設計與實現(xiàn)

基于CPLD和嵌入式系統(tǒng)高速數(shù)據(jù)采集系統(tǒng)的設計與實現(xiàn) 介紹一種基于CPLD和嵌入式系統(tǒng)高速數(shù)據(jù)采集系統(tǒng),并詳細闡述了系統(tǒng)的結構和軟硬件的實
2009-10-15 23:46:59616

基于A/D和DSP的高速數(shù)據(jù)采集技術

基于A/D和DSP的高速數(shù)據(jù)采集技術 中頻信號分為和差兩路,高速A/D與DSP組成的數(shù)據(jù)采集系統(tǒng)要分別對這兩路信號進行采集。對于兩路數(shù)據(jù)采集電路,A/
2009-10-17 10:17:411201

基于單片機和CPLD實時數(shù)據(jù)采集顯示系統(tǒng)設計

基于單片機和CPLD實時數(shù)據(jù)采集顯示系統(tǒng)設計 1 引言    數(shù)據(jù)采集是分析模擬信號量數(shù)據(jù)的有效方法。而實時顯示數(shù)據(jù)是自動化檢測系統(tǒng)的現(xiàn)實需求。在測
2009-12-22 17:31:021739

基于CPLD/FPGA高速數(shù)據(jù)采集系統(tǒng)的設計

基于CPLD/FPGA高速數(shù)據(jù)采集系統(tǒng)的設計 0 引 言    傳統(tǒng)的數(shù)據(jù)采集系統(tǒng)一般采用單片機,系統(tǒng)大多通過PCI總線完成數(shù)據(jù)的傳輸。其缺點是數(shù)學運算能力差;
2010-01-27 09:35:01508

基于雙端口RAM的高速數(shù)據(jù)采集系統(tǒng)

文章給出了一種基于雙端口 SRAM 技術的高速數(shù)據(jù)采集系統(tǒng)的設計。采用將高速雙端口SRAM 映射為主機內存并構造成環(huán)狀緩沖區(qū)的方法,實現(xiàn)高速ADC數(shù)據(jù)流實時采集與主機處理的并行操
2011-07-13 17:59:3199

單片機系統(tǒng)高速數(shù)據(jù)采集實現(xiàn)

介紹一種單片機系統(tǒng)高速數(shù)據(jù)采集實現(xiàn)方法,在單片機與高速A/D轉換器之間以靜態(tài)存儲器作緩沖器,采用A/D轉換器直接寫存儲器的方式提高采樣頻率,實現(xiàn)高速數(shù)據(jù)采集。并給出了設
2011-07-18 16:59:08190

高速數(shù)據(jù)采集系統(tǒng)CPLD的應用

CPLD高速數(shù)據(jù)采集系統(tǒng)中的應用! 介紹了高速數(shù)據(jù)采集系統(tǒng)的整體框架分析了其中的通用部分CPLD系列產(chǎn)品的特點及其開發(fā)軟件.CPLD根據(jù)高速數(shù)據(jù)采集系統(tǒng)的需要VHDL語言的形式,介紹了由
2011-12-17 00:12:0026

5 Gsps高速數(shù)據(jù)采集系統(tǒng)的設計與實現(xiàn)

以某高速實時頻譜儀為應用背景,論述了5 Gsps采樣率的高速數(shù)據(jù)采集系統(tǒng)的構成和設計要點,著重分析了采集系統(tǒng)的關鍵部分高速ADC(analog to digital,模數(shù)轉換器)的設計、系統(tǒng)采樣時
2012-02-08 11:11:4418

基于CPLD的線陣CCD數(shù)據(jù)采集系統(tǒng)的開發(fā)

本文結合實際應用需要,設計了基于復雜可編程邏輯器件(CPLD)的線陣CCD數(shù)據(jù)采集系統(tǒng)。著重介紹了數(shù)據(jù)采集的特點及該系統(tǒng)軟、硬件設計和最后的性能評價。
2012-05-14 09:53:411133

基于CPLD多通道編碼器數(shù)據(jù)采集系統(tǒng)設計

  本文提出了采用Xilinx公司生產(chǎn)的CPLD來對多通道旋轉編碼器進行數(shù)據(jù)采集的方法,著重介紹了系統(tǒng)的軟硬件設計和驅動程序開發(fā),以及實際應用情況,得出了用CPLD技術為多通道編碼器
2012-07-11 10:36:311224

高速大容量數(shù)據(jù)采集系統(tǒng)設計與實現(xiàn)

高速大容量數(shù)據(jù)采集系統(tǒng)設計與實現(xiàn),下來看看
2016-05-10 11:24:3314

高速數(shù)據(jù)采集系統(tǒng)中的FPGA的設計

高速數(shù)據(jù)采集系統(tǒng)中的FPGA的設計,下來看看
2016-05-10 11:24:3315

基于FPGA的高速數(shù)據(jù)采集硬件系統(tǒng)設計

基于FPGA的高速數(shù)據(jù)采集硬件系統(tǒng)設計.
2016-05-10 17:06:4043

基于FPGA的高速數(shù)據(jù)采集系統(tǒng)接口設計

基于FPGA的高速數(shù)據(jù)采集系統(tǒng)接口設計.
2016-05-10 17:06:4027

基于FPGA的高速數(shù)據(jù)采集系統(tǒng)的設計

基于FPGA的高速數(shù)據(jù)采集系統(tǒng)的設計,下來看看
2016-05-10 17:06:4019

基于FPGA的高速數(shù)據(jù)采集系統(tǒng)設計_楊江濤

基于FPGA的高速數(shù)據(jù)采集系統(tǒng)設計,用ad芯片和sdram構成高速數(shù)據(jù)采集系統(tǒng)。
2016-05-17 09:49:5135

六通道高速數(shù)據(jù)采集系統(tǒng)的設計

六通道高速數(shù)據(jù)采集系統(tǒng)的設計
2017-01-17 19:54:2411

基于PXI架構的高速數(shù)據(jù)采集系統(tǒng)設計_黃宇

基于PXI架構的高速數(shù)據(jù)采集系統(tǒng)設計_黃宇
2017-02-07 15:17:366

單片機高速數(shù)據(jù)采集系統(tǒng)的設計_張俊梅

單片機高速數(shù)據(jù)采集系統(tǒng)的設計_張俊梅
2017-03-19 11:28:162

基于CPLD高速數(shù)據(jù)采集系統(tǒng)設計_鮮果

基于CPLD高速數(shù)據(jù)采集系統(tǒng)設計_鮮果
2017-03-19 11:45:233

一種便攜式高速數(shù)據(jù)采集器的研究實現(xiàn)_張珂

一種便攜式高速數(shù)據(jù)采集器的研究實現(xiàn)_張珂
2017-03-15 09:08:560

高速高精度的數(shù)據(jù)采集系統(tǒng)的設計與實現(xiàn)

設計了基于FPGA與ARM 芯片的數(shù)據(jù)采集系統(tǒng),F(xiàn)PGA 負責控制A/D轉換器,保證了采樣精度與處理速度,ARM負責邏輯控制及與上位機交互的實現(xiàn),并將采集到的數(shù)據(jù)通過USB高速上傳至主機進行實時處理。對模擬數(shù)據(jù)采集的測試結果達到了較高的采樣精度和速度,驗證了整個系統(tǒng)高速性和可行性。
2017-11-18 12:47:104154

高速數(shù)據(jù)采集記錄系統(tǒng)

2018年8月,西安慕雷電子發(fā)布了全球頂級高速數(shù)據(jù)采集記錄存儲系統(tǒng),采樣率高達4GSPS,分辨率12bit,模擬帶寬2GHZ,記錄存儲帶寬高達6GB/S!西安慕雷電子供應全球頂級高速數(shù)據(jù)采集卡及超寬
2018-11-13 21:21:34486

使用PCI總線設計高速數(shù)據(jù)采集系統(tǒng)的資料說明

本文詳細介紹了一種基于PCI 總線的高速數(shù)據(jù)采集系統(tǒng)的原理、組成和功能以及在Windows2000 環(huán)境下進行數(shù)據(jù)采集和存儲的方法。該系統(tǒng)用于某型號衛(wèi)星下行的高速數(shù)據(jù)采集系統(tǒng)設計與技術的通用性可應用于其它類似的高速數(shù)據(jù)采集與處理系統(tǒng)中。
2019-11-27 16:19:004

如何使用AVR和CPLD實現(xiàn)高速數(shù)據(jù)采集系統(tǒng)的設計

為了提高數(shù)據(jù)采集卡的速度,同時降低成本,設計一種并行數(shù)據(jù)采集系統(tǒng),要求并行采集速度大于10 Mb/s。整個系統(tǒng)由AVR與CPLD控制實現(xiàn),通過MAXl308完成模數(shù)轉換,并設計搭建了其外圍電路。采用
2020-07-20 17:17:0211

基于PIC總線的高速數(shù)據(jù)采集系統(tǒng)

本文詳細介紹了一種基于 PCI 總線的高速數(shù)據(jù)采集系統(tǒng)的原理、組成和功能以及在 Windows 2000 環(huán)境下進行數(shù)據(jù)采集和存儲的方法。該系統(tǒng)用于某型號衛(wèi)星下行的高速數(shù)據(jù)采集。系統(tǒng)設計與技術的通用性可應用于其它類似的高速數(shù)據(jù)采集與處理系統(tǒng)中。
2021-04-14 14:29:3013

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