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      電子發(fā)燒友網(wǎng)>電子資料下載>可編程邏輯>FPGA/ASIC>如何使用FPGA實(shí)現(xiàn)折反射全景圖像查表實(shí)時(shí)展開

      如何使用FPGA實(shí)現(xiàn)折反射全景圖像查表實(shí)時(shí)展開

      2021-02-02 | rar | 0.48 MB | 次下載 | 免費(fèi)

      資料介紹

      　　為設(shè)計(jì)嵌入式折反射全景實(shí)時(shí)成像系統(tǒng)，在FPGA上通過查表實(shí)現(xiàn)折反射全景圖像展開，并結(jié)合FPGA特點(diǎn)。采用圖像分塊展開、時(shí)間隱藏?cái)?shù)據(jù)讀寫技術(shù)、FPGA流水線等方法提高展開速度。實(shí)驗(yàn)表明，將1024×768 YUV4：2：2格式源圖像展開為1280×256 YUV 4：2：2格式目標(biāo)圖像，速度可達(dá)100fps，展開速度比基于單像素的全景查表展開提高約12倍。

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