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      電子發(fā)燒友網(wǎng)>電子資料下載>可編程邏輯>FPGA/ASIC>FPGA的Verilog簡(jiǎn)介資料詳細(xì)說(shuō)明

      FPGA的Verilog簡(jiǎn)介資料詳細(xì)說(shuō)明

      2021-02-02 | rar | 0.26 MB | 次下載 | 免費(fèi)

      資料介紹

      　　IEEE工業(yè)標(biāo)準(zhǔn)硬件描述語(yǔ)言（HDL）-用于描述數(shù)字系統(tǒng)

      　　用于模擬和合成

      　　veriloghdl：由關(guān)鍵字、語(yǔ)法和語(yǔ)義組成，用于描述硬件功能和時(shí)序。

      　　PLI：編程語(yǔ)言接口提供用于Verilog和EDA工具之間交互的C語(yǔ)言例程。（模擬器、波形顯示器）

      　　SDF：標(biāo)準(zhǔn)延遲格式-一個(gè)文件，用于向模擬器和其他工具反注釋精確的定時(shí)信息。

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