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隨著信息技術(shù)和通信技術(shù)的發(fā)展，人們對(duì)信息傳輸速率的要求越來越高，如對(duì)高清電視、視頻會(huì)議等服務(wù)的需求日益高漲，從而對(duì)調(diào)制解調(diào)這一制約傳輸速率的環(huán)節(jié)提出了更高的速率要求。傳統(tǒng)的高速調(diào)制解調(diào)器多為高速模擬調(diào)制解調(diào)器。隨著數(shù)字芯片處理速度的不斷提高，可靠性更高、靈活性更大的高速數(shù)字調(diào)制解調(diào)器得到了越來越廣泛的應(yīng)用。
而高速數(shù)字調(diào)制解調(diào)器的速率仍會(huì)受限于其所采用的數(shù)字信號(hào)處理芯片的最高處理速度。在諸多數(shù)字芯片中，FPCA的處理速度最快，常用于高速信號(hào)處理領(lǐng)域。而FPCA的處理速率主要受限于其主時(shí)鐘頻率。若采用傳統(tǒng)的串行調(diào)制技術(shù)就難以突破主時(shí)鐘頻率對(duì)調(diào)制速率的限制。若想進(jìn)一步提高調(diào)制速率，就必須先將高速數(shù)據(jù)分流到各個(gè)支路以降低速率，其后采用并行結(jié)構(gòu)進(jìn)行處理。
文中對(duì)差分編碼、成形濾波等各個(gè)調(diào)制步驟的并行處理算法進(jìn)行了研究，將這些模塊轉(zhuǎn)化為并行結(jié)構(gòu)，從而在時(shí)鐘頻率受限的情況下提高了處理速率，并對(duì)這些結(jié)構(gòu)進(jìn)行了深度優(yōu)化，以減少資源消耗，便于FPGA實(shí)現(xiàn)。
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