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      多核TMS320C6474中串行協(xié)議RapiIO性能優(yōu)化

      2017-11-02 | rar | 0.92 MB | 次下載 | 1積分

      資料介紹

      　　現(xiàn)今的處理器性能很強(qiáng)大，可以提供很高計(jì)算速度，但是對(duì)其處理能力的某些應(yīng)用要求也在不斷增加。這就產(chǎn)生了擁有處理器的機(jī)器同時(shí)T作的概念。但是這種多個(gè)機(jī)器同時(shí)T作的機(jī)制需要解決兩個(gè)基本的相互關(guān)聯(lián)的問題：處理器間通信和處理器與其它信息處理部分之間的通信。為了解決處理器之間的互連問題，并滿足嵌入式系統(tǒng)對(duì)帶寬不斷增長(zhǎng)的需求，提出了串行Rapidl0（ SRIO）互連協(xié)議。這種結(jié)構(gòu)起初是為嵌入式計(jì)算系統(tǒng)設(shè)計(jì)的，如今應(yīng)用到邊緣網(wǎng)絡(luò)，存儲(chǔ)，軍事和丁業(yè)設(shè)備等各個(gè)領(lǐng)域。文中提出的對(duì)集成在DSP-TMS320C6474上的串行互連Rapidl0的性能優(yōu)化結(jié)果，是以C6474作為實(shí)驗(yàn)平臺(tái)的。這個(gè)板子上有兩個(gè)DSP處理器，通過一條串行Rapidl0總線上的兩個(gè)通道相連。

      多核TMS320C6474中串行協(xié)議RapiIO性能優(yōu)化

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