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      基于Matlab的并行循環(huán)冗余校驗Verilog代碼自動生成方法

      2017-12-12 | rar | 0.97 MB | 次下載 | 3積分

      資料介紹

      　　在水聲信號探測數(shù)據(jù)的傳輸過程中，現(xiàn)場可編程門陣列（ FPGA）通過傳統(tǒng)串行方法對長數(shù)據(jù)幀進(jìn)行循環(huán)冗余校驗（CRC）時無法達(dá)到速度要求，而更快速的并行校驗方法存在因編程復(fù)雜帶來的實際工程應(yīng)用困難問題。為了滿足傳輸對校驗速度的需求，降低編程難度和縮短編程時間，設(shè)計了一種借助Matlab對任意長度數(shù)據(jù)幀自動編寫并行CRC程序語句的方法。該計算方法基于矩陣法數(shù)學(xué)原理，借助Matlab完成所有數(shù)學(xué)推導(dǎo)計算過程，然后直接輸出符合Verilog HDL語法規(guī)則的并行CRC校驗程序語句。通過在QuartusⅡ9.0中仿真，進(jìn)一步在民用拖曳聲吶陣列系統(tǒng)上進(jìn)行數(shù)據(jù)傳輸實驗，驗證了Matlab自動編程方法的有效性：校驗程序的自動編寫輸出能在幾十秒內(nèi)完成，同時生成的并行CRC校驗程序能在滿足數(shù)據(jù)傳輸速度要求的情況下正確地計算出系統(tǒng)中傳輸協(xié)議定義的長數(shù)據(jù)幀的校驗碼。

      基于Matlab的并行循環(huán)冗余校驗Verilog代碼自動生成方法

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