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時(shí)序分析

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時(shí)序分析是以分析時(shí)間序列的發(fā)展過(guò)程、方向和趨勢(shì)，預(yù)測(cè)將來(lái)時(shí)域可能達(dá)到的目標(biāo)的方法。此方法運(yùn)用概率統(tǒng)計(jì)中時(shí)間序列分析原理和技術(shù)，利用時(shí)序系統(tǒng)的數(shù)據(jù)相關(guān)性，建立相應(yīng)的數(shù)學(xué)模型，描述系統(tǒng)的時(shí)序狀態(tài)，以預(yù)測(cè)未來(lái)。

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時(shí)序分析技術(shù)

深度解析FPGA中的時(shí)序約束

建立時(shí)間和保持時(shí)間是FPGA時(shí)序約束中兩個(gè)最基本的概念，同樣在芯片電路時(shí)序分析中也存在。

2024-08-06 標(biāo)簽：FPGA 寄存器時(shí)序分析 1151 0

芯片后仿之SDF 3.0解析(三)

本文接著解析SDF3.0的Timing Checks Entries、Timing Environment Entries兩個(gè)部分。

2024-04-16 標(biāo)簽：仿真 VCS 時(shí)序分析 2556 0

什么是鎖存器？數(shù)字IC設(shè)計(jì)中為什么要避免鎖存器？

數(shù)字IC設(shè)計(jì)里，常會(huì)出現(xiàn)鎖存器，D觸發(fā)器和寄存器，很多人（比如我）老傻傻分不清，搞不懂他們的區(qū)別是什么。

2024-02-17 標(biāo)簽：IC設(shè)計(jì)移位寄存器鎖存器 2871 0

FPGA通過(guò)SPI對(duì)ADC配置簡(jiǎn)介（三）3線SPI配置時(shí)序分析

AD9249的SPI控制模塊包含4根信號(hào)線，即CSB1、CSB2、SDIO以及SCLK。但CSB1、CSB2可以一起由CSB來(lái)控制，實(shí)際上就是3線SPI。

2023-12-12 標(biāo)簽：fpga 寄存器時(shí)序分析 3203 0

FPGA通過(guò)SPI對(duì)ADC配置簡(jiǎn)介(二)-4線SPI配置時(shí)序分析

本篇將以德州儀器(TI)的高速ADC芯片—ads52j90為例，進(jìn)行ADC的4線SPI配置時(shí)序介紹與分析。

2023-12-11 標(biāo)簽：fpga SPI 時(shí)序分析 2396 0

帶skew的時(shí)序計(jì)算基礎(chǔ)分析

組合邏輯的延遲Tc，從FF1/CK到FF1/Q的延遲為Tq，定義Treal = Tq + Tc，從建立時(shí)間和保持時(shí)間這兩個(gè)標(biāo)準(zhǔn)去考察Treal。

2023-12-01 標(biāo)簽：RTL 觸發(fā)器時(shí)序分析 1532 0

基于FPGA的時(shí)序分析設(shè)計(jì)方案

時(shí)鐘的時(shí)序特性主要分為抖動(dòng)(Jitter)、偏移(Skew)、占空比失真(Duty Cycle Distortion)3點(diǎn)。對(duì)于低速設(shè)計(jì)，基本不用考慮這...

2023-11-22 標(biāo)簽：驅(qū)動(dòng)器寄存器數(shù)字信號(hào) 876 0

后端設(shè)計(jì)PG liberty增量式生成實(shí)現(xiàn)方案

pin scope 的 pin對(duì)應(yīng)的PG 信息：這個(gè)用于工具判別信號(hào)所屬的PG網(wǎng)絡(luò)，從而對(duì)UPF flow里的isolation或者LS做合規(guī)檢查，注意...

2023-11-03 標(biāo)簽：命令時(shí)序分析 UPF 1082 0

FPGA數(shù)字電路時(shí)序分析案例

當(dāng)觸發(fā)器或寄存器在時(shí)鐘上升沿到達(dá)時(shí)將D的值賦給Q，這個(gè)過(guò)程稱之為采樣（sampling）。當(dāng)時(shí)鐘上升沿時(shí)，如果D是0或者1的穩(wěn)定狀態(tài)，那么Q也會(huì)輸出一個(gè)...

2023-10-16 標(biāo)簽：寄存器數(shù)字電路觸發(fā)器 1387 0

做好FPGA設(shè)計(jì)需要掌握哪些知識(shí)

成為一名說(shuō)得過(guò)去的FPGA設(shè)計(jì)者，需要練好5項(xiàng)基本功：仿真、綜合、時(shí)序分析、調(diào)試、驗(yàn)證。

2023-09-28 標(biāo)簽：fpga FPGA設(shè)計(jì)仿真 1023 0

I2C讀寫時(shí)序分析和實(shí)現(xiàn)思路

上篇推文對(duì)I2C總線的特性進(jìn)行了介紹和描述。對(duì)于開(kāi)發(fā)者而言，最重要的是編碼I2C的讀寫時(shí)序驅(qū)動(dòng)。本篇推文主要總結(jié)和分享I2C總線主機(jī)端通信的編程實(shí)現(xiàn)思路...

2023-10-01 標(biāo)簽：fpga I2C I2C總線 2529 0

單片機(jī)的三總線結(jié)構(gòu)與總線時(shí)序分析

計(jì)算機(jī)系統(tǒng)是以微處理器為核心的，各器件要與微處理器相連，且必須協(xié)調(diào)工作，所以在微處理機(jī)中引入了總線的概念，各器件共同享用總線，任何時(shí)候只能有一個(gè)器件發(fā)送...

2023-09-13 標(biāo)簽：微處理器 51單片機(jī)時(shí)序分析 4136 0

芯片制造的成本和工藝流程分析

設(shè)計(jì)驗(yàn)證需要滿足性能、功能和架構(gòu)等三個(gè)主要標(biāo)準(zhǔn)。首先需要滿足功能標(biāo)準(zhǔn)，然后進(jìn)行設(shè)計(jì)驗(yàn)證，驗(yàn)證設(shè)計(jì)的芯片是否能夠正常工作。如果芯片能夠正常工作，則進(jìn)行后端...

2023-09-10 標(biāo)簽：芯片設(shè)計(jì)時(shí)序分析納米芯片 1575 0

FPGA時(shí)序約束之時(shí)序路徑和時(shí)序模型

時(shí)序路徑作為時(shí)序約束和時(shí)序分析的物理連接關(guān)系，可分為片間路徑和片內(nèi)路徑。

2023-08-14 標(biāo)簽：fpga 寄存器時(shí)序分析 1013 0

時(shí)序分析基本概念解析

正如“聚合”的意思（字典）“兩個(gè)或多個(gè)事物聚集在一起的發(fā)生”。所以我們可以假設(shè)它也與 2 個(gè)時(shí)鐘路徑聚集在一起有關(guān)。（了解時(shí)鐘路徑請(qǐng)參考另一篇博客-靜...

2023-08-08 標(biāo)簽：時(shí)鐘觸發(fā)器時(shí)序分析 1314 0

FPGA時(shí)序分析-建立時(shí)間和保持時(shí)間裕量都是inf怎么解決呢？

今天有個(gè)小伙伴遇到一個(gè)問(wèn)題，就是在vivado里面綜合后看到的建立時(shí)間和保持時(shí)間裕量都是inf，我們來(lái)看看怎么解決這個(gè)問(wèn)題。

2023-07-30 標(biāo)簽：fpga FPGA設(shè)計(jì)寄存器 1621 0

時(shí)鐘樹(shù)：芯片的大動(dòng)脈

我覺(jué)得稱時(shí)鐘樹(shù)為芯片的大動(dòng)脈一點(diǎn)也不夸張，因?yàn)樗衒lipflop 翻轉(zhuǎn)都要受到它的控制。而時(shí)鐘樹(shù)的設(shè)計(jì)到實(shí)現(xiàn)是一個(gè)很復(fù)雜的過(guò)程，從流程上說(shuō)，它牽扯到使...

2023-07-15 標(biāo)簽：芯片 pll 時(shí)序分析 5822 0

什么是時(shí)序分析？教你掌握FPGA時(shí)序約束

時(shí)序分析本質(zhì)上就是一種時(shí)序檢查，目的是檢查設(shè)計(jì)中所有的D觸發(fā)器是否能夠正常工作，也就是檢查D觸發(fā)器的同步端口（數(shù)據(jù)輸入端口）的變化是否滿足建立時(shí)間要求（...

2023-07-14 標(biāo)簽：RAM D觸發(fā)器時(shí)序分析 4293 0

時(shí)序分析基本概念介紹—花一樣的“模式”

今天要介紹的時(shí)序基本概念是Mode（模式）. 這是Multiple Scenario環(huán)境下Sign off的一個(gè)重要概念。芯片的設(shè)計(jì)模式包括最基本的功能...

2023-07-10 標(biāo)簽：寄存器存儲(chǔ)器芯片設(shè)計(jì) 4323 0

時(shí)序分析基本概念介紹<Combinational logic>

今天我們要介紹的時(shí)序分析概念是Combinational logic. 中文名組合邏輯單元。這是邏輯單元的基本組成器件。

2023-07-10 標(biāo)簽：門電路全加器時(shí)序分析 1043 0

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