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標(biāo)簽 > 芯片設(shè)計(jì)
《芯片設(shè)計(jì)》是2009年11月上??茖W(xué)技術(shù)出版社出版的圖書(shū),作者是(德)B.科爾特,(德)J.菲根。
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總結(jié)一下pipeline流水線設(shè)計(jì)的關(guān)鍵點(diǎn)
pipeline流水線設(shè)計(jì)是一種典型的面積換性能的設(shè)計(jì)。一方面通過(guò)對(duì)長(zhǎng)功能路徑的合理劃分,在同一時(shí)間內(nèi)同時(shí)并行多個(gè)該功能請(qǐng)求,大大提高了某個(gè)功能的吞吐率
2023-06-27 標(biāo)簽:處理器芯片設(shè)計(jì)乘法器 2806 0
異步電路不能根據(jù)時(shí)鐘是否同源來(lái)界定,時(shí)鐘之間沒(méi)有確定的相位關(guān)系是唯一準(zhǔn)則。
2023-06-27 標(biāo)簽:FPGA設(shè)計(jì)芯片設(shè)計(jì)異步電路 1323 0
什么是IR-drop?其實(shí),IR這個(gè)詞并不是什么縮寫(xiě),這里的I就是指電流,R是指電阻,他們放在一起相乘,得出來(lái)的結(jié)果就是電壓。
2023-06-16 標(biāo)簽:寄存器芯片設(shè)計(jì)PAD 8793 0
直接在網(wǎng)表中插入RTL來(lái)快速做芯片功能ECO
近幾年,芯片設(shè)計(jì)規(guī)模越來(lái)越大,這使得重跑一次綜合需要長(zhǎng)達(dá)數(shù)小時(shí),甚至幾天時(shí)間。
2023-06-15 標(biāo)簽:芯片設(shè)計(jì)RTLECO 1313 0
面對(duì)復(fù)雜的設(shè)計(jì)代碼,我們?nèi)绾未_保其準(zhǔn)確性?功能驗(yàn)證就是這場(chǎng)戰(zhàn)斗的關(guān)鍵過(guò)程。工程師們通常使用的驗(yàn)證方法包括軟件仿真、硬件仿真和原型驗(yàn)證等。這些不同的驗(yàn)證方...
2023-06-11 標(biāo)簽:寄存器芯片設(shè)計(jì)仿真 1490 0
對(duì)于工程設(shè)計(jì)人員來(lái)講,IGBT芯片的性能,可以從規(guī)格書(shū)中很直觀地得到。但是,系統(tǒng)設(shè)計(jì)時(shí),這些性能能夠發(fā)揮出來(lái)多少,就要看“封裝“了,畢竟夏天穿著棉襖工作...
2023-06-09 標(biāo)簽:電動(dòng)汽車(chē)封裝逆變器 1016 0
整個(gè)實(shí)現(xiàn)階段,可以概括成玩EDA 工具及基于EDA 工具的方法學(xué),EDA 工具無(wú)疑是實(shí)現(xiàn)階段的主導(dǎo),一顆芯片做得好不好,在實(shí)現(xiàn)階段之前基本取決于工程師的...
2023-06-07 標(biāo)簽:集成電路芯片設(shè)計(jì)eda 3301 0
LEF和DEF是APR工程師工作中經(jīng)常會(huì)碰到的兩類(lèi)文件,也會(huì)對(duì)APR的基礎(chǔ)配置和APR的flow產(chǎn)生直接的影響?;鞠喈?dāng)于APR物理設(shè)計(jì)的基礎(chǔ)建設(shè)。
2023-06-07 標(biāo)簽:芯片設(shè)計(jì)DRCapr 9721 0
數(shù)字IC設(shè)計(jì)流程中為什么要做門(mén)級(jí)仿真?
門(mén)級(jí)仿真(gate levelsimulation)也稱(chēng)之為后仿真,是數(shù)字IC設(shè)計(jì)流程中的一個(gè)重要步驟。
2023-06-07 標(biāo)簽:IC設(shè)計(jì)芯片設(shè)計(jì)仿真 2433 0
直接在網(wǎng)表中插入RTL來(lái)快速做芯片功能ECO
我們?cè)诰W(wǎng)表里直接插入了RTL的always語(yǔ)句,對(duì)wr_data_7_進(jìn)行了打拍和簡(jiǎn)單邏輯處理(新加的邏輯所需要的輸入信號(hào)都可以在原網(wǎng)表中找到),把處理...
2023-06-06 標(biāo)簽:芯片設(shè)計(jì)RTLECO 2797 0
芯片設(shè)計(jì)過(guò)程是一項(xiàng)復(fù)雜的多步驟工作,涉及從初始系統(tǒng)規(guī)格到制造的各個(gè)階段。每一步對(duì)于實(shí)現(xiàn)生產(chǎn)完全可用芯片的目標(biāo)都至關(guān)重要。本文概述了芯片設(shè)計(jì)流程、不同階段...
EDA集成電路設(shè)計(jì)實(shí)現(xiàn)流程講解
外部世界是一個(gè)模擬世界,故所有需要與外部世界接口的部分都需要模擬集成電路,模擬集成電路將采集到的外部信息轉(zhuǎn)化成0/1 交給數(shù)字集成電路運(yùn)算處理,再將數(shù)字...
2023-06-05 標(biāo)簽:集成電路芯片設(shè)計(jì)eda 1617 0
芯片設(shè)計(jì)是一個(gè)復(fù)雜的過(guò)程,需要從概念到最終產(chǎn)品的多個(gè)階段,涉及到不同的技術(shù)和工具。本文將介紹芯片設(shè)計(jì)的主要流程和其中涉及的技術(shù)和工具。
2023-06-03 標(biāo)簽:測(cè)試封裝芯片設(shè)計(jì) 1.0萬(wàn) 0
芯華章淺談eda、Chiplet等新型技術(shù)趨勢(shì)
從傳統(tǒng)的E/E架構(gòu)到跨域融合,再到中央集成式域控制器,基于單SoC芯片的艙駕融合方案已成為當(dāng)前的重點(diǎn)研發(fā)方向。芯粒(Chiplet)技術(shù)的出現(xiàn),為通過(guò)架...
2023-05-25 標(biāo)簽:芯片設(shè)計(jì)eda芯華章 399 0
淺談芯片設(shè)計(jì)的5個(gè)難關(guān)
對(duì)于芯片來(lái)說(shuō)設(shè)計(jì)和工藝同樣復(fù)雜,八十年代EDA技術(shù)誕生——芯片自動(dòng)化設(shè)計(jì),使得芯片設(shè)計(jì)以及超大規(guī)模集成電路的難度大為降低。
2023-05-17 標(biāo)簽:集成電路芯片設(shè)計(jì)eda 886 0
AMD在2003年推出的基于K8微架構(gòu)的64位速龍?zhí)幚砥?,因其?qiáng)悍的性能成為高端游戲玩家的主流配置。其市場(chǎng)份額也在逐年攀升,甚至在桌面CPU領(lǐng)域的市占率...
2023-05-15 標(biāo)簽:cpu芯片設(shè)計(jì)eda 1827 0
制作半導(dǎo)體產(chǎn)品的第一步,就是根據(jù)所需功能設(shè)計(jì)芯片(Chip)。然后,再將芯片制作成晶圓(Wafer)。由于晶圓由芯片反復(fù)排列而成,當(dāng)我們細(xì)看已完成的晶圓...
2023-05-11 標(biāo)簽:半導(dǎo)體芯片設(shè)計(jì)晶圓測(cè)試 3202 0
芯片設(shè)計(jì)里的Multi-Bit FF方法討論
在現(xiàn)代的芯片設(shè)計(jì)里邊,工程師在優(yōu)化功耗和面積上無(wú)所不有其極,這里討論的multi-bit FF 就是其中的一種方法或者稱(chēng)之為一種流程。
2023-05-08 標(biāo)簽:芯片設(shè)計(jì)RTLDCT 2403 0
集成電路產(chǎn)業(yè)鏈由上、中、下游三部分組成。集成電路產(chǎn)業(yè)鏈的上游包括EDA、IP、材料和設(shè)備等供應(yīng)商;產(chǎn)業(yè)鏈中游主要包括芯片設(shè)計(jì)、晶圓制造和封裝測(cè)試等企業(yè);...
2023-04-25 標(biāo)簽:集成電路物聯(lián)網(wǎng)芯片設(shè)計(jì) 2423 0
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