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標(biāo)簽 > 賽靈思
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DAVE嵌入式系統(tǒng)在嵌入式世界2015中展示了Matrix多重HLS IP和DAVE Bora套件
用于數(shù)據(jù)包處理的高級(jí)語(yǔ)言P4的探討
由Xilinx,Barefoot Networks,Netcope Technologies和MoSys提供的OFC 2017小組會(huì)議討論了P4的采用,...
2018-11-28 標(biāo)簽:fpgaasic數(shù)據(jù) 2383 0
Spartan-6 FPGA消費(fèi)類視頻套件提供了一種更簡(jiǎn)單的方式來(lái)更新和修改視頻算法,并采用了新的視頻標(biāo)準(zhǔn),如DisplayPort和V-by-One-HS。
采用Dyplo Runtime OS擴(kuò)展提高系統(tǒng)級(jí)性能
主題嵌入式系統(tǒng)產(chǎn)品經(jīng)理Rene Zenden展示了采用Zynq All Programmable SoC的Dyplo Runtime OS擴(kuò)展如何以更低...
AWS F1硬件平臺(tái)的技術(shù)規(guī)范及注意事項(xiàng) (4-2)
此培訓(xùn)視頻介紹了AWS F1硬件平臺(tái)的技術(shù)規(guī)范。 觀看此視頻以了解AWS FPGA中的各個(gè)區(qū)域,了解AWS F1 Shell并查看重要的性能注意事項(xiàng)。
把握DCM、PLL、PMCD和MMCM知識(shí)是穩(wěn)健可靠的時(shí)鐘設(shè)計(jì)策略的基礎(chǔ)。賽靈思在其FPGA中提供了豐富的時(shí)鐘資源,大多數(shù)設(shè)計(jì)人員在他們的FPGA設(shè)計(jì)中...
EyeTech數(shù)字系統(tǒng)實(shí)現(xiàn)自然用戶界面眼圖跟蹤芯片技術(shù)
采用Zynq?全可編程SoC實(shí)現(xiàn)的快速自然用戶界面眼圖跟蹤芯片技術(shù)
2018-11-30 標(biāo)簽:芯片賽靈思計(jì)算機(jī) 2354 0
如何使用Xilinx的All Programmable SoC進(jìn)行邊緣機(jī)器學(xué)習(xí)
GL Research的Javier Garcia于2018年1月9日在法蘭克福的XDF 2018的Edge Track中提供了一個(gè)用例演示.Javie...
2018-11-23 標(biāo)簽:賽靈思soc機(jī)器學(xué)習(xí) 2353 0
賽靈思將演示來(lái)自安富利公司的智能視覺(jué)開(kāi)發(fā)套件的智能視覺(jué)處理示例
在本次研討會(huì)中,賽靈思將向您演示來(lái)自安富利公司的智能視覺(jué)開(kāi)發(fā)套件(SVDK)以及基于該套件的靈活的智能視覺(jué)處理示例。
2019-08-01 標(biāo)簽:賽靈思系統(tǒng)構(gòu)架智能視覺(jué) 2352 0
這個(gè)Xilinx Quick Take Video我們將討論Constraint Explosion。 在本次會(huì)議中,我們將研究導(dǎo)致時(shí)序約束爆炸的原因...
賽靈思(Xilinx)面向網(wǎng)絡(luò)和數(shù)據(jù)中心的更智能的解決方案針對(duì)三大細(xì)分市場(chǎng):(1)更智能的無(wú)線 HetNet;(2)更智能有線網(wǎng)絡(luò),包括邊緣和電信級(jí)以太...
Xilinx 戰(zhàn)略應(yīng)用高級(jí)工程師,專注于 C/C++ 高層次綜合,擁有多年利用 Xilinx FPGA 實(shí)現(xiàn)數(shù)字信號(hào)處理算法的經(jīng)驗(yàn),對(duì) Xilinx F...
這種自動(dòng)駕駛演示運(yùn)行了當(dāng)今自動(dòng)系統(tǒng)中常用的三種主要復(fù)雜算法,即卷積神經(jīng)網(wǎng)絡(luò)(CNN),密集光流和立體視覺(jué),所有這些都在一個(gè)Zynq Ultrascale...
2018-11-28 標(biāo)簽:神經(jīng)網(wǎng)絡(luò)賽靈思自動(dòng)駕駛 2323 0
使用全可編程SoC實(shí)現(xiàn)完整的射頻單元設(shè)計(jì)研發(fā)會(huì)
運(yùn)營(yíng)商一直在努力尋求更高的帶寬,兼容多種無(wú)線空口標(biāo)準(zhǔn),并支持更多天線以從MIMO增益中獲益。研討會(huì)將共同探討如何才能滿足運(yùn)營(yíng)商的這些需求,并同時(shí)滿足成本...
如何在EDK中使用自己的 IP核呢? 這是很多人夢(mèng)寐以求的事情。然而在EDK以及ISE的各種文檔中對(duì)此卻遮遮掩掩,欲語(yǔ)還休。
從可編程器件發(fā)展看FPGA未來(lái)趨勢(shì)
可編程邏輯器件的發(fā)展歷史可編程邏輯器件的發(fā)展可以劃分為4個(gè)階段,即從20世紀(jì)70年代初到70年代中為第1段,20世紀(jì)70年代中到80年代中為第2階段,2...
Reconova Technology開(kāi)發(fā)智能傳感產(chǎn)品
Reconova Technology為智能家電,智能零售,智能安全開(kāi)發(fā)基于機(jī)器視覺(jué)的智能傳感產(chǎn)品。
2018-11-27 標(biāo)簽:賽靈思智能機(jī)器視覺(jué) 2293 0
使用賽靈思的功耗估計(jì)器和分析器工具協(xié)助功耗優(yōu)化的步驟有哪些?
FPGA與眾多其它類型組件的不同之處在于,其核心電壓、輔助電壓和I/O電壓電源需求取決于設(shè)計(jì)實(shí)現(xiàn)。因此,確定應(yīng)用中FPGA的功耗比數(shù)據(jù)手冊(cè)描述的情況更...
賽靈思全可編程的解決方案助力你通過(guò)差異化在競(jìng)爭(zhēng)者脫穎而出
我們誠(chéng)摯地邀請(qǐng)您光臨我們的展位 (H05)觀看更多精彩演示,現(xiàn)場(chǎng)每一個(gè)產(chǎn)品都會(huì)有專家為您演示與講解。助您快速掌握最熱門(mén)的創(chuàng)客利器 —— 全可編程技術(shù)。P...
Vivado:行業(yè)首款 SoC 增強(qiáng)型設(shè)計(jì)套件最新消息
交互式時(shí)鐘域的交叉分析:該功能支持設(shè)計(jì)人員在設(shè)計(jì)早期階段調(diào)試CDC問(wèn)題。結(jié)合Vivado設(shè)計(jì)套件的交互式時(shí)序分析和交叉探測(cè)特性,CDC分析功能可提供強(qiáng)大...
2019-08-01 標(biāo)簽:賽靈思仿真器系統(tǒng)級(jí) 2284 0
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