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      標簽　>　集成電路設(shè)計

      集成電路設(shè)計

      +關(guān)注4人關(guān)注

      集成電路設(shè)計（Integrated circuit design， IC design），亦可稱之為超大規(guī)模集成電路設(shè)計（VLSI design），是指以集成電路、超大規(guī)模集成電路為目標的設(shè)計流程。集成電路設(shè)計涉及對電子器件（例如晶體管、電阻器、電容器等）、器件間互連線模型的建立。

      文章：39個 瀏覽：18052次 帖子：1個

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