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      標簽　>　fpga設(shè)計

      fpga設(shè)計

      fpga設(shè)計

      +關(guān)注9人關(guān)注

      FPGA（Field－Programmable Gate Array），即現(xiàn)場可編程門陣列，它是在PAL、GAL、CPLD等可編程器件的基礎(chǔ)上進一步發(fā)展的產(chǎn)物。

      文章：348個 瀏覽：27250次 帖子：90個

      fpga設(shè)計技術(shù)

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      AXI4協(xié)議是一個點對點的主從接口協(xié)議，數(shù)據(jù)可以同時在主機（Master）和從機（Slave）之間**雙向** **傳輸** ，且數(shù)據(jù)傳輸大小可以不同。

      2023-06-21 標簽：FPGA設(shè)計FIFO存儲BRAM 3909 0

      Xilinx FPGA AXI4總線（一）介紹【AXI4】【AXI4-Lite】【AXI-Stream】

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      從 FPGA 應(yīng)用角度看看 AMBA 總線中的 AXI4 總線。

      2023-06-21 標簽：控制器FPGA設(shè)計DDR 2748 0

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      .mif 和 .coe 是 FPGA 設(shè)計中常用的存儲文件，用于 ROM、RAM 等存儲器數(shù)據(jù)的加載，常見的還用在 DDS 信號發(fā)生器和 FIR 濾波器...

      2023-06-21 標簽：FPGA設(shè)計存儲器DDS 6207 0

      CDC跨時鐘域處理及相應(yīng)的時序約束

      CDC（Clock Domain Conversion）跨時鐘域分單bit和多bit傳輸

      2023-06-21 標簽：FPGA設(shè)計RAMCDC 2292 0

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      對應(yīng)的IP端口處也會出現(xiàn)相應(yīng)的端口，例如上圖選擇了2個Quad，也就是8個通道的串行收發(fā)器，那么對應(yīng)的drp接口就有8個。

      2023-06-21 標簽：收發(fā)器FPGA設(shè)計串行收發(fā)器 1500 0

      講解幾點關(guān)于FIFO IP核使用時的注意事項

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      FIFO？還是FIFO IP核？這也需要寫總結(jié)嗎？太容易了吧。如果我是一個正在處于面試找工作中的年輕人，肯定關(guān)注的是如何手撕FIFO，這也是當時校招時候...

      2023-06-21 標簽：FPGA設(shè)計寄存器RAM 1980 0

      Xilinx的高質(zhì)量時鐘輸出ODDR原語

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      在SDR接口中，ODDR轉(zhuǎn)發(fā)時鐘（仍在時鐘樹內(nèi)），輸出端要直連到輸出port，不可加邏輯，連接方式：輸出時鐘連接ODDR的C引腳，D1固定值1&apos...

      2023-06-21 標簽：FPGA設(shè)計SDRRTL 2750 0

      ZC706評估板IBERT誤碼率測試和眼圖掃描

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      IBERT（Integrated Bit ErrorRatio Tester，集成誤比特率測試工具），是Xilinx提供用于調(diào)試FPGA高速串行接口比特...

      2023-06-21 標簽：收發(fā)器FPGA設(shè)計寄存器 4484 0

      關(guān)于行為仿真的一點觀點

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      仿真是為了仿真，所以不要設(shè)置極限情況，例如在時鐘上升沿通過阻塞賦值給數(shù)據(jù)，應(yīng)該避免這種情況；

      2023-06-21 標簽：FPGA設(shè)計仿真器Vivado 667 0

      FPGA設(shè)計心得之Aurora IP核例子簡析與仿真

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      FLow Control 暫時選擇為None。（有必要后面專門研究，暫時最主要的還是弄懂用戶接口信號的用法?。?/p>

      2023-06-21 標簽：FPGA設(shè)計移位寄存器狀態(tài)機 2209 0

      你真的會Xilinx FPGA的復(fù)位嗎？

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      對于復(fù)位信號的處理，為了方便我們習(xí)慣上采用全局復(fù)位，博主在很長一段時間內(nèi)都是將復(fù)位信號作為一個I/O口，通過撥碼開關(guān)硬件復(fù)位。

      2023-06-21 標簽：FPGA設(shè)計觸發(fā)器狀態(tài)機 1598 0

      不得不讀的Xilinx FPGA復(fù)位策略

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      盡量少使用復(fù)位，特別是少用全局復(fù)位，能不用復(fù)位就不用，一定要用復(fù)位的使用局部復(fù)位；

      2023-06-21 標簽：FPGA設(shè)計微處理器觸發(fā)器 3016 0

      乘法器的Verilog HDL實現(xiàn)方案

      乘法器的Verilog HDL實現(xiàn)方案

      兩個N位二進制數(shù)x、y的乘積用簡單的方法計算就是利用移位操作來實現(xiàn)。

      2023-06-21 標簽：FPGA設(shè)計HDL乘法器 1566 0

      怎么通過搗鼓FPGA板把數(shù)碼管給點亮并顯示有效信息？

      怎么通過搗鼓FPGA板把數(shù)碼管給點亮并顯示有效信息？

      今天我們?nèi)蝿?wù)是通過小腳丫板載的兩個數(shù)碼管來顯示字符，所以首先我們要了解一下數(shù)碼管的基本工作原理，接下來再研究怎么通過搗鼓小腳丫把數(shù)碼管給點亮，并且顯示出...

      2023-06-20 標簽：FPGA設(shè)計led燈數(shù)碼管 1792 0

      通過小腳丫FPGA核心開發(fā)板來進行門電路的設(shè)計

      通過小腳丫FPGA核心開發(fā)板來進行門電路的設(shè)計

      在數(shù)字電路中，門電路是最基本的構(gòu)成單位，可以說，任何復(fù)雜的數(shù)字電路系統(tǒng)都可以通過我們耳熟能詳?shù)呐c門，非門，或門，與非門，異或門等等組合實現(xiàn)。

      2023-06-20 標簽：FPGA設(shè)計led燈MOS管 1588 0

      簡易FM信號解調(diào)的FPGA實現(xiàn)過程講解

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      FM解調(diào)需要去掉載波得到基帶的信號，考慮到FM的特殊性，使用參考資料1中的小角度近似解調(diào)算法

      2023-06-20 標簽：濾波器FPGA設(shè)計正弦波 6433 0

      介紹FPGA在線調(diào)試的一大利器—VIO

      介紹FPGA在線調(diào)試的一大利器—VIO

      之前的文章介紹了FPGA在線調(diào)試的方法，包括選定抓取信號，防止信號被優(yōu)化的方法等等。

      2023-06-20 標簽：FPGA設(shè)計DDS觸發(fā)器 8524 0

      FPGA純verilog編解碼SDI實現(xiàn)流程

      FPGA純verilog編解碼SDI實現(xiàn)流程

      一是使用專用編解碼芯片，比如典型的接收器GS2971，發(fā)送器GS2972，優(yōu)點是簡單，比如GS2971接收器直接將SDI解碼為并行的YCRCB，GS29...

      2023-06-19 標簽：FPGA設(shè)計DDR3接收器 2730 0

      FPGA在線調(diào)試的方法簡單總結(jié)

      FPGA在線調(diào)試的方法簡單總結(jié)

      Xilinx被AMD收購的事情把我震出來了，看了看上上一篇文章講了下仿真的文件操作，這篇隔了很久遠，不知道該從何講起，就說說FPGA的在線調(diào)試的一些簡單...

      2023-06-19 標簽：FPGA設(shè)計RTLAXI總線 2371 0

      多片F(xiàn)PGA原型驗證的限制因素有哪些？

      當SoC系統(tǒng)的規(guī)模很大的時候，單片F(xiàn)PGA驗證平臺已經(jīng)無法容納這么多容量，我們將采取將SoC設(shè)計劃分為多個FPGA的映射。

      2023-06-19 標簽：FPGA設(shè)計連接器TDM 859 0

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      • Protues
        Protues
        +關(guān)注
        Proteus軟件是英國Lab Center Electronics公司出版的EDA工具軟件（該軟件中國總代理為廣州風標電子技術(shù)有限公司）。它不僅具有其它EDA工具軟件的仿真功能，還能仿真單片機及外圍器件。
      • 靜電防護
        靜電防護
        +關(guān)注
        為防止靜電積累所引起的人身電擊、火災(zāi)和爆炸、電子器件失效和損壞，以及對生產(chǎn)的不良影響而采取的防范措施。其防范原則主要是抑制靜電的產(chǎn)生，加速靜電泄漏，進行靜電中和等。
      • Altium Designer
        Altium Designer
        +關(guān)注
      • FPGA芯片
        FPGA芯片
        +關(guān)注
        FPGA（Field－Programmable Gate Array），即現(xiàn)場可編程門陣列，它是在PAL、GAL、CPLD等可編程器件的基礎(chǔ)上進一步發(fā)展的產(chǎn)物。
      • ArduBlock
        ArduBlock
        +關(guān)注
        ArduBlock軟件是Arduino官方編程環(huán)境的第三方軟件，目前必須依附于Arduino軟件下運行，區(qū)別于Arduino文本式編程環(huán)境，ArduBlock是以圖形化積木搭建的方式編程的，這樣的方式會使編程的可視化和交互性加強，編程門檻降低，即使沒有編程經(jīng)驗的人也可以嘗試給Arduino控制器編寫程序。
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      • FPGA開發(fā)板
        FPGA開發(fā)板
        +關(guān)注
        FPGA開發(fā)板在基于MCU、定制ASIC和體積龐大的電線束來實現(xiàn)引擎及控制電子的系統(tǒng)方案已發(fā)展至接近其技術(shù)和應(yīng)用極限，汽車工業(yè)正面臨新的設(shè)計挑戰(zhàn)。過去汽車電子產(chǎn)品的開發(fā)周期是漫長的，而許多汽車制造商現(xiàn)正致力于在更短的時間內(nèi)，裝備消費者所需的新一代汽車。
      • PCB封裝
        PCB封裝
        +關(guān)注
        pcb封裝就是把 實際的電子元器件，芯片等的各種參數(shù)（比如元器件的大小，長寬，直插，貼片，焊盤的大小，管腳的長寬，管腳的間距等）用圖形方式表現(xiàn)出來，以便可以在畫pcb圖時進行調(diào)用。
      • QUARTUS II
        QUARTUS II
        +關(guān)注
        Quartus II 是Altera公司推出的綜合性CPLD/FPGA開發(fā)軟件，軟件支持原理圖、VHDL、VerilogHDL以及AHDL（Altera Hardware 支持Description Language）等多種設(shè)計輸入形式，內(nèi)嵌自有的綜合器以及仿真器，可以完成從設(shè)計輸入到硬件配置的完整PLD設(shè)計流程。
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        語音交互
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      • PCB封裝庫
        PCB封裝庫
        +關(guān)注
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        +關(guān)注
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        QuickPcb
        +關(guān)注
      • Artix-7
        Artix-7
        +關(guān)注
        　　Artix-7 系列：相對于 Spartan-6 系列而言，Artix-7 系列功耗降低了一半， 成本降低了 35%，采用小型化封裝、統(tǒng)一的 Virtex 系列架構(gòu)，能滿足低成本大批量市場的性能要求，這也正是此前 ASSP、ASIC 和低成本 FPGA 所針對的市場領(lǐng)域。
      • VHDL代碼
        VHDL代碼
        +關(guān)注
      • Protel 99 se
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        +關(guān)注
      • powerlink
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        +關(guān)注
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        candence
        +關(guān)注
      • 面包板
        面包板
        +關(guān)注
        面包板是由于板子上有很多小插孔，專為電子電路的無焊接實驗設(shè)計制造的。由于各種電子元器件可根據(jù)需要隨意插入或拔出，免去了焊接，節(jié)省了電路的組裝時間，而且元件可以重復(fù)使用，所以非常適合電子電路的組裝、調(diào)試和訓(xùn)練。
      • AXI
        AXI
        +關(guān)注
        AXI是一種總線協(xié)議，該協(xié)議是ARM公司提出的AMBA3.0協(xié)議中最重要的部分，是一種面向高性能、高帶寬、低延遲的片內(nèi)總線。它的地址/控制和數(shù)據(jù)相位是分離的，支持不對齊的數(shù)據(jù)傳輸，同時在突發(fā)傳輸中，只需要首地址，同時分離的讀寫數(shù)據(jù)通道、并支持Outstanding傳輸訪問和亂序訪問，并更加容易進行時序收斂。AXI是AMBA中一個新的高性能協(xié)議。
      • 特性阻抗
        特性阻抗
        +關(guān)注
        特性阻抗又稱特征阻抗，它不是直流電阻，屬于長線傳輸中的概念。特性阻抗是射頻傳輸線影響無線電波電壓、電流的幅值和相位變化的固有特性，等于各處的電壓與電流的比值，用V/I表示。在射頻電路中，電阻、電容、電感都會阻礙交變電流的流動，合稱阻抗。電阻是吸收電磁能量的，理想電容和電感不消耗電磁能量。
      • 時鐘源
        時鐘源
        +關(guān)注
        時鐘源用來為環(huán)形脈沖發(fā)生器提供頻率穩(wěn)定且電平匹配的方波時鐘脈沖信號。它通常由石英 晶體振蕩器和與非門組成的正反饋振蕩電路組成，其輸出送至環(huán)形脈沖發(fā)生器。
      • AD采樣
        AD采樣
        +關(guān)注
        　　AD轉(zhuǎn)換采樣頻率指完成一次從模擬轉(zhuǎn)換到數(shù)字的AD轉(zhuǎn)換所需時間的倒數(shù)，模擬量可以是電壓、電流等電信號，也可以是壓力、溫度、濕度、位移、聲音等非電信號；而AD分辨率指數(shù)字量變化一個最小量時模擬信號的變化量。
      • 驅(qū)動電流
        驅(qū)動電流
        +關(guān)注
      • Kintex-7
        Kintex-7
        +關(guān)注
        　　Kintex-7系列：Kintex-7 系列是一種新型 FPGA，能以不到 Virtex-6 系列一半的價格實現(xiàn)與其相當性能，性價比提高了一倍，功耗降低了一半。
      • Protel DXP
        Protel DXP
        +關(guān)注
      • FPGA教程
        FPGA教程
        +關(guān)注
      • 紅外觸摸屏
        紅外觸摸屏
        +關(guān)注
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      模數(shù)轉(zhuǎn)換器 數(shù)模轉(zhuǎn)換器 數(shù)字電位器 觸摸屏控制器 AFE ADC DAC 電源管理
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      振蕩器 諧振器 濾波器 電容器 電感器 電阻器 二極管 晶體管
      變送器 傳感器 解析器 編碼器 陀螺儀 加速計 溫度傳感器 壓力傳感器
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