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FPGA(Field-Programmable Gate Array),即現(xiàn)場可編程門陣列,它是在PAL、GAL、CPLD等可編程器件的基礎(chǔ)上進(jìn)一步發(fā)展的產(chǎn)物。它是作為專用集成電路(ASIC)領(lǐng)域中的一種半定制電路而出現(xiàn)的,既解決了定制電路的不足,又克服了原有可編程器件門電路數(shù)有限的缺點(diǎn)。
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頻譜監(jiān)測與信號智能系統(tǒng)的系統(tǒng)組件詳解
頻譜監(jiān)測和信號智能涉及使用工具和技術(shù)來分析無線電頻譜。頻譜監(jiān)測為用戶、監(jiān)管機(jī)構(gòu)及情報(bào)小組提供了關(guān)于頻譜正在如何被使用的有用信息。從監(jiān)管的角度來看,頻譜監(jiān)...
FPGA VI或程序生成規(guī)范的引用的基礎(chǔ)教程
主VI可用于與運(yùn)行在FPGA終端上的FPGA VI或位文件通信。主VI可運(yùn)行在計(jì)算機(jī)上或RT終端上。每個(gè)主VI必須打開運(yùn)行在FPGA終端上的FPGA V...
FPGA中主控VI等待和確認(rèn)信號終端與等待和確認(rèn)多個(gè)中斷步驟教程
某些FPGA終端允許通過FPGA VI生成中斷以通知主控VI事件。例如,數(shù)據(jù)已準(zhǔn)備好、產(chǎn)生錯(cuò)誤或任務(wù)完成。如要判定終端是否支持中斷,請?jiān)L問FPGA終端屬...
采用流水線進(jìn)行FPGA VI吞吐量優(yōu)化設(shè)計(jì)
流水線是一種可用于增強(qiáng)FPGA VI吞吐量的技術(shù)。在流水線設(shè)計(jì)中,用戶可利用FPGA的并行處理功能提高順序代碼的有效性。如要實(shí)現(xiàn)流水線,必須將代碼拆分為...
現(xiàn)在的大多數(shù)儀器通過將封閉式FPGA與固定固件相結(jié)合來實(shí)現(xiàn)儀器的各種功能。如果您看過一個(gè)拆解后的示波器,您可能已經(jīng)看過里面的FPGA。 FPGA提高了測...
每個(gè)FPGA芯片(FPGA)是由有限個(gè)帶有可編程連接預(yù)定義資源組成。這些互連資源通過LabVIEW FPGA模塊實(shí)現(xiàn)用戶設(shè)計(jì)的數(shù)字電路。用戶創(chuàng)建FPGA...
集成Xilinx內(nèi)核生成器IP至FPGA VI詳細(xì)步驟
LabVIEW使用IP集成節(jié)點(diǎn)方便的整合Xilinx內(nèi)核生成IP至FPGA VI。按照下列步驟添加Xilinx內(nèi)核生成器IP至FPGA VI。 1、在支...
FPGA VI中不同的Xilinx內(nèi)核生成器IP設(shè)計(jì)實(shí)現(xiàn)與子模板說明
所屬選板:FPGA模塊VI和函數(shù) 必需:FPGA模塊。本主題的內(nèi)容可能與您所安裝的LabVIEW選板不匹配,LabVIEW選板上顯示的對象取決于操作系統(tǒng)...
LabVIEW FPGA模塊在時(shí)鐘電路的運(yùn)用
如要使用數(shù)據(jù)流模型執(zhí)行代碼,LabVIEW將同步FPGA上的邏輯。默認(rèn)情況下,LabVIEW FPGA在程序框圖的邏輯函數(shù)間放置一個(gè)寄存器,以最大化每個(gè)...
基于FPGA 的嵌入式系統(tǒng)程序開發(fā)實(shí)現(xiàn)對ARM 接口通信控制模塊、芯片驅(qū)動(dòng)模塊的程序設(shè)計(jì)
數(shù)字存儲(chǔ)示波器采用ARM 與FPGA 雙處理器結(jié)合的嵌入式系統(tǒng)設(shè)計(jì)方案,重點(diǎn)介紹在FPGA 中如何實(shí)現(xiàn)對外圍芯片的通信與驅(qū)動(dòng),采用VHDL 語言,以逐層...
基于FPGA的軟硬件協(xié)同測試設(shè)計(jì)影響因素分析與設(shè)計(jì)實(shí)現(xiàn)
在軟硬件的開發(fā)階段中,測試結(jié)果直接關(guān)系到這個(gè)軟硬件能否順利進(jìn)行調(diào)試應(yīng)用。其中,硬件的測試往往容易受外界因素的影響,如環(huán)境、計(jì)算機(jī)設(shè)備等,可以通過一些仿真...
基于FPGA的新型電容數(shù)據(jù)采集系統(tǒng)設(shè)計(jì)
數(shù)據(jù)采集系統(tǒng)的速度制約了電容層析成像技術(shù)在航空發(fā)動(dòng)機(jī)氣路監(jiān)測系統(tǒng)等高速設(shè)備中的應(yīng)用。為此,設(shè)計(jì)了一種基于FPGA的新型電容數(shù)據(jù)采集系統(tǒng),采用DDR2存儲(chǔ)...
2017-11-18 標(biāo)簽:fpga數(shù)據(jù)采集 2108 0
基于FPGA的振動(dòng)信號采集處理系統(tǒng)設(shè)計(jì)并實(shí)際驗(yàn)證
在振動(dòng)信號采集和處理系統(tǒng)設(shè)計(jì)中,信號的處理時(shí)間與可靠性決定著系統(tǒng)應(yīng)用的可行性。本文設(shè)計(jì)了一種基于FPGA的振動(dòng)信號采集處理系統(tǒng),該系統(tǒng)通過振動(dòng)信號采集電...
FPGA編程時(shí)的一些實(shí)際問題闡述及解決方案詳解
問題: 隨著NI的FPGA產(chǎn)品的廣泛使用,很多同事和客戶都碰到了一些FPGA編程時(shí)遇到的問題。由于FPGA不能實(shí)時(shí)調(diào)試,每次修改一點(diǎn)代碼之后都要編譯很長...
在FPGA平臺下實(shí)現(xiàn)基于平方倍頻法的BPSK調(diào)制信號載頻估計(jì)單元設(shè)計(jì)
根據(jù)BPSK調(diào)制信號調(diào)制機(jī)理和平方倍頻法原理,在FPGA平臺上設(shè)計(jì)實(shí)現(xiàn)了BPSK調(diào)制信號載波頻率估計(jì)單元。利用ModelSim仿真環(huán)境對載頻估計(jì)功能進(jìn)行...
基于FPGA的LVDS過采樣技術(shù)研究并用Xilinx評估板進(jìn)行驗(yàn)證
針對LVDS接口,研究并實(shí)現(xiàn)了一種基于FPGA的LVDS過采樣技術(shù),重點(diǎn)對LVDS過采樣技術(shù)中系統(tǒng)組成、ISERDESE2、時(shí)鐘采樣、數(shù)據(jù)恢復(fù)單元、時(shí)鐘...
FPGA接口VI和函數(shù)中關(guān)閉FPGA VI引用的執(zhí)行詳解
所屬選板: FPGA接口VI和函數(shù) 必需: FPGA接口 關(guān)閉FPGA VI的引用并可選擇重置該VI的執(zhí)行。默認(rèn)情況下,“關(guān)閉FPGA VI引用”函數(shù)可...
新版LabVIEW FPGA 新增特性詳解及其帶來的系統(tǒng)效率優(yōu)化
相比其它FPGA設(shè)計(jì)工具,NI LabVIEW FPGA模塊可幫助嵌入式設(shè)計(jì)人員使用更少的工程資源更快速地完成項(xiàng)目。LabVIEW FPGA 2014 ...
FPGA多重加載技術(shù)的設(shè)計(jì)模塊及其在硬件平臺上的多模式啟動(dòng)測試并分析
Xilinx 7系列FPGA是Xilinx公司最新推出的一個(gè)芯片系列,Kintex7是該系列芯片中的一種,擁有大量的可編程資源。即便如此,在一些多模式...
NI系統(tǒng)級模塊(SOM)采用可重配置的FPGA技術(shù)
基于Zynq SoC,NI SOM經(jīng)過廣泛的測試與驗(yàn)證,并配有完整的軟件協(xié)議棧。 嵌入式設(shè)計(jì)團(tuán)隊(duì)肩負(fù)著處理眾多棘手問題的重?fù)?dān)。他們需要跟上最新技術(shù)并提供...
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