verilog

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Verilog HDL是一種硬件描述語(yǔ)言（HDL:Hardware Description Language），以文本形式來(lái)描述數(shù)字系統(tǒng)硬件的結(jié)構(gòu)和行為的語(yǔ)言，用它可以表示邏輯電路圖、邏輯表達(dá)式，還可以表示數(shù)字邏輯系統(tǒng)所完成的邏輯功能。

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verilog技術(shù)

怎么用emac實(shí)現(xiàn)Verilog自動(dòng)連線呢？

我們?cè)诰帉懸恍┍容^復(fù)雜的Verilog代碼時(shí)，通常需要進(jìn)行大量的手動(dòng)連線工作，這種工作十分容易出錯(cuò)，并且在代碼模塊的嵌套層級(jí)較多時(shí)，更改里層的一個(gè)代碼

2024-01-24 標(biāo)簽：Verilog DUT Ubuntu系統(tǒng) 1988 0

verilog運(yùn)算符的優(yōu)先級(jí)

先給大家出一個(gè)題目：當(dāng)x為5時(shí)，y=x << 6 + x <<3 + x << 2 + x的結(jié)果為多少，即y的值是多少？

2024-01-19 標(biāo)簽：Verilog 乘法器運(yùn)算符 3756 0

如何對(duì)Verilog/SystemVerilog代碼加密

os模塊中的system()函數(shù)接受一個(gè)字符串參數(shù)，其中包含要執(zhí)行的命令。在21-22行中，line為字符串變量，和前面雙引號(hào)中的linux命令拼接在一...

2024-01-15 標(biāo)簽：Verilog 字符串 VCS 3912 0

Verilog中的三態(tài)門與雙向信號(hào)詳解

在數(shù)字電路中，邏輯輸出有兩個(gè)正常態(tài)：低電平狀態(tài)（對(duì)應(yīng)邏輯0）和高電平狀態(tài)（對(duì)應(yīng)邏輯1）。此外，電路還有不屬于0和1狀態(tài)的高阻態(tài)，高阻態(tài)常用字母 Z 表示。

2024-01-11 標(biāo)簽：Verilog 邏輯器件三態(tài)門 1.1萬(wàn) 0

關(guān)于FPGA的開源項(xiàng)目介紹

Hello，大家好，之前給大家分享了大約一百多個(gè)關(guān)于FPGA的開源項(xiàng)目，涉及PCIe、網(wǎng)絡(luò)、RISC-V、視頻編碼等等，這次給大家?guī)?lái)的是不枯燥的娛樂(lè)項(xiàng)...

2024-01-10 標(biāo)簽：fpga 內(nèi)核 Verilog 1847 0

基于FPGA的輕量級(jí)CAN總線控制器

ISO11898 定義了通信速率為 125 kbps～1 Mbps 的高速 CAN 通信標(biāo)準(zhǔn)，屬于閉環(huán)總線，傳輸速率可達(dá)1Mbps，總線長(zhǎng)度 ≤ 40米。

2024-01-05 標(biāo)簽：fpga CAN總線 CAN通信 2627 0

數(shù)字電路設(shè)計(jì)有哪些仿真驗(yàn)證流程

數(shù)字電路設(shè)計(jì)的仿真驗(yàn)證流程是確保設(shè)計(jì)能夠正確運(yùn)行的重要步驟之一。在現(xiàn)代電子設(shè)備中，數(shù)字電路被廣泛應(yīng)用于各種應(yīng)用領(lǐng)域，如計(jì)算機(jī)、通信設(shè)備、汽車電子等等。因...

2024-01-02 標(biāo)簽：汽車電子 Verilog 數(shù)字電路 2267 0

FPGA學(xué)習(xí)入門從點(diǎn)燈開始

首先，F(xiàn)PGA開發(fā)工程師是一個(gè)相對(duì)高薪的工作，但是，很多同學(xué)在剛?cè)腴T時(shí)都會(huì)有一種無(wú)從下手的感覺，尤其是將FPGA作為第一個(gè)要掌握的開發(fā)板時(shí)，更是感覺苦惱...

2023-12-28 標(biāo)簽：fpga Verilog 計(jì)數(shù)器 670 0

verilog語(yǔ)法-如何使用function提高效率？

function的作用返回一個(gè)數(shù)值，此數(shù)值由一串組合邏輯代碼計(jì)算得到。

2023-12-25 標(biāo)簽：二進(jìn)制 Verilog CRC校驗(yàn) 3285 0

FPGA之Verilog點(diǎn)燈小程序

首先個(gè)人用的是QuartusII11.0，開發(fā)板用的是CycloneIV的EP4CE6E22C8N芯片。

2023-12-25 標(biāo)簽：fpga led燈 Verilog 1570 0

國(guó)外大學(xué)的FPGA開發(fā)項(xiàng)目盤點(diǎn)

據(jù)我了解，目前國(guó)內(nèi)很多大學(xué)是沒(méi)有開設(shè)FPGA相關(guān)課程的，所以很多同學(xué)都是自學(xué)，但是自學(xué)需要一定的目標(biāo)和項(xiàng)目，今天我們就去看看常春藤盟校Cornell U...

2023-12-22 標(biāo)簽：fpga Verilog 1339 0

Verilog實(shí)現(xiàn)DDS正弦波發(fā)生器

DDS 同 DSP（數(shù)字信號(hào)處理）一樣，是一項(xiàng)關(guān)鍵的數(shù)字化技術(shù)。DDS 是直接數(shù)字式頻率合成器（Direct Digital Synthesizer）的...

2023-12-22 標(biāo)簽：合成器正弦波發(fā)生器 Verilog 1723 0

找verilog bug的利器—notepad++介紹

相信大家寫verilog代碼的時(shí)候，都會(huì)用到notepad++，大家也知道notepad++可以和vivado關(guān)聯(lián)使用，這樣寫起工程代碼的時(shí)候，調(diào)試很方便。

2023-12-21 標(biāo)簽：Verilog Vivado 2920 0

芯片后仿之SDF 3.0解析

SDF文件是在VCS/NC-Verilog后仿真運(yùn)行時(shí)將STD/IO/Macro門級(jí)verilog中specify的延遲信息替換為QRC/Star-RC...

2023-12-18 標(biāo)簽：芯片仿真 Verilog 1784 0

Fpga Verilog SDRAM模塊—單字讀寫案例

筆者與SDRAM有段不短的孽緣，它作為冤魂日夜不斷糾纏筆者。筆者嘗試過(guò)許多方法將其退散，不過(guò)屢試屢敗的筆者，最終心情像橘子一樣橙。

2023-12-15 標(biāo)簽：fpga SDRAM Verilog 1863 0

IC設(shè)計(jì)：Verilog是如何實(shí)現(xiàn)RR輪詢調(diào)度的？

在設(shè)計(jì)中，我們經(jīng)常會(huì)用到RR（Round-Robin,RR）輪詢調(diào)度，用于保證在一個(gè)時(shí)間段內(nèi)的多個(gè)請(qǐng)求信號(hào)都能得到公平響應(yīng)。

2023-12-13 標(biāo)簽：寄存器 IC設(shè)計(jì)Verilog 2246 0

verilog中數(shù)據(jù)的符號(hào)屬性（有符號(hào)數(shù)和無(wú)符號(hào)數(shù)）探究根源

為了省流，還是先甩結(jié)論。有符號(hào)數(shù)和無(wú)符號(hào)數(shù)的最本質(zhì)區(qū)別就是：符號(hào)位的識(shí)別和高位拓展。除此之外，另一個(gè)區(qū)別就是從人的角度如何如何讀這個(gè)數(shù)，或者說(shuō)$disp...

2023-12-10 標(biāo)簽：Verilog 運(yùn)算符號(hào) 2180 0

淺談Verilog中casex語(yǔ)句

代碼如下，大家看到這個(gè)代碼有什么體會(huì)？綜合會(huì)有什么Warning？

2023-12-07 標(biāo)簽：仿真 Verilog 代碼 1661 0

FPGA入門篇：Verilog計(jì)數(shù)器

Verilog HDL是一種硬件描述語(yǔ)言，以文本形式來(lái)描述數(shù)字系統(tǒng)硬件的結(jié)構(gòu)和行為的語(yǔ)言，用它可以表示邏輯電路圖、邏輯表達(dá)式，還可以表示數(shù)字邏輯系統(tǒng)所完...

2023-12-07 標(biāo)簽：fpga Verilog Verilog HDL 3459 0

verilog中有符號(hào)數(shù)和無(wú)符號(hào)數(shù)的本質(zhì)探究

不知道有沒(méi)有人像我一樣，長(zhǎng)久以來(lái)將verilog中的有符號(hào)數(shù)視為不敢觸碰的禁區(qū)。

2023-12-04 標(biāo)簽：仿真器 Verilog VCS 1571 0

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Protues

Protues

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Proteus軟件是英國(guó)Lab Center Electronics公司出版的EDA工具軟件（該軟件中國(guó)總代理為廣州風(fēng)標(biāo)電子技術(shù)有限公司）。它不僅具有其它EDA工具軟件的仿真功能，還能仿真單片機(jī)及外圍器件。
靜電防護(hù)

靜電防護(hù)

+關(guān)注

為防止靜電積累所引起的人身電擊、火災(zāi)和爆炸、電子器件失效和損壞，以及對(duì)生產(chǎn)的不良影響而采取的防范措施。其防范原則主要是抑制靜電的產(chǎn)生，加速靜電泄漏，進(jìn)行靜電中和等。
Altium Designer

Altium Designer

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FPGA芯片

FPGA芯片

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FPGA（Field－Programmable Gate Array），即現(xiàn)場(chǎng)可編程門陣列，它是在PAL、GAL、CPLD等可編程器件的基礎(chǔ)上進(jìn)一步發(fā)展的產(chǎn)物。
ArduBlock

ArduBlock

+關(guān)注

ArduBlock軟件是Arduino官方編程環(huán)境的第三方軟件，目前必須依附于Arduino軟件下運(yùn)行，區(qū)別于Arduino文本式編程環(huán)境，ArduBlock是以圖形化積木搭建的方式編程的，這樣的方式會(huì)使編程的可視化和交互性加強(qiáng)，編程門檻降低，即使沒(méi)有編程經(jīng)驗(yàn)的人也可以嘗試給Arduino控制器編寫程序。
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識(shí)別

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FPGA開發(fā)板

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FPGA開發(fā)板在基于MCU、定制ASIC和體積龐大的電線束來(lái)實(shí)現(xiàn)引擎及控制電子的系統(tǒng)方案已發(fā)展至接近其技術(shù)和應(yīng)用極限，汽車工業(yè)正面臨新的設(shè)計(jì)挑戰(zhàn)。過(guò)去汽車電子產(chǎn)品的開發(fā)周期是漫長(zhǎng)的，而許多汽車制造商現(xiàn)正致力于在更短的時(shí)間內(nèi)，裝備消費(fèi)者所需的新一代汽車。
PCB封裝

PCB封裝

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pcb封裝就是把實(shí)際的電子元器件，芯片等的各種參數(shù)（比如元器件的大小，長(zhǎng)寬，直插，貼片，焊盤的大小，管腳的長(zhǎng)寬，管腳的間距等）用圖形方式表現(xiàn)出來(lái)，以便可以在畫pcb圖時(shí)進(jìn)行調(diào)用。
QUARTUS II

QUARTUS II

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Quartus II 是Altera公司推出的綜合性CPLD/FPGA開發(fā)軟件，軟件支持原理圖、VHDL、VerilogHDL以及AHDL（Altera Hardware 支持Description Language）等多種設(shè)計(jì)輸入形式，內(nèi)嵌自有的綜合器以及仿真器，可以完成從設(shè)計(jì)輸入到硬件配置的完整PLD設(shè)計(jì)流程。
語(yǔ)音交互

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PCB封裝庫(kù)

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Artix-7

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　　Artix-7 系列：相對(duì)于 Spartan-6 系列而言，Artix-7 系列功耗降低了一半，成本降低了 35%，采用小型化封裝、統(tǒng)一的 Virtex 系列架構(gòu)，能滿足低成本大批量市場(chǎng)的性能要求，這也正是此前 ASSP、ASIC 和低成本 FPGA 所針對(duì)的市場(chǎng)領(lǐng)域。
VHDL代碼

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面包板是由于板子上有很多小插孔，專為電子電路的無(wú)焊接實(shí)驗(yàn)設(shè)計(jì)制造的。由于各種電子元器件可根據(jù)需要隨意插入或拔出，免去了焊接，節(jié)省了電路的組裝時(shí)間，而且元件可以重復(fù)使用，所以非常適合電子電路的組裝、調(diào)試和訓(xùn)練。
AXI

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AXI是一種總線協(xié)議，該協(xié)議是ARM公司提出的AMBA3.0協(xié)議中最重要的部分，是一種面向高性能、高帶寬、低延遲的片內(nèi)總線。它的地址/控制和數(shù)據(jù)相位是分離的，支持不對(duì)齊的數(shù)據(jù)傳輸，同時(shí)在突發(fā)傳輸中，只需要首地址，同時(shí)分離的讀寫數(shù)據(jù)通道、并支持Outstanding傳輸訪問(wèn)和亂序訪問(wèn)，并更加容易進(jìn)行時(shí)序收斂。AXI是AMBA中一個(gè)新的高性能協(xié)議。
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特性阻抗又稱特征阻抗，它不是直流電阻，屬于長(zhǎng)線傳輸中的概念。特性阻抗是射頻傳輸線影響無(wú)線電波電壓、電流的幅值和相位變化的固有特性，等于各處的電壓與電流的比值，用V/I表示。在射頻電路中，電阻、電容、電感都會(huì)阻礙交變電流的流動(dòng)，合稱阻抗。電阻是吸收電磁能量的，理想電容和電感不消耗電磁能量。
時(shí)鐘源

時(shí)鐘源

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時(shí)鐘源用來(lái)為環(huán)形脈沖發(fā)生器提供頻率穩(wěn)定且電平匹配的方波時(shí)鐘脈沖信號(hào)。它通常由石英晶體振蕩器和與非門組成的正反饋振蕩電路組成，其輸出送至環(huán)形脈沖發(fā)生器。
AD采樣

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　　AD轉(zhuǎn)換采樣頻率指完成一次從模擬轉(zhuǎn)換到數(shù)字的AD轉(zhuǎn)換所需時(shí)間的倒數(shù)，模擬量可以是電壓、電流等電信號(hào)，也可以是壓力、溫度、濕度、位移、聲音等非電信號(hào)；而AD分辨率指數(shù)字量變化一個(gè)最小量時(shí)模擬信號(hào)的變化量。
驅(qū)動(dòng)電流

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Kintex-7

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　　Kintex-7系列：Kintex-7 系列是一種新型 FPGA，能以不到 Virtex-6 系列一半的價(jià)格實(shí)現(xiàn)與其相當(dāng)性能，性價(jià)比提高了一倍，功耗降低了一半。
Protel DXP

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FPGA教程

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紅外觸摸屏

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