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標(biāo)簽 > vhdl
VHDL全名Very-High-Speed Integrated Circuit Hardware Description Language,誕生于1982年。1987年底,VHDL被IEEE和美國國防部確認為標(biāo)準硬件描述語言 。
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基于FPGA器件和VHDL語言實現(xiàn)波形及移相波形發(fā)生器的系統(tǒng)設(shè)計
標(biāo)準時鐘(由晶振電路產(chǎn)生)加于進制可編程的n進制計數(shù)器,其溢出脈沖加于可預(yù)置初值的地址計數(shù)器,生成波形存儲器所需的地址信號,地址信號的產(chǎn)生頻率正比于時鐘...
基于可編程邏輯器件和VHDL語言實現(xiàn)信號源的方案設(shè)計
在高速數(shù)據(jù)采集系統(tǒng)中,信號源作為一種校驗設(shè)備,需要及時、有效地向采集設(shè)備提供高頻信號,用于檢驗數(shù)據(jù)采集器的工作情況;同時信號源還應(yīng)該能夠提供一些必要的控...
基于Altera的FPGA器件和VHDL語言實現(xiàn)數(shù)據(jù)采集系統(tǒng)的設(shè)計
傳統(tǒng)的數(shù)據(jù)采集系統(tǒng),通常采用單片機或DSP作為主要控制模塊,控制ADC、存儲器和其他外圍電路的工作。隨著數(shù)據(jù)采集對速度性能的要求越來越高,傳統(tǒng)采集系統(tǒng)的...
2020-08-06 標(biāo)簽:fpga數(shù)據(jù)采集vhdl 1365 0
在FPGA芯片上使用VHDL語言實現(xiàn)UART模塊的設(shè)計
在數(shù)據(jù)采集系統(tǒng)中, 常需要進行異步串行數(shù)據(jù)傳輸,目前廣泛使用的RS232異步串行接口,如8250、NS16450等專用集成芯片,雖然使用簡單,卻有占用電...
基于EP1K30TC144-3芯片實現(xiàn)溫控定時噴灌系統(tǒng)的設(shè)計和仿真分析
FPGA是新型的可編程邏輯器件,能夠?qū)⒋罅康倪壿嫻δ芗捎趩蝹€器件中,它所提供的門數(shù)從幾百門到上百萬門,符合系統(tǒng)芯片(SOC—System On Chi...
采用可編輯邏輯器件和VHDL語言實現(xiàn)波控系統(tǒng)設(shè)計的設(shè)計
相控陣是通過波控系統(tǒng)控制陣列天線各單元通道的相位、幅度以形成空間波束并控制其方位角和俯仰角。早期的波控系統(tǒng)一般采用硬件電路來實現(xiàn),這種實現(xiàn)方法的缺點是設(shè)...
基于EP1C6Q240C8的FPGA芯片實現(xiàn)電子測試系統(tǒng)的設(shè)計
本文采用的是ALTERA公司的EP1C6Q240C8型號的FPGA,整個體統(tǒng)采用模塊化設(shè)計的思想,將各個模塊用VHDL語言描述出來再進行連接。
基于VHDL語言及SOPC技術(shù)實現(xiàn)全數(shù)字調(diào)頻信號發(fā)生器的設(shè)計
在常用的信號源及信號處理設(shè)計方案中,RC/LC振蕩電路頻率調(diào)整方便,但是它的工作頻率穩(wěn)定度較低。頻率穩(wěn)定度較低導(dǎo)致系統(tǒng)的工作穩(wěn)定度降低,使其不適用于對精...
采用SOPC技術(shù)和VHDL語言實現(xiàn)圖像增強處理系統(tǒng)的應(yīng)用方案
圖像增強最早起源于人類的空間探索計劃。從衛(wèi)星或飛船上獲得的關(guān)于地球和太陽系中行星的圖像因為多種原因而降質(zhì),這些原因如成像設(shè)備受使用環(huán)境的限制,相機和對象...
采用復(fù)雜控制邏輯器件和VHDL語言實現(xiàn)曼徹斯特編解碼器的設(shè)計
雖然計算機通信的方法和手段多種多樣,但都必須依靠數(shù)據(jù)通信技術(shù)。數(shù)據(jù)通信就是將數(shù)據(jù)信號加到數(shù)據(jù)傳輸信道上進行傳輸,并在接收點將原始發(fā)送的數(shù)據(jù)正確地恢復(fù)過來...
使用CPLD器件和VHDL語言實現(xiàn)USB收發(fā)模塊的硬件功能設(shè)計
當(dāng)前,高密度可編程邏輯器件CPLD,由于具有巨大的靈活性而廣泛應(yīng)用于狀態(tài)機、同步、譯碼、解碼、計數(shù)、總線接口、串并轉(zhuǎn)換等很多方面,而且在信號處理領(lǐng)域的應(yīng)...
基于可編程邏輯器件CPLD芯片和VHDL語言實現(xiàn)彩燈控制器系統(tǒng)的設(shè)計
彩燈作為一種景觀,安裝在建筑物的適當(dāng)?shù)胤揭皇亲鳛檠b飾增添節(jié)日氣氛,二是有一種廣告宣傳的作用,也可用在舞臺上增強晚會燈光效果。實現(xiàn)彩燈控制的方案很多,不同...
基于VHDL語言和可編程邏輯器件實現(xiàn)HDB3編譯碼器的設(shè)計
由于VHDL不能處理負電平,只能面向“1”、“0”兩種狀態(tài),所以要對它的輸出進行編碼,如表1所示。編碼的實現(xiàn)是根據(jù)HDB3編碼原理把二進制碼編碼成兩路單...
采用VHDL語言在FPGA上實現(xiàn)WolfMCU體系結(jié)構(gòu)的設(shè)計
基于以上討論,可以看出ASIP+FPGA設(shè)計模式可以從很大程度上解決引言中提到的兩個難題。為了進行更深入的研究,我們對該設(shè)計模式進行了嘗試,用VHDL硬...
采用Spartan2系列FPGA器件實現(xiàn)全數(shù)字鎖相環(huán)路的設(shè)計和仿真驗證
數(shù)字鎖相環(huán)路已在數(shù)字通信、無線電電子學(xué)及電力系統(tǒng)自動化等領(lǐng)域中得到了極為廣泛的應(yīng)用。傳統(tǒng)的全數(shù)字鎖相環(huán)路(DPLL)是由中、小規(guī)模TTL集成電路構(gòu)成。這...
基于Xilinx Spartan系列FPGA和VHDL語言設(shè)計衛(wèi)星數(shù)據(jù)存儲糾錯系統(tǒng)
空間飛器在太空環(huán)境中面臨的主要問題之一就是輻射。太空中的各種高能粒子(包括高能質(zhì)子、中子、α粒子、得離子等)具有很高的動能,通過時可能會影響半導(dǎo)體電路的...
在Altera CycIone II系列FPGA中用VHDL實現(xiàn)E2PROM控制器的設(shè)計
E2PROM存儲器存儲單元的損壞主要是由頻繁的寫操作造成的。若要解決問題,首先耍避免對同一單元進行頻繁的擦寫,降低存儲單元損壞的可能;其次當(dāng)某些單元損壞...
采用VHDL語言在CPLD內(nèi)部編程實現(xiàn)Flash讀取控制設(shè)計
本設(shè)計已實用于國家863計劃“可擴展到T比特的高性能IPv4/v6路由器基礎(chǔ)平臺及實驗系統(tǒng)”項目中。其主要功能是對主控部分的FPGA讀取Flash進行控制。
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