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標(biāo)簽 > vhdl
VHDL全名Very-High-Speed Integrated Circuit Hardware Description Language,誕生于1982年。1987年底,VHDL被IEEE和美國(guó)國(guó)防部確認(rèn)為標(biāo)準(zhǔn)硬件描述語(yǔ)言 。
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基于FPGA和VHDL語(yǔ)言編程實(shí)現(xiàn)液晶屏信號(hào)發(fā)生器的設(shè)計(jì)
液晶顯示已成為目前平板電視與計(jì)算機(jī)顯示終端的主流,液晶顯示器的研究設(shè)計(jì)、生產(chǎn)、檢驗(yàn)等部門(mén)甚至消費(fèi)者需要用一些定量或定性的方法和指標(biāo)去檢驗(yàn)液晶顯示器的質(zhì)量和特性。
2020-07-10 標(biāo)簽:fpgavhdl信號(hào)發(fā)生器 1576 0
設(shè)計(jì)FPGA系統(tǒng)的三個(gè)基本原則是什么,了解一下
在這種方法中面積的復(fù)制可以換取速度的提高。支持的速度越高,就意味著可以實(shí)現(xiàn)更高的產(chǎn)品性能。一些注重產(chǎn)品性能的應(yīng)用領(lǐng)域可以采用并行處理技術(shù),實(shí)現(xiàn)面積換速度。
基于復(fù)雜可編程邏輯器件和VHDL語(yǔ)言實(shí)現(xiàn)半整數(shù)分頻器的設(shè)計(jì)
在數(shù)字系統(tǒng)設(shè)計(jì)中,根據(jù)不同的設(shè)計(jì)需要,經(jīng)常會(huì)遇到偶數(shù)分頻、奇數(shù)分頻、半整數(shù)分頻等,有的還要求等占空比。在基于cpld(復(fù)雜可編程邏輯器件)的數(shù)字系統(tǒng)設(shè)計(jì)...
Verilog HDL是一種硬件描述語(yǔ)言,以文本形式來(lái)描述數(shù)字系統(tǒng)硬件的結(jié)構(gòu)和行為的語(yǔ)言,用它可以表示邏輯電路圖、邏輯表達(dá)式,還可以表示數(shù)字邏輯系統(tǒng)所完...
基于EDA技術(shù)和VHDL語(yǔ)言編程實(shí)現(xiàn)智能交通控制燈的設(shè)計(jì)
十字路口設(shè)計(jì)兩組交通燈分別控制東西和南北兩個(gè)方向的交通。如圖1所示,當(dāng)東西方向的紅燈亮?xí)r,南北方向?qū)?yīng)綠燈亮,過(guò)渡階段黃燈亮,即東西方向紅燈亮的時(shí)間等于...
2020-04-24 標(biāo)簽:eda計(jì)數(shù)器vhdl 4171 0
基于級(jí)聯(lián)結(jié)構(gòu)和VHDL語(yǔ)言的IIR數(shù)字濾波器在FPGA上實(shí)現(xiàn)設(shè)計(jì)
IIR數(shù)字濾波器在很多領(lǐng)域中有著廣闊的應(yīng)用。與FIR數(shù)字濾波器相比,它可以用較低的階數(shù)獲得高選擇性,所用存儲(chǔ)單元少,經(jīng)濟(jì)而效率高,在相同門(mén)級(jí)規(guī)模和相同時(shí)...
采用VHDL語(yǔ)言實(shí)現(xiàn)卷積碼編解碼器設(shè)計(jì)
數(shù)字信息在有噪信道中傳輸時(shí),會(huì)受到噪聲干擾的影響,誤碼總是不可避免的。為了在已知信噪比的情況下達(dá)到一定的誤碼率指標(biāo),在合理設(shè)計(jì)基帶信號(hào),選擇調(diào)制、解調(diào)方...
生成語(yǔ)句(GENERATE)是一種可以建立重復(fù)結(jié)構(gòu)或者是在多個(gè)模塊的表示形式之間進(jìn)行選擇的語(yǔ)句。由于生成語(yǔ)句可以用來(lái)產(chǎn)生多個(gè)相同的結(jié)構(gòu),因此使用生成語(yǔ)句...
Verilog HDL是一種硬件描述語(yǔ)言,以文本形式來(lái)描述數(shù)字系統(tǒng)硬件的結(jié)構(gòu)和行為的語(yǔ)言,用它可以表示邏輯電路圖、邏輯表達(dá)式,還可以表示數(shù)字邏輯系統(tǒng)所完...
2019-11-13 標(biāo)簽:電路圖vhdlverilog hdl 3505 0
深入淺出玩轉(zhuǎn)FPGA視頻:Quartus II調(diào)用ModeSim仿真實(shí)例
ModeSim是業(yè)界唯一的單內(nèi)核支持VHDL和Verilog混合仿真的仿真器。它采用直接優(yōu)化的編譯技術(shù)、Tcl/Tk技術(shù)、和單一內(nèi)核仿真技術(shù),編譯仿真速...
利用VHDL語(yǔ)言的FPGA試驗(yàn)箱設(shè)計(jì)洗衣機(jī)模擬程序
本設(shè)計(jì)利用vhdl硬件描述語(yǔ)言在FPGA試驗(yàn)箱設(shè)計(jì)洗衣機(jī)模擬程序。◆利用3個(gè)LED表示待機(jī)、正轉(zhuǎn)、反轉(zhuǎn)三種工作狀態(tài)?!糇孕性O(shè)定洗衣機(jī)循環(huán)次數(shù)(最大為16...
當(dāng)然階段四純屬個(gè)人的對(duì)未來(lái)的推測(cè),但是,近年來(lái),F(xiàn)PGA也高速發(fā)展,明顯有當(dāng)年匯編語(yǔ)言開(kāi)發(fā)到C高級(jí)語(yǔ)言開(kāi)發(fā)的趨勢(shì),我們是不是應(yīng)該不局限于只學(xué)習(xí)FPG...
通過(guò)LPM_ROM模塊和VHDL語(yǔ)言為核心設(shè)計(jì)多功能信號(hào)發(fā)生器
以FPGA芯片為載體, 通過(guò)QuartusII 的LPM_ROM 模塊和VHDL 語(yǔ)言為核心設(shè)計(jì)一個(gè)多功 能信號(hào)發(fā)生器,根據(jù)輸入信號(hào)的選擇可以輸出遞增鋸...
FCSR的基本原理和特性及VHDL可編程邏輯器件的實(shí)現(xiàn)
偽隨機(jī)信號(hào)在雷達(dá)、遙控、遙測(cè)、通信加密和無(wú)線電測(cè)量系統(tǒng)領(lǐng)域有著廣泛的應(yīng)用,其產(chǎn)生方法有多種途徑。進(jìn)位反饋移位寄存器(feedbackwithcarrys...
在PCI總線上采用CPLD技術(shù)實(shí)現(xiàn)多種板卡的設(shè)計(jì)
PLD(可編程邏輯器件)以其操作靈活、使用方便、開(kāi)發(fā)迅速、投資風(fēng)險(xiǎn)低的特點(diǎn),很快發(fā)展起來(lái),并越來(lái)越受人們的矚目。PLD是可以由用戶(hù)在工作現(xiàn)場(chǎng)編程的邏輯器...
采用VHDL語(yǔ)言和EDA工具實(shí)現(xiàn)超高頻射頻標(biāo)簽數(shù)字電路
在研究讀寫(xiě)器和射頻標(biāo)簽通信過(guò)程的基礎(chǔ)上,結(jié)合EPC C1G2協(xié)議以及ISO/IEC18000.6協(xié)議, 采用VHDL語(yǔ)言設(shè)計(jì)出一種應(yīng)用于超高頻段的射頻標(biāo)...
使用VHDL語(yǔ)言和FPGA技術(shù)實(shí)現(xiàn)高效微控制器內(nèi)核的設(shè)計(jì)
與傳統(tǒng)投片實(shí)現(xiàn)ASIC相比,F(xiàn)PGA具有實(shí)現(xiàn)速度快、風(fēng)險(xiǎn)小、可編程、可隨時(shí)更改升級(jí)等一系列優(yōu)點(diǎn),因而得到了越米越廣泛的應(yīng)用。MCS-51應(yīng)用時(shí)間長(zhǎng)、范圍...
通過(guò)VHDL語(yǔ)言和EPlC6Q240C8芯片實(shí)現(xiàn)16QAM調(diào)制器的設(shè)計(jì)
為了滿(mǎn)足現(xiàn)代通信系統(tǒng)對(duì)傳輸速率和帶寬提出的新要求。人們不斷地推出一些新的數(shù)字調(diào)制解調(diào)技術(shù)。正交幅度調(diào)制解調(diào)(quadrature ampli-tude ...
基于CPLD和VHDL實(shí)現(xiàn)時(shí)間控制器系統(tǒng)的設(shè)計(jì)
FUNC-CTRL模塊控制系統(tǒng)處于不同的功能狀態(tài),并產(chǎn)生不同的控制信號(hào)分別控制TIME-SET模塊和CLOCK模塊,而這3個(gè)模塊的輸出連接到COMPAR...
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