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標(biāo)簽 > xilinx
Xilinx是全球領(lǐng)先的可編程邏輯完整解決方案的供應(yīng)商。Xilinx研發(fā)、制造并銷售范圍廣泛的高級集成電路、軟件設(shè)計(jì)工具以及作為預(yù)定義系統(tǒng)級功能的IP(Intellectual Property)核。
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在日常FPGA開發(fā)過程中,邏輯代碼設(shè)計(jì)完成后,為了驗(yàn)證代碼邏輯的正確性,優(yōu)先使用邏輯仿真(modesim)進(jìn)行驗(yàn)證。仿真驗(yàn)證通過后進(jìn)行板級驗(yàn)證時(shí),使用邏...
FPGA芯片設(shè)計(jì)及關(guān)鍵技術(shù)
本文來自“FPGA專題:萬能芯片點(diǎn)燃新動(dòng)力,國產(chǎn)替代未來可期(2023)”,F(xiàn)PGA又稱現(xiàn)場可編程門陣列,是在硅片上預(yù)先設(shè)計(jì)實(shí)現(xiàn)的具有可編程特性的集成電...
Xilinx 7系列與Ultrascale系列FPGA的區(qū)別
Xilinx是一家專業(yè)的可編程邏輯器件(PLD)廠商,其產(chǎn)品包括FPGA、CPLD、SOC等。Xilinx的FPGA產(chǎn)品線有多個(gè)系列,其中7系列和Ult...
如何在KV260上快速體驗(yàn)Vitsi AI圖像分類示例程序
本文首先將會(huì)對Vitis統(tǒng)一軟件平臺(tái)和Vitsi AI進(jìn)行簡單介紹,然后介紹如何在KV260上部署DPU鏡像,最后在KV260 DPU鏡像上運(yùn)行Viti...
XILINX FPGA IP之FIFO Generator例化仿真
上文XILINX FPGA IP之FIFO對XILINX FIFO Generator IP的特性和內(nèi)部處理流程進(jìn)行了簡要的說明,本文通過實(shí)際例子對該I...
在數(shù)字設(shè)計(jì)中,fifo是數(shù)據(jù)操作任務(wù)所需的普遍結(jié)構(gòu),如跨時(shí)鐘域、低延遲內(nèi)存緩沖和總線寬度轉(zhuǎn)換。
XILINX FPGA IP之DDS Compiler_ip例化仿真
之前的文章對dds ip 的結(jié)構(gòu)、精度、參數(shù)、接口進(jìn)行了詳細(xì)的說明,本文通過例化仿真對該IP的實(shí)際使用進(jìn)行演示。本文例化固定模式和可配置模式兩種模式分別...
Xilinx Vivado使用增量實(shí)現(xiàn)
增量實(shí)現(xiàn)自從首次獲得支持以來,不斷升級演變,在此過程中已添加了多項(xiàng)針對性能和編譯時(shí)間的增強(qiáng)功能。它解決了實(shí)現(xiàn)階段針對快速迭代的需求,顯著節(jié)省了編譯時(shí)間,...
本文介紹一個(gè)FPGA 開源項(xiàng)目:Micro Blaze最小系統(tǒng)。MicroBlaze是Xilinx提供的一個(gè)軟核IP,該軟核是由FPGA片內(nèi)邏輯資源組成...
2023-09-01 標(biāo)簽:fpgaXilinxMicroBlaze 3667 0
本文介紹一個(gè)FPGA開源項(xiàng)目:基于IBERT的GTX數(shù)據(jù)傳輸測試。IBERT是指誤碼率測試,在Vivado軟件中,IBERT 7 Series GTX ...
2023-08-31 標(biāo)簽:fpga收發(fā)器數(shù)據(jù)傳輸 3248 0
基于Xilinx FPGA AXI-EMC IP的EMIF通信測試
外部存儲(chǔ)器接口( EMIF )通信常用于FPGA和DSP之間的數(shù)據(jù)傳輸,即將FPGA作為DSP的外部SRAM、或者協(xié)同處理器等。Xilinx提供了AXI...
Xilinx 7系列FPGA的時(shí)鐘結(jié)構(gòu)解析
通過上一篇文章“時(shí)鐘管理技術(shù)”,我們了解Xilinx 7系列FPGA主要有全局時(shí)鐘、區(qū)域時(shí)鐘、時(shí)鐘管理塊(CMT)。 通過以上時(shí)鐘資源的結(jié)合,Xilin...
通過使用Xilinx 的 XC7A35T-2CSG325C Artix-7 FPGA,ThunderScope 可以將 1 GB/s 的實(shí)時(shí)采樣數(shù)據(jù)傳輸...
2023-08-29 標(biāo)簽:fpga示波器數(shù)據(jù)傳輸 932 0
手把手教你動(dòng)態(tài)編輯Xilinx FPGA內(nèi)LUT內(nèi)容
在7系列FPGA中,將近2/3的SLICE是SLICEL,其余的是SLICEM[1],也就是說,F(xiàn)PGA內(nèi)2/3的資源在bitstream文件下載后,其...
Linux下如何通過UIO監(jiān)控PL給到PS的中斷
xilinx mpsoc 平臺(tái)中,PS 和 PL 進(jìn)行交互時(shí),PS 需要獲取 PL 發(fā)出的中斷信號。從 mpsoc 技術(shù)參考手冊 ug1085 TRM ...
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