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今天我們講一下與時(shí)鐘（clock）相關(guān)的PCB的設(shè)計(jì)考慮，主要分兩部分：原理圖設(shè)計(jì) - 針對時(shí)鐘電路應(yīng)該放置哪些器件？以及PCB布局和走線 - 如何擺放與時(shí)鐘相關(guān)的元器件并正確連線達(dá)到理想的性能。...
一個(gè)完整的半定制設(shè)計(jì)流程應(yīng)該是：RTL代碼輸入、功能仿真、邏輯綜合、形式驗(yàn)證、時(shí)序/功耗/噪聲分析，布局布線（物理綜合）、版圖驗(yàn)證。...
動(dòng)上料裝置進(jìn)行生產(chǎn)活動(dòng)。而消費(fèi)類PCB朝著更薄、更小、更輕的方向發(fā)展，一方面要求上料裝置能有效將粘連的兩片分開；另一方面，對兩片檢測功能提出了更高的要求。...
世界三大EDA廠商一般指的是Cadence, Synopsys, Mentor Graphics，四強(qiáng)的話好包括Springsoft。就我個(gè)人的理解，Synopsys主要是強(qiáng)在前端，DC和PT是公認(rèn)的標(biāo)準(zhǔn)。Cadence牛在后端，無論是RF, 數(shù)字，亦或是PCB級，它的后端布線工具都用的挺廣的。...
在用verilog編寫代碼的時(shí)候出現(xiàn)錯(cuò)誤提示：“mixed single- and double-edge expressions are not supported”：在敏感驅(qū)動(dòng)信號中，不能既有單邊沿的驅(qū)動(dòng)又有雙邊沿的驅(qū)動(dòng)，如always@(posedge Clk50Mhz or negedge ...
EMI超標(biāo)的主要源頭之一是時(shí)鐘，良好的時(shí)鐘設(shè)計(jì)和布局不僅確保了系統(tǒng)良好的性能和時(shí)序問題，還可以最大限度的降低EMI輻射問題。...
PCB設(shè)計(jì)過程中工程師幾乎必做的事就是給每個(gè)電源管腳（Vcc、Vdd等）加上一個(gè)0.1uF的陶瓷電容，并在某些地方加上更大容量的極性電容，幾乎成了每天吃飯必定要吃碗米一樣的事情了，但Why呢？...
上次測試的時(shí)候參考GD-LinkAdapterUserManualV1.0.pdf文件中前3節(jié)的燒寫步驟操作,雖然軟件可讀出固件版本及UID,且燒寫提示如圖信息,但是開發(fā)板還是跟新生嬰兒一樣毫無變化. 2.打開項(xiàng)目,連接開發(fā)板 在Keil中打開Demo的第2個(gè)項(xiàng)目02_GPIO_KeyBoard_P...
GD32F330支持用KEIL或IAR為開發(fā)工具，出于習(xí)慣本人以KEIL為開發(fā)工具，其版本為V5.15。為了使KEIL對該開發(fā)板予以支持，需添加安裝包 隨后即可以例程01_GPIO_Runing_Led來進(jìn)行測試，經(jīng)編譯其結(jié)果如圖1所示。 圖1完成編譯 在添加安裝包之后，使用工具圖標(biāo)打開Option...
EDA是一種以事件為媒介，實(shí)現(xiàn)組件或服務(wù)之間最大松耦合的方式。傳統(tǒng)面向接口編程是以接口為媒介，實(shí)現(xiàn)調(diào)用接口者和接口實(shí)現(xiàn)者之間的解耦，但是這種解耦程度不是很高，如果接口發(fā)生變化，雙方代碼都需要變動(dòng)，而事件驅(qū)動(dòng)則是調(diào)用者和被調(diào)用者互相不知道對方，兩者只和中間消息隊(duì)列耦合。...
我們采用的方式是將這些系統(tǒng)使用事件驅(qū)動(dòng)架構(gòu)。從高一層來看，這意味著當(dāng)有趣的事情發(fā)生在系統(tǒng)的記錄(SOR)中，我們要求系統(tǒng)能夠發(fā)出事件來標(biāo)識當(dāng)前資源已經(jīng)被改變。...
1.使用串口首先我們得根據(jù)GD32F330C8T6芯片的datasheet找到對應(yīng)的引腳。在GD32330C-START開發(fā)板原理圖中，查看該引腳有沒有引出來。 （1）在GD32F330C8T6芯片的datasheet中找到引腳PA2、PA3為串口USART1的TX和RX； （2）在GD32330C...
看看今天的物聯(lián)網(wǎng)和智能設(shè)備領(lǐng)域，你可能會覺得現(xiàn)在是成為芯片工程師最好的年代。設(shè)備越來越小，將越來越多功能集成到更小的尺寸中。從手機(jī)到可穿戴設(shè)備，再到家居、汽車和工作場所的各式智能傳感器，2018年是尖端創(chuàng)新的一年。創(chuàng)新而又體現(xiàn)未來感。 不過這個(gè)創(chuàng)新的未來，來的不是那么容易。你可以問任何一位現(xiàn)代芯片工...
微電子封裝 90年代前半期美國提出了第二代表面組裝技術(shù)的IC封裝技術(shù)--BGA(球柵陣列封裝)，其進(jìn)一步的小型封裝為CSP(芯片規(guī)模封裝)，在20世紀(jì)90年代末成為人們關(guān)注的焦點(diǎn)。 球柵陣列封裝(BGA) 典型的球柵陣列封裝(BGA)是非常耐用的，如圖1所示。一旦被掉落到地板上之后，BGA可進(jìn)行組裝...
隨著電子組件功能提升，各種電子產(chǎn)品不斷朝向高速化方向發(fā)展，然而高性能化、多功能化、可攜帶化的結(jié)果，各式各樣的EMC(Electro Magnetic Compatibility)問題，卻成為設(shè)計(jì)者揮之不去的夢魘。 目前EMI(Electro Magnetic Interference)噪訊對策，大多...
布線（Layout）是pcb設(shè)計(jì)工程師最基本的工作技能之一。走線的好壞將直接影響到整個(gè)系統(tǒng)的性能，大多數(shù)高速的設(shè)計(jì)理論也要最終經(jīng)過Layout得以實(shí)現(xiàn)并驗(yàn)證，由此可見，布線在高速pcb設(shè)計(jì)中是至關(guān)重要的。下面將針對實(shí)際布線中可能遇到的一些情況，分析其合理性，并給出一些比較優(yōu)化的走線策略。 主要從直角...
隨著各種大規(guī)模、高密度新型電子元器件的不斷涌現(xiàn)，電子電路的設(shè)計(jì)越來越復(fù)雜、越來越精密?；谶@種迫切需求，電路CAD設(shè)計(jì)技術(shù)也充分利用了計(jì)算機(jī)革命所帶來的成果，使得設(shè)計(jì)手段發(fā)生了翻天覆地的變化，其中的Protel 99電子設(shè)計(jì)軟件就是一款功能強(qiáng)大、界面友好、操作簡便實(shí)用的快速、高效的電路CAD設(shè)計(jì)軟件...
剪切是印制電路板機(jī)械操作的第一步，通過剪切可以給出大致的形狀和輪廓?；镜那懈罘椒ㄟm用于各種各樣的基板，通常厚度不超過2mm 。當(dāng)切割的板子超過2mm 時(shí)，剪切的邊緣會出現(xiàn)粗糙和不整齊，因此，一般不采用這種方法。...
為了給用戶提供操作GPIO的通用API，方便應(yīng)用程序開發(fā)，RT-Thread中引入了通用GPIO設(shè)備驅(qū)動(dòng)。并提供類似Arduino風(fēng)格的API用于操作GPIO，如設(shè)置GPIO模式和輸出電平、讀取GPIO輸入電平、配置GPIO外部中斷。本文說明了如何使用RT-Thread的通用GPIO設(shè)備驅(qū)動(dòng)。 ...
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