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• FPGA設(shè)計中經(jīng)常犯的10個錯誤

  本文列出了FPGA設(shè)計中常見的十個錯誤。我們收集了 FPGA 工程師在其設(shè)計中犯的 10 個最常見錯誤，并提供了解決方案的建議和替代方案。本文假定讀者已經(jīng)具備 RTL 設(shè)計和數(shù)字電路方面的基礎(chǔ)。接下來讓我們深入探討在FPGA 設(shè)計中要避免的 10 大錯誤。...

  1398次閱讀 · 1評論 fpgaFPGA設(shè)計RTL數(shù)字電路時序
  

• FPGA在基站上的應(yīng)用

  ①應(yīng)該是沒設(shè)置好有效路徑，有些信號可能扇出比較多，它實際的路徑名字，跟時序分析窗口中的是不一致的，需要打開到最底層的路徑，找到實際路徑名。...

  751次閱讀 · 0評論 fpga濾波器DDR3無線電Ethernet
  

• 為什么SoC驗證一定需要FPGA原型驗證呢？

  在現(xiàn)代SoC芯片驗證過程中，不可避免的都會使用FPGA原型驗證，或許原型驗證一詞對你而言非常新鮮，但是FPGA上板驗證應(yīng)該是非常熟悉的場景了。...

  1762次閱讀 · 0評論 ASIC設(shè)計SoC芯片觸發(fā)器FPGA開發(fā)板PLL電路
  

• 從SoC仿真驗證到FPGA原型驗證的時機

  我們當(dāng)然希望在項目中盡快準(zhǔn)備好基于FPGA原型驗證的代碼，以便最大限度地為軟件團隊和RTL驗證人員帶來更客觀的收益。...

  1158次閱讀 · 0評論 驅(qū)動器存儲器SoC芯片RTLFPGA開發(fā)板
  

• 基于R-Tile的英特爾Agilex 7 FPGA正在量產(chǎn)

  FPGA加速器在市場上的應(yīng)用率穩(wěn)步增長，而隨著配備R-Tile的FPGA的推出，更高性能的加速器也隨之而來。...

  309次閱讀 · 0評論 fpga英特爾加速器
  

• 基于FPGA 的AI火災(zāi)偵查定位解決方案

  解決方案包括建立一個分布式計算機視覺系統(tǒng)，增加建筑物火災(zāi)的早期檢測。該系統(tǒng)的分布式和模塊化特性可以輕松部署，而無需增加更多基礎(chǔ)設(shè)施。在...

  689次閱讀 · 0評論 fpgaAI計算機視覺
  

• 使用FPGA進行AI火災(zāi)定位-FirAI

  目標(biāo)：解決方案包括建立一個分布式計算機視覺系統(tǒng)，增加建筑物火災(zāi)的早期檢測。該系統(tǒng)的分布式和模塊化特性可以輕松部署，而無需增加更多基礎(chǔ)設(shè)施。...

  524次閱讀 · 0評論 fpgaSD卡DPUUSB攝像頭
  

• Intel和Xilinx的FPGA系列芯片命名規(guī)則

  Altera FPGA產(chǎn)品系列也備受歡迎，主要的FPGA系列產(chǎn)品有：Cyclone、MAXII、Arria、Stratix、Agilex，其中應(yīng)用廣泛的消費級FPGA芯片是Cyclone系列，市面上大部分Inter開發(fā)板都是用的Cyclone IV。...

  1818次閱讀 · 0評論 fpgaXilinxintel
  

• 基于移位寄存器TDM的實現(xiàn)方式

  設(shè)計中兩片F(xiàn)PGA分割邊界的數(shù)據(jù)Sig1、Sig2、Sig3、Sig4……等一大波的信號被并行地加載到傳輸時鐘的上升沿上的移位寄存器中，并用相同的時鐘移出。...

  332次閱讀 · 0評論 FPGA設(shè)計移位寄存器多路復(fù)用器TDM
  

• Xilinx FPGA遠程調(diào)試方法(二)

  上篇主要是分享了Vivado編譯軟件遠程調(diào)試的方法。杰克使用Vivado軟件進行遠程連接，主要是用于固化程序以及FPGA(PL端)的異常排查。而本篇主要內(nèi)容是對使用Vitis軟件遠程調(diào)試的方法進行總結(jié)和分享。...

  3406次閱讀 · 0評論 fpgaXilinx遠程調(diào)試Vivado編譯軟件
  

• Xilinx FPGA遠程調(diào)試方法(一)

  日常的FPGA開發(fā)常常會遇到“編碼與上機調(diào)試使用各自的電腦”的場景，解決方法一般如下。...

  3596次閱讀 · 0評論 fpga嵌入式Xilinx遠程調(diào)試Vitis
  

• 詳解FPGA電源排序的四種方案

  當(dāng)采用現(xiàn)場可編程門陣列 (FPGA) 進行設(shè)計時，電源排序是需要考慮的一個重要的方面。通常情況下，F(xiàn)PGA 供應(yīng)商都規(guī)定了電源排序要求，因為一個FPGA所需要的電源軌數(shù)量會從 3 個到 10 個以上不等。...

  1050次閱讀 · 0評論 fpga接口引腳可編程門陣列電源排序
  

• FPGA跨時鐘域處理的注意事項

  跨時鐘域之間不能存在組合邏輯。 跨時鐘域本身就容易產(chǎn)生亞穩(wěn)態(tài)，如果在跨時鐘域之間存在組合邏輯會大大增加競爭冒險出現(xiàn)的概率。 這一點在實際設(shè)計中通常會因為粗心而導(dǎo)致設(shè)計異常，如下邊代碼中的S_clr_flag_a_all信號，就是在擴展時不小心使用了組合邏輯，這種情況下由于競爭冒險，會導(dǎo)致跨時鐘域后的...

  1182次閱讀 · 0評論 fpga信號組合邏輯時序邏輯時鐘域
  

• FPGA中定點數(shù)的處理方法

  FPGA中最常用的還是定點化數(shù)據(jù)處理方法，本文對定點化數(shù)據(jù)處理方法進行簡要探討，并給出必要的代碼例子。...

  3650次閱讀 · 0評論 FPGA除法運算數(shù)據(jù)處理代碼符號
  

• 多片F(xiàn)PGA原型驗證系統(tǒng)互連拓撲分析

  多片F(xiàn)PGA的原型驗證系統(tǒng)的性能和容量通常受到FPGA間連接的限制。FPGA中有大量的資源，但IO引腳的數(shù)量受封裝技術(shù)的限制，通常只有1000個左右的用戶IO引腳。...

  1865次閱讀 · 0評論 連接器交換機SoC設(shè)計FPGA系統(tǒng)
  

• SoC設(shè)計的IO PAD怎么移植到FPGA原型驗證

  FPGA原型驗證系統(tǒng)要盡可能多的復(fù)用SoC相關(guān)的模塊，這樣才是復(fù)刻SoC原型的意義所在。...

  862次閱讀 · 0評論 時鐘緩沖器分頻器RTLSoC系統(tǒng)FPGA開發(fā)板
  

• 淺析FPGA原型驗證系統(tǒng)的時鐘資源

  如果SoC設(shè)計規(guī)模小，在單個FPGA內(nèi)可以容納，那么只要系統(tǒng)中的FPGA具有所SoC所設(shè)計需要時鐘的數(shù)量...

  1137次閱讀 · 0評論 fpgapllSoC設(shè)計時鐘分頻
  

• 基于移位寄存器的TDM的實現(xiàn)方式

  設(shè)計中兩片F(xiàn)PGA分割邊界的數(shù)據(jù)Sig1、Sig2、Sig3、Sig4……等一大波的信號被并行地加載到傳輸時鐘的上升沿上的移位寄存器中，并用相同的時鐘移出。...

  490次閱讀 · 0評論 移位寄存器多路復(fù)用器FPGA開發(fā)板
  

• 正確認(rèn)識原型驗證多片F(xiàn)PGA自動分割工具

  當(dāng)SoC的規(guī)模在一片F(xiàn)PGA中裝不下的時候，我們通常選擇多片F(xiàn)PGA原型驗證的平臺來承載整個SoC系統(tǒng)。...

  815次閱讀 · 0評論 存儲器SoC設(shè)計FPGA開發(fā)板

• 處理FPGA原型設(shè)計需要多長時間？

  FPGA設(shè)計的五個主要任務(wù)：邏輯綜合、門級映射、整體功能邏輯布局、邏輯資源互連布線...

  787次閱讀 · 0評論 FPGA設(shè)計EDA工具RTLBRAM
  
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