異或門 （簡稱XOR gate）是數(shù)字邏輯中實現(xiàn)邏輯異或的邏輯門。有多個輸入端、一個輸出端，多輸入異或門可由兩輸入異或門構(gòu)成。若兩個輸入的電平相異，則輸出為高電平1；若兩個輸入的電平相同，則輸出為低電平0。即如果兩個輸入不同，則異或門輸出高電平1。

雖然異或不是開關(guān)代數(shù)的基本運算之一，但是在實際運用中相當(dāng)普遍地使用分立的異或門。大多數(shù)開關(guān)技術(shù)不能直接實現(xiàn)異或功能，而是使用多個門組合設(shè)計。

##############################################

##############################################

隨著超大規(guī)模集成電路的復(fù)雜程度不斷提高，電路制造后的測試所需的時間和經(jīng)濟成本也不斷增加。電路在設(shè)計時向電路添加一些特殊的結(jié)構(gòu)（例如掃描鏈和內(nèi)建自測試），能夠大大方便之后的電路測試。這樣的設(shè)計被即為可測試性設(shè)計，它們使電路更加復(fù)雜，但是卻能憑借更簡捷的測試降低整個項目的成本。

隨著超大規(guī)模集成電路的集成度不斷提高，同時市場競爭壓力的不斷增加，集成電路設(shè)計逐漸引入了可重用設(shè)計方法學(xué)。可重用設(shè)計方法學(xué)的主要意義在于，提供IP核（知識產(chǎn)權(quán)核）的供應(yīng)商可以將一些已經(jīng)預(yù)先完成的設(shè)計以商品的形式提供給設(shè)計方，后者可以將IP核作為一個完整的模塊在自己的設(shè)計項目中使用。