自ＰＣＩ協(xié)議問世以來，ＰＣＩ總線應(yīng)用越來越廣泛，現(xiàn)已成為事實上的計算機總線標準。隨著ＰＣＩ應(yīng)用和開發(fā)的深入，往往需要在復(fù)雜的ＰＣＩ系統(tǒng)中使用ＰＣＩ橋來完成設(shè)計工作，包括使用主／ＰＣＩ橋來完成整個系統(tǒng)的初始化配置過程。ＰＣＩ橋的使用已從傳統(tǒng)的ＰＣ機領(lǐng)域拓展到更多的電子應(yīng)用系統(tǒng)中。

１、PCI主橋簡介

在復(fù)雜的ＰＣＩ系統(tǒng)中，往往擁有不只一條ＰＣＩ總線。為了提高ＰＣＩ系統(tǒng)的負載能力，可用ＰＣＩ－ＰＣＩ橋把各條ＰＣＩ總線連接起來，同時在處理器總線與ＰＣＩ總線之間使用主／ＰＣＩ橋來完成總線轉(zhuǎn)換，以形成完整的ＰＣＩ系統(tǒng)。常用的ＰＣＩ系統(tǒng)結(jié)構(gòu)如圖１所示。

系統(tǒng)上電時，主ＣＰＵ（處理器）對ＰＣＩ目標設(shè)備的初始化也稱為配置訪問。由于ＰＣＩ目標設(shè)備所定義的配置空間通常不在ＣＰＵ的存儲器和Ｉ／Ｏ空間中，所以需要一種特殊的機制來執(zhí)行配置訪問。這種機制通常由主／ＰＣＩ橋來完成。配置軟件在上電后能夠掃描ＰＣＩ總線，以確定現(xiàn)有哪些ＰＣＩ設(shè)備，并根據(jù)它們的配置要求分別進行配置。配置完成后，各個ＰＣＩ目標設(shè)備就可以在ＰＣＩ總線控制器的協(xié)調(diào)仲裁下正常工作。

在ＰＣ兼容系統(tǒng)中，主／ＰＣＩ橋也稱為北橋，用于連接主處理器總線和基礎(chǔ)ＰＣＩ局部總線（第一級ＰＣＩ總線）。北橋芯片內(nèi)通常集成有主存儲器控制器，因此處理速度很快。南橋芯片內(nèi)一般集成有ＩＤＥ控制器、ＵＳＢ和其它速度較慢的Ｉ／Ｏ控制器，因此處理速度相對較慢。南北橋構(gòu)成芯片組。

２、Wishbone片上總線技術(shù)

片上系統(tǒng)ＳＯＣ（Ｓｙｓｔｅｍ－Ｏｎ－Ｃｈｉｐ）技術(shù)近兩年發(fā)展迅速，越來越多的廠商開始開發(fā)自己的ＩＰ核，然后提供給系統(tǒng)集成者。而各廠商采用自己定義的ＩＰ核接口規(guī)范來開發(fā)產(chǎn)品，使得系統(tǒng)集成成為一個棘手的問題。為了提供ＩＰ核的可重用性，實現(xiàn)眾多廠商ＩＰ核的有效互連，片上總線ＯＣＢ（Ｏｎ－Ｃｈｉｐ－Ｂｕｓ）技術(shù)就應(yīng)運而生了。目前在ＳＯＣ領(lǐng)域較有影響的三種片上總線標準為：ＩＢＭ公司的Ｃｏｒｅ-ｃｏｎｎｅｃｔ、ＡＲＭ公司的ＡＭＢＡ和ＳｉｌｉｃｏｒｅＣｏｒｐ公司的Ｗｉｓｈｂｏｎｅ總線。其中Ｗｉｓｈｂｏｎｅ總線已經(jīng)被全球最大的開放ＩＰ組織（Ｏｐｅｎｃｏｒｅｓ）列為主要支持的ＳＯＣ內(nèi)部互連總線協(xié)議。遵循Ｗｉｓｈｂｏｎｅ總線協(xié)議的ＩＰ核可以很快有效地集成到ＳＯＣ中。目前，Ｏｐｅｎｃｏｒｅｓ上很多開放的ＩＰ核接口都采用Ｗｉｓｈｂｏｎｅ總線設(shè)計。而且越來越多的ＩＰ核商用廠商也宣布支持Ｗｉｓｈ-ｂｏｎｅ總線協(xié)議。

Ｗｉｓｈｂｏｎｅ總線最大的特點是結(jié)構(gòu)簡單靈活，需要邏輯門少；同時完全免費、完全公開。Ｗｉｓｈｂｏｎｅ規(guī)范支持完整的普通數(shù)據(jù)傳輸協(xié)議，包括單個讀寫周期、塊傳輸?shù)?。?shù)據(jù)總線寬度為８～６４位（寬度仍然可以擴展），地址總線可以達到６４位；最快時一個時鐘周期就可進行一次數(shù)據(jù)傳輸；支持握手協(xié)議，速率可以調(diào)整；支持出錯重試等。在Ｗｉｓｈｂｏｎｅ總線規(guī)范中，可使用Ｍａｓｔｅｒ／Ｓｌａｖｅ結(jié)構(gòu)實現(xiàn)非常靈活的系統(tǒng)設(shè)計。Ｍａｓｔｅｒ和Ｓｌａｖｅ有四種互連方式，分別為：點對點、數(shù)據(jù)流、共享總線和交叉互連。其中點對點方式是連接一個Ｍａｓｔｅｒ和一個Ｓｌａｖｅ最簡單的方式，使用起來非常方便。圖２給出了采用點對點互連方式的Ｗｉｓｈｂｏｎｅ主／從接口圖。其中ＳＹＳＣＯＮ為產(chǎn)生ＲＳＴ復(fù)位和ＣＬＫ時鐘信號的模塊，ＴＡＧＮ為用戶自定義信號。

Ｗｉｓｈｂｏｎｅ 在Ｍａｓｔｅｒ和Ｓｌａｖｅ之間使用的握手協(xié)議如圖３所示。當準備好傳輸數(shù)據(jù)時？Ｍａｓｔｅｒ使ＳＴＢ Ｏ信號有效，ＳＴＢ Ｏ狀態(tài)將一直保持到Ｓｌａｖｅ的結(jié)束信號ＡＣＫ Ｏ、ＥＲＲ Ｏ 或 ＲＴＹ Ｏ？對Ｍａｓｔｅｒ而言是ＡＣＫ Ｉ？ＥＲＲ Ｉ和ＲＴＹ Ｉ？ 之一聲明有效。Ｍａｓｔｅｒ在每一個ＣＬＫ Ｉ的上升沿對結(jié)束信號采樣？如果該信號有效？ＳＴＢ Ｏ信號變低。此外，Ｗｉｓｈｂｏｎｅ接口的兩邊都能夠完全控制數(shù)據(jù)傳送的速率。

３、PCI Bridge核

開放ＩＰ組織Ｏｐｅｎｃｏｒｅｓ提供的ＰＣＩ Ｂｒｉｄｇｅ Ｃｏｒｅ提供了Ｗｉｓｈｂｏｎｅ片上系統(tǒng)總線和ＰＣＩ邏輯總線的接口。ＰＣＩ Ｂｒｉｄｇｅ Ｃｏｒｅ由兩個相對獨立的單元組成：一個單元處理由ＰＣＩ總線方啟動的數(shù)據(jù)交易，另一個單元則處理由Ｗｉｓｈｂｏｎｅ總線方啟動的交易。它是一個ＰＣＩ總線和Ｗｉｓｈｂｏｎｅ總線之間真正的橋。

ＰＣＩ 橋核支持３２位ＰＣＩ總線接口，并完全兼容ＰＣＩ２．２協(xié)議（支持６６ＭＨｚ規(guī)范）；它含有獨立的主橋、從橋功能模塊和完整的命令／狀態(tài)寄存器；支持Ｗｉｓｈｂｏｎｅ ＳＯＣ互連協(xié)議Ｂ版本（包括Ｂ１和Ｂ３）；此外，它可通過Ｗｉｓｈｂｏｎｅ接口支持３２位總線操作；并可配置片上ＦＩＦＯ。

３．１ ＰＣＩ Ｂｒｉｄｇｅ內(nèi)部結(jié)構(gòu)

ＰＣＩ橋核由兩個相對獨立的單元模塊組成：ＰＣＩ目標單元和Ｗｉｓｈｂｏｎｅ從單元。每個單元自身都有一套完整的功能來支持Ｗｉｓｈｂｏｎｅ和ＰＣＩ總線之間的交易。Ｗｉｓｈｂｏｎｅ從單元可作為ＰＣＩ橋中Ｗｉｓｈ-ｂｏｎｅ側(cè)的從設(shè)備和ＰＣＩ側(cè)的主設(shè)備啟動交易；ＰＣＩ目標單元則可作為ＰＣＩ橋中ＰＣＩ側(cè)的目標設(shè)備和Ｗｉｓｈｂｏｎｅ側(cè)的主設(shè)備啟動交易。兩個單元互相獨立。ＰＣＩ目標單元用于實現(xiàn)ＰＣＩ總線從設(shè)備接口和Ｗｉｓｈｂｏｎｅ總線的主設(shè)備接口；而Ｗｉｓｈｂｏｎｅ從單元則用于實現(xiàn)Ｗｉｓｈｂｏｎｅ總線從接口和ＰＣＩ總線的主設(shè)備接口。

圖４是ＰＣＩ橋核的內(nèi)部結(jié)構(gòu)。

３．２ ＰＣＩ Ｂｒｉｄｇｅ的操作

ＰＣＩ橋核有兩種應(yīng)用方式：主、從橋（相對ＰＣＩ總線而言）。作為從橋時，當ＰＣＩ橋連到擁有ＰＣＩ總線的主機系統(tǒng)上電后，主機系統(tǒng)軟件將掃描ＰＣＩ總線上連接的ＰＣＩ總線設(shè)備（包括ＰＣＩ橋），然后配置ＰＣＩ橋空間寄存器，即由配置軟件來完成ＰＣＩ橋的初始化配置過程。之后，ＰＣＩ橋進入正常工作狀態(tài)。

ＰＣＩ橋核作為主橋時，ＰＣＩ橋完全控制ＰＣＩ總線。ＰＣＩ橋的Ｗｉｓｈｂｏｎｅ代理設(shè)備完全負責連接到ＰＣＩ總線上的ＰＣＩ設(shè)備的初始化配置過程。運行在Ｗｉｓｈｂｏｎｅ代理設(shè)備上的固件（設(shè)備無關(guān)軟件）在上電后掃描ＰＣＩ總線，以確定有哪些ＰＣＩ設(shè)備，并分別有什么配置要求。然后在Ｗｉｓｈｂｏｎｅ映象０空間內(nèi)配置各個ＰＣＩ設(shè)備的配置空間。配置完成即可加載各個ＰＣＩ設(shè)備的驅(qū)動程序。此時ＰＣＩ設(shè)備也可以通過ＰＣＩ橋的ＰＣＩ目標單元訪問Ｗｉｓｈｂｏｎｅ總線。

ＰＣＩ橋的配置空間包括兩個部分：一個部分為Ｗｉｓｈｂｏｎｅ從單元的配置、狀態(tài)和控制寄存器；另一個部分為ＰＣＩ目標單元的配置、狀態(tài)和控制寄存器（包括ＰＣＩ協(xié)議要求實現(xiàn)的２５６字節(jié)標準配置空間）。ＰＣＩ橋通過相應(yīng)的地址映像空間（ＰＣＩ映像０和Ｗｉｓｈｂｏｎｅ映像０）來實現(xiàn)ＰＣＩ橋兩側(cè)代理設(shè)備訪問ＰＣＩ橋的配置空間。作為從橋時，主機系統(tǒng)的主橋可以使用普通的存儲器讀寫指令來訪問ＰＣＩ橋的配置空間，也可以通過配置讀寫指令來訪問ＰＣＩ橋配置空間的低２５６字節(jié)。作為主橋時，ＰＣＩ橋本身就可以產(chǎn)生配置周期。如同ＰＣ機Ｘ８６系統(tǒng)的主橋配置機制０一樣，ＰＣＩ橋的Ｗｉｓｈｂｏｎｅ代理主設(shè)備可以通過訪問ＰＣＩ橋配置空間的ＣＮＦ＿ＡＤＤＲ和ＣＮＦ＿ＤＡＴＡ寄存器來產(chǎn)生配置讀寫命令，從而實現(xiàn)對其它ＰＣＩ設(shè)備的上電初始化過程。

由于ＰＣＩ橋核是一個軟核，在ＰＣＩ橋核中有一個參數(shù)頭文件?？梢酝ㄟ^更改ＰＣＩ橋核頭文件的參數(shù)來改變ＰＣＩ橋的操作方式（如主橋或從橋設(shè)置、ＰＣＩ或Ｗｉｓｈｂｏｎｅ映像空間的定義等），因而使用非常方便。

４、 使用PCI Bridge核來訪問PCI設(shè)備

ＰＣＩ橋作為從橋一般用在ＰＣＩ擴展卡上（或稱ＰＣＩ周邊卡），如數(shù)據(jù)采集，圖像傳輸?shù)取６鳛橹鳂蛞话阌迷冢校茫煽偩€的主控板上（或稱ＰＣＩ系統(tǒng)卡），但需要初始化ＰＣＩ總線上的功能設(shè)備，并控制ＰＣＩ總線的操作。

為了調(diào)試主／從橋的應(yīng)用，筆者設(shè)計了三塊電路板來協(xié)調(diào)控制ＰＣＩ總線的操作。一塊為ＦＰＧＡ板（Ｘｉｌｉｎｘ公司的Ｓｐａｒｔａｎ ＩＩ芯片，設(shè)計有ＰＣＩ接口），一塊為微控制器板（５１單片機），一塊為普通ＰＣＩ擴展卡。

作為從橋時，只需要ＦＰＧＡ板就可以完成整個實驗過程。即用Ｖｅｒｉｌｏｇ語言實現(xiàn)一個Ｗｉｓｈｂｏｎｅ從接口，并連接到ＦＰＧＡ內(nèi)部的ＢｌｏｃｋＲＡＭ上（可由ＩＳＥ的ＣＯＲＥ ｇｅｎｅｒａｔｏｒ產(chǎn)生），然后選擇ＰＣＩ Ｂｒｉｄｇｅ核的應(yīng)用方式為ＧＵＥＳＴ（從橋方式），并連同自己的程序一起編譯下載到ＦＰＧＡ的配置芯片上。這樣，把ＦＰ-ＧＡ板插入ＰＣ機的ＰＣＩ插槽，就可在ＰＣ機上開發(fā)驅(qū)動程序來訪問ＦＰＧＡ板上的資源（如ＲＡＭ等）。如果要進行數(shù)據(jù)采集，可以把Ｗｉｓｈｂｏｎｅ從接口連接到數(shù)據(jù)采集模塊上。從橋?qū)崿F(xiàn)的功能模塊圖如圖５所示。

作為主橋時（選擇ＰＣＩ Ｂｒｉｄｇｅ核的應(yīng)用方式為ＨＯＳＴ），由于ＦＰＧＡ板上沒有微控制器，所以需要把ＦＰＧＡ板上的Ｉ／Ｏ口與５１單片機電路板上的Ｉ／Ｏ擴展口連接起來一起形成ＰＣＩ主控板。ＦＰＧＡ板和普通ＰＣＩ擴展板都插到獨立的ＰＣＩ底板的ＰＣＩ插槽上，然后在ＦＰＧＡ板上和單片機板上進行編程以實現(xiàn)對普通ＰＣＩ擴展板的初始化配置和正常讀寫操作。其電路功能模塊框圖如圖６所示。

由于單片機的接口是８位，讀寫時序也和ＰＣＩ橋中的Ｗｉｓｈｂｏｎｅ時序不同，所以需要在ＰＣＩ橋和單片機擴展Ｉ／Ｏ口之間用軟件實現(xiàn)一個Ｗｉｓｈｂｏｎｅ主接口。該Ｗｉｓｈｂｏｎｅ主接口的工作過程為：單片機發(fā)出讀操作時，先傳送４次８位地址數(shù)據(jù)到ＦＰＧＡ中，再將由Ｗｉｓｈｂｏｎｅ主接口組成的３２位地址存儲在一個３２位地址寄存器中，隨后單片機發(fā)出讀命令，以啟動Ｗｉｓｈｂｏｎｅ主接口進行Ｗｉｓｈｂｏｎｅ總線的讀時序，當Ｗｉｓｈｂｏｎｅ主接口把從ＰＣＩ總線上讀來的３２位數(shù)據(jù)存放在一個３２位讀數(shù)據(jù)寄存器中后，單片機將分４次讀出３２位數(shù)據(jù)；單片機進行寫操作如同讀一樣，依次傳送３２位地址和３２位數(shù)據(jù)，最后發(fā)送寫命令啟動Ｗｉｓｈｂｏｎｅ主接口以進行Ｗｉｓｈｂｏｎｅ總線的寫時序。Ｗｉｓｈｂｏｎｅ的讀寫時序可由Ｖｅｒｉｌｏｇ語言描述的同步狀態(tài)機實現(xiàn)。

在５１單片機上用Ｃ語言編程實現(xiàn)主控板固件的完整軟件過程為：上電后，固件先按順序依次掃描ＰＣＩ總線上存在的ＰＣＩ設(shè)備，掃描的目的之一是為總線和設(shè)備編號。當掃描結(jié)束后，設(shè)備類型、拓撲位置等信息以設(shè)備為單位被存放在一個數(shù)據(jù)結(jié)構(gòu)中，并按實際掃描的順序組成一個鏈表。同時，設(shè)備的配置要求也依次存放在這個數(shù)據(jù)鏈表中。固件得到系統(tǒng)的設(shè)備拓撲圖后，分別按照設(shè)備的配置要求一一進行配置，也就是分配地址資源給設(shè)備的基地址寄存器。配置完成后，各個ＰＣＩ設(shè)備即可進入正常工作狀態(tài)。

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