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      電子發(fā)燒友網(wǎng)>電子資料下載>可編程邏輯>FPGA/ASIC>VHDL的180例代碼

      VHDL的180例代碼

      2014-07-16 | doc | 858KB | 次下載 | 免費(fèi)

      資料介紹

      基礎(chǔ)的實(shí)例代碼

      　　【例3-1】 2選1多路選擇器程序。 （P31）

      　　

      　　LIBRARY IEEE; --IEEE庫(kù)使用說(shuō)明語(yǔ)句

      　　USE IEEE.STD_LOGIC_1164.ALL;

      　　ENTITY mux21 IS --實(shí)體說(shuō)明部分

      　　PORT（

      　　a，b ： IN STD_LOGIC;

      　　s： IN STD_LOGIC;

      　　y： OUT STD_LOGIC

      　　）;

      　　END ENTITY mux21;

      　　ARCHITECTURE mux21a OF mux21 IS --結(jié)構(gòu)體說(shuō)明部分

      　　BEGIN

      　　PROCESS（a，b，s）

      　　BEGIN

      　　IF s=‘0’ THEN y《=a;

      　　ELSE

      　　y《=b;

      　　END IF;

      　　END PROCESS;

      　　END ARCHITECTURE mux21a;

      　　

      　　【例3-2】 有類(lèi)屬說(shuō)明的2輸入與非門(mén)的實(shí)體描述。 （P33）

      　　

      　　ENTITY nand2 IS

      　　GENERIC （ t_rise ： TIME ：= 2ns ;

      　　t_fall ： TIME ：= 1ns ）

      　　PORT（ a： IN BIT;

      　　b ： IN BIT;

      　　s ： OUT BIT）;

      　　END ENTITY nand2;

      　　

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