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Vivado Design Suite 2015.3新增量編譯功能介紹
了解Vivado實(shí)現(xiàn)中2015.3中的新增量編譯功能,包括更好地處理物理優(yōu)化和自動(dòng)增量編譯流程。
任何電子器件的使用壽命均取決于其工作溫度。在較高溫度下器件會(huì)加快老化,使用壽命會(huì)縮短。但某些應(yīng)用要求電子產(chǎn)品工作在器件最大額定工作結(jié)溫下。以石油天然...
Zynq-7000 All Programmable SoC器件的I/O標(biāo)準(zhǔn)
了解設(shè)計(jì)人員在使用Zynq-7000 All Programmable SoC器件時(shí)可用的不同I / O,從標(biāo)準(zhǔn)I / O到串行收發(fā)器以及模擬輸入。
Zynq All Programmable技術(shù)的NI產(chǎn)品討論
來(lái)自Xilinx的Dave Tokic和來(lái)自National Instruments的Sanjay Challa討論了使用Zynq All Progra...
基于賽靈思FPGA技術(shù)的高靈活性嵌入式控制器的功能實(shí)現(xiàn)
RIO架構(gòu)目前已被用于多款系統(tǒng)中,如EUROelectronics等公司的系統(tǒng)。借助該架構(gòu),從產(chǎn)品原型設(shè)計(jì)到最終機(jī)械設(shè)備完成,EUROelectroni...
Xilinx新系列汽車(chē)設(shè)備如何推進(jìn)下一代駕駛員輔助
了解有關(guān)Xilinx新系列汽車(chē)設(shè)備如何幫助推進(jìn)下一代駕駛員輔助,駕駛員信息和駕駛員信息娛樂(lè)應(yīng)用的更多信息。 由汽車(chē)營(yíng)銷經(jīng)理Thorsten Kistl...
了解如何配置和練習(xí)U-Boot的USB主機(jī)功能。 這允許在Zynq上使用USB記憶棒進(jìn)行數(shù)據(jù)存儲(chǔ)和檢索,包括二次啟動(dòng)。
可用性網(wǎng)絡(luò)物理系統(tǒng)的SoC-E,可進(jìn)行監(jiān)控和維護(hù)
SoC-e的此高可用性網(wǎng)絡(luò)物理系統(tǒng)演示顯示網(wǎng)絡(luò)之間的零丟失切換以及兩個(gè)具有嵌入式藍(lán)牙連接的Netbox之間的同步,以進(jìn)行監(jiān)控和維護(hù)。
賽靈思推出的業(yè)界異構(gòu)多核soc--Zynq UltraScale+ MPSoC
Zynq UltraScale+ MPSoC 面向廣泛的應(yīng)用領(lǐng)域而打造 , 非常適用于 5G 無(wú)線基礎(chǔ)設(shè)施、面向數(shù)據(jù)中心和有線通信的軟件定義網(wǎng)絡(luò)、新一代...
2019-07-30 標(biāo)簽:賽靈思系統(tǒng)軟件生態(tài)系統(tǒng) 3052 0
intoPIX TICO夾層壓縮提供高達(dá)4:1的視覺(jué)無(wú)損壓縮,并在使用Xilinx HDMI IP內(nèi)核的KC705 Kintex-7評(píng)估平臺(tái)上進(jìn)行了演示。
我們將繼續(xù)介紹 Vivado HLS 所支持的 “for循環(huán)” 的優(yōu)化方法。在默認(rèn)情況下,Vivado HLS 并不會(huì)對(duì)順序執(zhí)行的 for 循環(huán)優(yōu)化為并...
Artix-7 FPGA AC701 評(píng)估套件產(chǎn)品描述
Artix-7 FPGA AC701 評(píng)估套件包含擁有領(lǐng)先單位功耗系統(tǒng)性能的 Artix-7 系列,快速滿足成本敏感型應(yīng)用。該套件包含硬件、設(shè)計(jì)工具、I...
2019-07-31 標(biāo)簽:賽靈思硬件設(shè)計(jì)工具 3049 0
Bitmain生產(chǎn)比特幣采礦機(jī)以及最大的礦山和哈希率權(quán)衡平臺(tái)產(chǎn)品以及虛擬貨幣采礦業(yè)的服務(wù)。
利用賽靈思Spartan-3A DSP FPGA器件開(kāi)發(fā)便攜式醫(yī)療成像設(shè)備
過(guò)去,醫(yī)療設(shè)備制造商主要集中于開(kāi)發(fā)諸如X光、MRI和超聲波等大型醫(yī)療設(shè)備,而今天的醫(yī)療設(shè)備制造商正走向便攜醫(yī)療電子設(shè)備的開(kāi)發(fā)。全世界人口老化的不斷擴(kuò)大,...
Vivado Design Suite 2016中的新功能介紹
新的器件支持包括:Kintex?UltraScale+?,Zynq?UltraScale+ MPSoC和所有Vivado HLx版本的單核Zynq-70...
Xilinx電氣驅(qū)動(dòng)器演示平臺(tái)的功能介紹
Xilinx電氣驅(qū)動(dòng)器演示平臺(tái)是一種輕松設(shè)計(jì)電氣驅(qū)動(dòng)器的方式,該驅(qū)動(dòng)器具有成本優(yōu)化,高性能和實(shí)現(xiàn)工業(yè)物聯(lián)網(wǎng)的功能.EDDP由什么構(gòu)成?如何使用它設(shè)計(jì)馬達(dá)...
2018-11-28 標(biāo)簽:驅(qū)動(dòng)器賽靈思物聯(lián)網(wǎng) 3045 0
借助Zynq RFSoC DFE解決 5G 大規(guī)模部署難題
無(wú)線電單元 (RU) 對(duì)更大帶寬的需求,不僅是為了增加數(shù)據(jù)速率。運(yùn)營(yíng)商還需要為現(xiàn)有和新的頻段解決復(fù)雜的無(wú)線電配置問(wèn)題。
UltraFAST設(shè)計(jì)方法簡(jiǎn)介
UltraFast 設(shè)計(jì)方法檢查表 (XTP301) 可通過(guò) Xilinx Documentation Navigator 訪問(wèn),另外也能夠以單獨(dú)電子數(shù)...
2019-07-31 標(biāo)簽:賽靈思流程圖設(shè)計(jì)方法 3038 0
利用DSP48E2 Slice中的寬MUX產(chǎn)品反饋
了解如何為UltraScale +設(shè)計(jì)添加額外的安全級(jí)別。 該視頻演示了如何防止差分功耗分析(DPA),以在比特流配置之上增加額外的安全性。
2018-11-27 標(biāo)簽:賽靈思功耗設(shè)計(jì) 3038 0
OpenCL的一個(gè)關(guān)鍵概念是將應(yīng)用程序問(wèn)題劃分為多維問(wèn)題空間。 被稱為N維內(nèi)核范圍的問(wèn)題空間的每個(gè)塊在...之間并行執(zhí)行相同的計(jì)算。
2018-11-22 標(biāo)簽:內(nèi)核賽靈思應(yīng)用程序 3032 0
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