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      標(biāo)簽　>　HDL

      HDL

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      2018-05-14 標(biāo)簽：verilogHDL描述語(yǔ)言 4.6萬(wàn) 0

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      2017-02-11 標(biāo)簽：VerilogHDLVHDL 3.6萬(wàn) 1

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      HDL代碼設(shè)計(jì)中重要的內(nèi)容之一就是設(shè)計(jì)程序的狀態(tài)機(jī)FSM，狀態(tài)轉(zhuǎn)換控制著整個(gè)程序的流程，為了理解程序，我們經(jīng)常需要把狀態(tài)機(jī)的狀態(tài)轉(zhuǎn)換圖畫(huà)出來(lái)，這樣看起來(lái)...

      2017-02-10 標(biāo)簽：HDLModelSim狀態(tài)機(jī) 1.6萬(wàn) 0

      IC設(shè)計(jì)流程之全定制和半定制

      一個(gè)完整的半定制設(shè)計(jì)流程應(yīng)該是：RTL代碼輸入、功能仿真、邏輯綜合、形式驗(yàn)證、時(shí)序/功耗/噪聲分析，布局布線(xiàn)（物理綜合）、版圖驗(yàn)證。

      2018-11-24 標(biāo)簽：ichdl 1.3萬(wàn) 0

      Modelsim、ActiveHDL等仿真器的基本原理

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      2018-06-14 標(biāo)簽：電路仿真器HDL 1.2萬(wàn) 0

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      2023-01-17 標(biāo)簽：寄存器HDLRTL 1.1萬(wàn) 0

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      所謂定點(diǎn)小數(shù)，就是小數(shù)點(diǎn)固定地隱含在某一位置上的數(shù)據(jù)。由于小數(shù)點(diǎn)的位置是固定的，所以就沒(méi)有必要儲(chǔ)存它（如果儲(chǔ)存了小數(shù)點(diǎn)的位置，那就是浮點(diǎn)數(shù)了）。而小數(shù)的...

      2018-06-12 標(biāo)簽：FPGAHDLCORDIC算法 9910 0

      常用的hdl語(yǔ)言有哪兩種

      Verilog HDL和VHDL是目前兩種最常用的硬件描述語(yǔ)言，同時(shí)也都是IEEE標(biāo)準(zhǔn)化的HDL語(yǔ)言。

      2020-08-25 標(biāo)簽：HDLvhdlVerilog HDL 9610 0

      8位無(wú)符號(hào)數(shù)乘法運(yùn)算HDL設(shè)計(jì)實(shí)例

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      加減乘除是運(yùn)算的基礎(chǔ)，也是我們?cè)谛W(xué)課堂里的重點(diǎn)必修課。乘除運(yùn)算雖然對(duì)于我們今天來(lái)說(shuō)還是小菜一碟，讓計(jì)算機(jī)做起來(lái)也是九牛一毛不足掛齒，但是要真探究一下計(jì)...

      2017-02-11 標(biāo)簽：HDL 9302 0

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      很多人問(wèn)我該如何去學(xué)FPGA，那么今天咱們就來(lái)聊一聊。 一、入門(mén)首先要掌握HDL（HDL=verilog+VHDL）。 第一句話(huà)是：還沒(méi)學(xué)數(shù)電的先學(xué)數(shù)電...

      2018-05-22 標(biāo)簽：FPGAHDLC語(yǔ)言 9252 0

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      Verilog HDL入門(mén)教程立即下載

      類(lèi)別：FPGA/ASIC 2019-02-11 標(biāo)簽：FPGAVerilogHDL 3377 1

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      2018-04-27 標(biāo)簽：fpga圖像處理hdl 7.0萬(wàn) 0

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      2022-09-19 標(biāo)簽：fpgaVerilogHDL 1.3萬(wàn) 0

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      2010-02-09 標(biāo)簽：VerilogHDLVHDL 1.1萬(wàn) 0

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      2023-12-07 標(biāo)簽：芯片設(shè)計(jì)HDL 5064 0

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