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      標(biāo)簽　>　rtl

      rtl

      rtl

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      RTL在電子科學(xué)中指的是寄存器轉(zhuǎn)換級電路（Register Transfer Level）的縮寫，也叫暫存器轉(zhuǎn)移層次。

      文章：353個 瀏覽：60887次 帖子：96個

      rtl技術(shù)

      如何去實現(xiàn)一個半加器電路的設(shè)計呢？

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      加法器用于兩個數(shù)或者多個數(shù)的加和，加法器又分為半加器（half adder）和全加器（full adder）。

      2023-05-22 標(biāo)簽：led燈加法器RTL 6323 0

      多路選擇器設(shè)計

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      組合邏輯電路的輸出信號只與當(dāng)前時刻的輸入信號有關(guān)，與其他時刻的輸入狀態(tài)無關(guān)，無存儲電路或反饋電路。

      2023-05-22 標(biāo)簽：led燈RTL組合邏輯電路 2589 0

      基于FPGA開發(fā)板點亮LED燈

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      設(shè)計規(guī)劃--波形繪制--編寫代碼--代碼編譯--編寫testbench--對比波形--綁定管腳--全編譯--上板驗證

      2023-05-22 標(biāo)簽：led燈時序電路RTL 1543 0

      聊一聊FPGA中的IP都是怎么區(qū)分的呢？

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      現(xiàn)今的FPGA設(shè)計規(guī)模越來越龐大，功能越來越復(fù)雜，因此FPGA設(shè)計的每個部分都從頭開始著手是不切實際的。

      2023-05-22 標(biāo)簽：FPGA設(shè)計寄存器EDA工具 2625 0

      原來SpinalHDL中BlackBox封裝數(shù)組接口如此簡單

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      當(dāng)在SpinalHDL中調(diào)用別人的RTL代碼時，需要采用BlackBox進(jìn)行封裝。對于大多數(shù)場景，想必小伙伴們都已輕車熟路。今天著重來看下當(dāng)RTL代碼的...

      2023-05-22 標(biāo)簽：接口封裝RTL 1031 0

      UVM Transaction-Level Modeling (TLM)概述

      驗證生產(chǎn)力的關(guān)鍵之一是在一個合適的抽象級別上考慮驗證問題。也就是說，在驗證DUT時應(yīng)該創(chuàng)建一個支持適當(dāng)抽象級別的驗證環(huán)境。

      2023-05-22 標(biāo)簽：RTLUVMTLM 1138 0

      多片F(xiàn)PGA原型平臺中的啟動同步研究

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      假如給定FPGA內(nèi)的時鐘沒有正確運行，那么我們多片F(xiàn)PGA系統(tǒng)的整體將不能同時啟動，這將有可能是致命的。

      2023-05-22 標(biāo)簽：fpga分頻器pll 446 0

      在高速設(shè)計中跨多個FPGA分配復(fù)位信號

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      SoC設(shè)計中通常會有“全局”同步復(fù)位，這將影響到整個設(shè)計中的大多數(shù)的時序設(shè)計模塊，并在同一時鐘沿同步釋放復(fù)位。

      2023-05-18 標(biāo)簽：fpgaSoC設(shè)計PAD 362 0

      RAL寄存器模型操作圖鑒

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      寄存器模型操作，指的是通過寄存器模型對RTL中寄存器進(jìn)行讀寫訪問，或者同步寄存器模型與RTL中寄存器的值。

      2023-05-17 標(biāo)簽：寄存器RTLUVM 1342 0

      從Verilog PLI到SystemVerilog DPI的演變過程

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      寫過Verilog和systemverilog的人肯定都用過系統(tǒng)自定義的函數(shù)$display，這是預(yù)定好的，可以直接調(diào)用的功能。

      2023-05-16 標(biāo)簽：VerilogC語言RTL 1249 0

      看一下多片F(xiàn)PGA原型驗證系統(tǒng)的時鐘同步

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      SoC設(shè)計是一個整體的芯片設(shè)計，最終整個設(shè)計將在統(tǒng)一到一塊硅片上完成整個芯片

      2023-05-16 標(biāo)簽：fpga緩沖器SoC設(shè)計 863 0

      淺析Stream里的隱式轉(zhuǎn)換

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      Stream、Flow是在電路描述里經(jīng)常用到的對象。

      2023-05-15 標(biāo)簽：RTLHDL語言 695 0

      IC設(shè)計全流程和要用到的EDA工具介紹

      設(shè)計一款芯片，明確需求（功能和性能）之后，先由架構(gòu)工程師設(shè)計架構(gòu)，得出芯片設(shè)計方案，前端設(shè)計工程師形成RTL代碼，驗證工程師進(jìn)行代碼驗證，再通過后端設(shè)計...

      2023-05-12 標(biāo)簽：電源IC設(shè)計eda 2238 0

      如何通過Vivado Synthesis中的URAM矩陣自動流水線化來實現(xiàn)最佳時序性能

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      UltraRAM 原語（也稱為 URAM）可在 Xilinx UltraScale + 架構(gòu)中使用，而且可用來高效地實現(xiàn)大容量深存儲器。由于大小和性能方...

      2023-05-08 標(biāo)簽：存儲器Xilinx流水線 2236 0

      FPGA原型系統(tǒng)裝配文件：Assign Traces介紹

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      多片F(xiàn)PGA原型驗證系統(tǒng)的拓?fù)溥B接方式各不相同，理想的多片F(xiàn)PGA原型驗證系統(tǒng)應(yīng)該可以靈活配置，可以使用其相應(yīng)的EDA工具

      2023-05-08 標(biāo)簽：FPGA設(shè)計連接器EDA工具 680 0

      芯片設(shè)計里的Multi-Bit FF方法討論

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      在現(xiàn)代的芯片設(shè)計里邊，工程師在優(yōu)化功耗和面積上無所不有其極，這里討論的multi-bit FF 就是其中的一種方法或者稱之為一種流程。

      2023-05-08 標(biāo)簽：芯片設(shè)計RTLDCT 2403 0

      簡述Vivado中的Elaborate的作用

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      在Vivado的界面中，有個RTL ANALYSIS->Open Elaborated Design的選項，可能很多工程師都沒有使用過。因為大家基...

      2023-05-05 標(biāo)簽：RTLdesignVivado 1614 0

      參數(shù)化RTL的驗證思路

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      參數(shù)化的代碼需要在靈活性和復(fù)雜性之間做出平衡，而且高度參數(shù)化代碼的驗證是一個非常具有挑戰(zhàn)性的工作。

      2023-05-05 標(biāo)簽：RTLUVMSVA 2273 0

      淺析芯片驗證中的scoreboard

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      在芯片驗證中，我們隨機(jī)發(fā)送數(shù)據(jù)激勵，同時使用scoreboard進(jìn)行數(shù)據(jù)完整性檢查。

      2023-05-04 標(biāo)簽：RTL芯片驗證 1439 0

      數(shù)字硬件建模SystemVerilog之Interface方法概述

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      SystemVerilog Interface是modport的一種，但比簡單的輸入、輸出或輸入輸出端口的功能更多。

      2023-04-28 標(biāo)簽：時鐘發(fā)生器RTLUVM 3438 0

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        廣東高云半導(dǎo)體科技股份有限公司提供編程設(shè)計軟件、IP核、參考設(shè)計、演示板等服務(wù)的完整FPGA芯片解決方案。
      • Zedboard
        Zedboard
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        ZedBoard是基于Xilinx Zynq?-7000擴(kuò)展式處理平臺（EPP）的低成本開發(fā)板。此板可以運行基于Linux，Android，Windows?或其他OS/ RTOS的設(shè)計。
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        I2S總線， 又稱 集成電路內(nèi)置音頻總線，是飛利浦公司為數(shù)字音頻設(shè)備之間的音頻數(shù)據(jù)傳輸而制定的一種總線標(biāo)準(zhǔn)，該總線專門用于音頻設(shè)備之間的數(shù)據(jù)傳輸，廣泛應(yīng)用于各種多媒體系統(tǒng)。
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        Samtec(申泰)公司是一家總部位于美國，致力于研發(fā)和生產(chǎn)高速數(shù)據(jù)通信連接器的供應(yīng)商，Samtec連接器使用100%液晶聚合物以及純磷青銅和鈹銅制造，擁有軍品級的技術(shù)參數(shù)，其產(chǎn)品包括各種通用標(biāo)準(zhǔn)的連接器以及通信線纜，并且為客戶提供解決方案。
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        HLS（HTTP Live Streaming）是Apple的動態(tài)碼率自適應(yīng)技術(shù)。主要用于PC和Apple終端的音視頻服務(wù)。包括一個m3u（8）的索引文件，TS媒體分片文件和key加密串文件。
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      • efpga
        efpga
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        eFPGA，全稱為嵌入式FPGA（Embedded FPGA），顧名思義是將類似于FPGA的可編程邏輯陣列“嵌入”到ASIC或SoC中。
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        TMS320C6416
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        數(shù)字秒表
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