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RTL在電子科學(xué)中指的是寄存器轉(zhuǎn)換級(jí)電路（Register Transfer Level）的縮寫(xiě)，也叫暫存器轉(zhuǎn)移層次。

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rtl技術(shù)

多路選擇器設(shè)計(jì)

組合邏輯電路的輸出信號(hào)只與當(dāng)前時(shí)刻的輸入信號(hào)有關(guān)，與其他時(shí)刻的輸入狀態(tài)無(wú)關(guān)，無(wú)存儲(chǔ)電路或反饋電路。

2023-05-22 標(biāo)簽：led燈 RTL 組合邏輯電路 2391 0

基于FPGA開(kāi)發(fā)板點(diǎn)亮LED燈

設(shè)計(jì)規(guī)劃--波形繪制--編寫(xiě)代碼--代碼編譯--編寫(xiě)testbench--對(duì)比波形--綁定管腳--全編譯--上板驗(yàn)證

2023-05-22 標(biāo)簽：led燈時(shí)序電路 RTL 1479 0

聊一聊FPGA中的IP都是怎么區(qū)分的呢？

現(xiàn)今的FPGA設(shè)計(jì)規(guī)模越來(lái)越龐大，功能越來(lái)越復(fù)雜，因此FPGA設(shè)計(jì)的每個(gè)部分都從頭開(kāi)始著手是不切實(shí)際的。

2023-05-22 標(biāo)簽：FPGA設(shè)計(jì)寄存器 EDA工具 2545 0

原來(lái)SpinalHDL中BlackBox封裝數(shù)組接口如此簡(jiǎn)單

當(dāng)在SpinalHDL中調(diào)用別人的RTL代碼時(shí)，需要采用BlackBox進(jìn)行封裝。對(duì)于大多數(shù)場(chǎng)景，想必小伙伴們都已輕車(chē)熟路。今天著重來(lái)看下當(dāng)RTL代碼的...

2023-05-22 標(biāo)簽：接口封裝 RTL 972 0

UVM Transaction-Level Modeling (TLM)概述

驗(yàn)證生產(chǎn)力的關(guān)鍵之一是在一個(gè)合適的抽象級(jí)別上考慮驗(yàn)證問(wèn)題。也就是說(shuō)，在驗(yàn)證DUT時(shí)應(yīng)該創(chuàng)建一個(gè)支持適當(dāng)抽象級(jí)別的驗(yàn)證環(huán)境。

2023-05-22 標(biāo)簽：RTL UVM TLM 1036 0

多片F(xiàn)PGA原型平臺(tái)中的啟動(dòng)同步研究

假如給定FPGA內(nèi)的時(shí)鐘沒(méi)有正確運(yùn)行，那么我們多片F(xiàn)PGA系統(tǒng)的整體將不能同時(shí)啟動(dòng)，這將有可能是致命的。

2023-05-22 標(biāo)簽：fpga 分頻器 pll 423 0

在高速設(shè)計(jì)中跨多個(gè)FPGA分配復(fù)位信號(hào)

SoC設(shè)計(jì)中通常會(huì)有“全局”同步復(fù)位，這將影響到整個(gè)設(shè)計(jì)中的大多數(shù)的時(shí)序設(shè)計(jì)模塊，并在同一時(shí)鐘沿同步釋放復(fù)位。

2023-05-18 標(biāo)簽：fpga SoC設(shè)計(jì)PAD 324 0

RAL寄存器模型操作圖鑒

寄存器模型操作，指的是通過(guò)寄存器模型對(duì)RTL中寄存器進(jìn)行讀寫(xiě)訪(fǎng)問(wèn)，或者同步寄存器模型與RTL中寄存器的值。

2023-05-17 標(biāo)簽：寄存器 RTL UVM 1242 0

從Verilog PLI到SystemVerilog DPI的演變過(guò)程

寫(xiě)過(guò)Verilog和systemverilog的人肯定都用過(guò)系統(tǒng)自定義的函數(shù)$display，這是預(yù)定好的，可以直接調(diào)用的功能。

2023-05-16 標(biāo)簽：Verilog C語(yǔ)言 RTL 1156 0

看一下多片F(xiàn)PGA原型驗(yàn)證系統(tǒng)的時(shí)鐘同步

SoC設(shè)計(jì)是一個(gè)整體的芯片設(shè)計(jì)，最終整個(gè)設(shè)計(jì)將在統(tǒng)一到一塊硅片上完成整個(gè)芯片

2023-05-16 標(biāo)簽：fpga 緩沖器 SoC設(shè)計(jì) 792 0

淺析Stream里的隱式轉(zhuǎn)換

Stream、Flow是在電路描述里經(jīng)常用到的對(duì)象。

2023-05-15 標(biāo)簽：RTL HDL語(yǔ)言 618 0

IC設(shè)計(jì)全流程和要用到的EDA工具介紹

設(shè)計(jì)一款芯片，明確需求（功能和性能）之后，先由架構(gòu)工程師設(shè)計(jì)架構(gòu)，得出芯片設(shè)計(jì)方案，前端設(shè)計(jì)工程師形成RTL代碼，驗(yàn)證工程師進(jìn)行代碼驗(yàn)證，再通過(guò)后端設(shè)計(jì)...

2023-05-12 標(biāo)簽：電源 IC設(shè)計(jì)eda 2139 0

如何通過(guò)Vivado Synthesis中的URAM矩陣自動(dòng)流水線(xiàn)化來(lái)實(shí)現(xiàn)最佳時(shí)序性能

UltraRAM 原語(yǔ)（也稱(chēng)為 URAM）可在 Xilinx UltraScale + 架構(gòu)中使用，而且可用來(lái)高效地實(shí)現(xiàn)大容量深存儲(chǔ)器。由于大小和性能方...

2023-05-08 標(biāo)簽：存儲(chǔ)器 Xilinx 流水線(xiàn) 2138 0

FPGA原型系統(tǒng)裝配文件：Assign Traces介紹

多片F(xiàn)PGA原型驗(yàn)證系統(tǒng)的拓?fù)溥B接方式各不相同，理想的多片F(xiàn)PGA原型驗(yàn)證系統(tǒng)應(yīng)該可以靈活配置，可以使用其相應(yīng)的EDA工具

2023-05-08 標(biāo)簽：FPGA設(shè)計(jì)連接器 EDA工具 636 0

芯片設(shè)計(jì)里的Multi-Bit FF方法討論

在現(xiàn)代的芯片設(shè)計(jì)里邊，工程師在優(yōu)化功耗和面積上無(wú)所不有其極，這里討論的multi-bit FF 就是其中的一種方法或者稱(chēng)之為一種流程。

2023-05-08 標(biāo)簽：芯片設(shè)計(jì)RTL DCT 2179 0

簡(jiǎn)述Vivado中的Elaborate的作用

在Vivado的界面中，有個(gè)RTL ANALYSIS->Open Elaborated Design的選項(xiàng)，可能很多工程師都沒(méi)有使用過(guò)。因?yàn)榇蠹一?..

2023-05-05 標(biāo)簽：RTL design Vivado 1500 0

參數(shù)化RTL的驗(yàn)證思路

參數(shù)化的代碼需要在靈活性和復(fù)雜性之間做出平衡，而且高度參數(shù)化代碼的驗(yàn)證是一個(gè)非常具有挑戰(zhàn)性的工作。

2023-05-05 標(biāo)簽：RTL UVM SVA 2053 0

淺析芯片驗(yàn)證中的scoreboard

在芯片驗(yàn)證中，我們隨機(jī)發(fā)送數(shù)據(jù)激勵(lì)，同時(shí)使用scoreboard進(jìn)行數(shù)據(jù)完整性檢查。

2023-05-04 標(biāo)簽：RTL 芯片驗(yàn)證 1276 0

數(shù)字硬件建模SystemVerilog之Interface方法概述

SystemVerilog Interface是modport的一種，但比簡(jiǎn)單的輸入、輸出或輸入輸出端口的功能更多。

2023-04-28 標(biāo)簽：時(shí)鐘發(fā)生器 RTL UVM 3245 0

芯片驗(yàn)證中的scoreboard分析

在芯片驗(yàn)證中，我們隨機(jī)發(fā)送數(shù)據(jù)激勵(lì)，同時(shí)使用scoreboard進(jìn)行數(shù)據(jù)完整性檢查。 scoreboard使用的關(guān)鍵在于如何啟動(dòng)檢查以及檢查的內(nèi)容...

2023-04-28 標(biāo)簽：數(shù)據(jù)RTL 芯片驗(yàn)證 1294 0

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廣東高云半導(dǎo)體科技股份有限公司提供編程設(shè)計(jì)軟件、IP核、參考設(shè)計(jì)、演示板等服務(wù)的完整FPGA芯片解決方案。
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ZedBoard是基于Xilinx Zynq?-7000擴(kuò)展式處理平臺(tái)（EPP）的低成本開(kāi)發(fā)板。此板可以運(yùn)行基于Linux，Android，Windows?或其他OS/ RTOS的設(shè)計(jì)。
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I2S總線(xiàn)，又稱(chēng) 集成電路內(nèi)置音頻總線(xiàn)，是飛利浦公司為數(shù)字音頻設(shè)備之間的音頻數(shù)據(jù)傳輸而制定的一種總線(xiàn)標(biāo)準(zhǔn)，該總線(xiàn)專(zhuān)門(mén)用于音頻設(shè)備之間的數(shù)據(jù)傳輸，廣泛應(yīng)用于各種多媒體系統(tǒng)。
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邏輯芯片又叫可編程邏輯器件，英文全稱(chēng)為：programmable logic device 即 PLD。PLD是做為一種通用集成電路產(chǎn)生的，他的邏輯功能按照用戶(hù)對(duì)器件編程來(lái)確定。一般的PLD的集成度很高，足以滿(mǎn)足設(shè)計(jì)一般的數(shù)字系統(tǒng)的需要。
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Samtec(申泰)公司是一家總部位于美國(guó)，致力于研發(fā)和生產(chǎn)高速數(shù)據(jù)通信連接器的供應(yīng)商，Samtec連接器使用100%液晶聚合物以及純磷青銅和鈹銅制造，擁有軍品級(jí)的技術(shù)參數(shù)，其產(chǎn)品包括各種通用標(biāo)準(zhǔn)的連接器以及通信線(xiàn)纜，并且為客戶(hù)提供解決方案。
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HLS（HTTP Live Streaming）是Apple的動(dòng)態(tài)碼率自適應(yīng)技術(shù)。主要用于PC和Apple終端的音視頻服務(wù)。包括一個(gè)m3u（8）的索引文件，TS媒體分片文件和key加密串文件。
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隨著物聯(lián)網(wǎng)技術(shù)的發(fā)展，搭載這一技術(shù)的家電也越來(lái)越多的出現(xiàn)，今年十分火熱的智能音箱就是物聯(lián)網(wǎng)技術(shù)和人工智能結(jié)合的代表，智能魔鏡這種基安防，終端，自動(dòng)化，人工智能的物聯(lián)網(wǎng)產(chǎn)品已經(jīng)成為了不可阻擋的趨勢(shì)，在未來(lái)，將更加全面、智能、便捷的走進(jìn)越來(lái)越多人們的生活。
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eFPGA，全稱(chēng)為嵌入式FPGA（Embedded FPGA），顧名思義是將類(lèi)似于FPGA的可編程邏輯陣列“嵌入”到ASIC或SoC中。
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