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vhdl語(yǔ)言

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VHDL 的英文全名是VHSIC Hardware Description Language（VHSIC硬件描述語(yǔ)言）。VHSIC是Very High Speed Integrated Circuit的縮寫，是20世紀(jì)80年代在美國(guó)國(guó)防部的資助下始創(chuàng)的，并最終導(dǎo)致了VHDL語(yǔ)言的出現(xiàn)。

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vhdl語(yǔ)言資訊

三人表決器：VHDL源代碼

--三人表決器(三種不同的描述方式) vhdl -- Three-input Majority Voter -- The entity declarat...

2012-05-18 標(biāo)簽：VHDL語(yǔ)言 VHDL源代碼三人表決器 2.2萬(wàn) 0

vhdl語(yǔ)言和c語(yǔ)言區(qū)別大嗎?差異性體現(xiàn)在哪兒

相信對(duì)vhdl語(yǔ)言和c語(yǔ)言區(qū)別也有了一定的了解，并且它們兩者之間的區(qū)別還是挺大的，下面我們?cè)敿?xì)細(xì)數(shù)一下它們的區(qū)別。

2017-11-09 標(biāo)簽：vhdl語(yǔ)言 c語(yǔ)言 2.1萬(wàn) 0

PLD設(shè)計(jì)速成（3）-采用VHDL設(shè)計(jì)輸入三人表決器

打開(kāi)MAX plusII,在開(kāi)始菜單內(nèi)選擇MAX PLUS II 項(xiàng)，開(kāi)始運(yùn)行MAX PLUS II(如下圖) 你最好把圖標(biāo)放到桌面上，以后直接雙擊MA...

2012-05-18 標(biāo)簽：VHDL語(yǔ)言 PLD芯片三人表決器 1.6萬(wàn) 0

PLD設(shè)計(jì)速成（4）-采用VerilogHDL輸入三人表決器

下面僅把和VHDL不同的詳細(xì)寫下，相同或基本相同的就一帶而過(guò)： (1)打開(kāi)MAX plusII (2)新建新建一個(gè)verilog-HDL文件(Text...

2012-05-18 標(biāo)簽：VHDL語(yǔ)言 PLD芯片三人表決器 1.5萬(wàn) 0

什么是vhdl語(yǔ)言_簡(jiǎn)述vhdl語(yǔ)言的特點(diǎn)

什么是vhdl語(yǔ)言 VHDL 的英文全名是VHSIC Hardware Description Language（VHSIC硬件描述語(yǔ)言）。VHSIC是...

2020-04-23 標(biāo)簽：VHDL語(yǔ)言 1.2萬(wàn) 0

PLD設(shè)計(jì)速成（2）-采用原理圖設(shè)計(jì)三人表決器

我們根據(jù)三人表決器的直值表，可以通過(guò) 卡諾圖化簡(jiǎn)可以得到： L2=SW1SW2 SW1SW3 SW2SW3 L1=_L2 那么我們可以在MAX plu...

2012-05-18 標(biāo)簽：VHDL語(yǔ)言 PLD芯片三人表決器 9735 0

簡(jiǎn)述BSDL邊界掃描語(yǔ)言，BSDL邊界掃描語(yǔ)言的應(yīng)用

BSDL邊界掃描語(yǔ)言的邊界掃描是一個(gè)完善的測(cè)試技術(shù)。邊界掃描在自當(dāng)聯(lián)合測(cè)試行動(dòng)組（JTAG）90年代初發(fā)明了一種解決方案來(lái)測(cè)試使用了許多新的印刷電路，...

2017-04-19 標(biāo)簽：vhdl語(yǔ)言 vhdl c++ 9058 0

基于VHDL語(yǔ)言的按鍵消抖電路設(shè)計(jì)及仿真

基于VHDL語(yǔ)言的按鍵消抖電路設(shè)計(jì)及仿真　按鍵開(kāi)關(guān)是電子設(shè)備實(shí)現(xiàn)人機(jī)對(duì)話的重要器件之一。由于大部分按鍵是機(jī)械觸點(diǎn)，在觸點(diǎn)閉合和斷開(kāi)時(shí)都會(huì)產(chǎn)生抖動(dòng)。為避免

2010-01-04 標(biāo)簽：VHDL語(yǔ)言按鍵消 6426 0

VHDL語(yǔ)言

一個(gè)完整的VHDL程序包括實(shí)體(Entity)，結(jié)構(gòu)體(Architecture)，配置(Configuration)，包集合(Package)，庫(kù)(L...

2022-11-09 標(biāo)簽：VHDL語(yǔ)言 5442 0

vhdl語(yǔ)言怎么仿真_vhdl語(yǔ)言的基本結(jié)構(gòu)

在VHDL程序中，實(shí)體（ENTITY）和結(jié)構(gòu)體（ARCHITECTURE）這兩個(gè)基本結(jié)構(gòu)是必須的，他們可以構(gòu)成最簡(jiǎn)單的VHDL程序。通常，最簡(jiǎn)單的VHD...

2020-04-23 標(biāo)簽：VHDL語(yǔ)言 4874 0

PLD設(shè)計(jì)速成（6）-編譯和布線

我們先要指定所用芯片的型號(hào)，菜單：Assign-Device 如下圖將彈出一窗口 (注意把show only fastest speed grade...

2012-05-18 標(biāo)簽：VHDL語(yǔ)言 PLD芯片三人表決器 3419 0

vhdl語(yǔ)言的操作符_vhdl語(yǔ)言有什么用

VHDL是一種用來(lái)描述數(shù)字邏輯系統(tǒng)的“編程語(yǔ)言”。它通過(guò)對(duì)硬件行為的直接描述來(lái)實(shí)現(xiàn)對(duì)硬件的物理實(shí)現(xiàn)，代表了當(dāng)今硬件設(shè)計(jì)的發(fā)展方向。VHDL是為了滿足邏輯...

2020-04-23 標(biāo)簽：VHDL語(yǔ)言 3185 0

PLD設(shè)計(jì)速成（7）-安裝下載電纜的驅(qū)動(dòng)程序

MAX plusII 軟件的驅(qū)動(dòng)設(shè)置在Win98下運(yùn)行MAX plusII可以自動(dòng)檢測(cè)到ByteBlasterMV(ByteBlaster)下載電纜，...

2012-05-18 標(biāo)簽：VHDL語(yǔ)言 PLD芯片三人表決器 2928 0

VHDL并行語(yǔ)句（生成語(yǔ)句）使用練習(xí)

實(shí)驗(yàn)七、VHDL并行語(yǔ)句（生成語(yǔ)句）使用練習(xí)一? 實(shí)驗(yàn)?zāi)康?掌握VHDL語(yǔ)言的基本描述語(yǔ)句的使用方法。2掌握VHDL語(yǔ)言的生成語(yǔ)句的使用方法。二? 實(shí)

2009-03-13 標(biāo)簽：VHDL語(yǔ)言 VHDL 2823 0

VHDL語(yǔ)言的組合電路設(shè)計(jì)

實(shí)驗(yàn)八、VHDL語(yǔ)言的組合電路設(shè)計(jì)一? 實(shí)驗(yàn)?zāi)康?掌握VHDL語(yǔ)言的基本結(jié)構(gòu)及設(shè)計(jì)的輸入方法。2掌握VHDL語(yǔ)言的組合電路設(shè)計(jì)方法。二? 實(shí)驗(yàn)設(shè)備與儀器

2009-03-13 標(biāo)簽：VHDL語(yǔ)言 VHDL 2753 0

PLD設(shè)計(jì)速成（8）-下載驗(yàn)證

( 注意：本次實(shí)驗(yàn)采用的JX002B實(shí)驗(yàn)板已經(jīng)將下載電纜的電路都做在了實(shí)驗(yàn)板上，所以只需要一根并口延長(zhǎng)線即可，實(shí)際使用中一般都使用標(biāo)準(zhǔn)的下載電纜(Byt...

2012-05-18 標(biāo)簽：VHDL語(yǔ)言 PLD芯片三人表決器 2549 0

通過(guò)實(shí)例,走近PLD

電子發(fā)燒友網(wǎng)： PLD設(shè)計(jì)，相信對(duì)很多人而言都不陌生。當(dāng)然也有對(duì)它不是那么了解的人，那么即使你沒(méi)有深入接觸過(guò)PLD，我們也可以讓你可以在短短的幾十分鐘內(nèi)...

2012-06-08 標(biāo)簽：VHDL語(yǔ)言 FPGA芯片 2436 0

基于VHDL的99小時(shí)定時(shí)器設(shè)計(jì)及實(shí)現(xiàn)

傳統(tǒng)的定時(shí)器硬件連接比較復(fù)雜，可靠性差，而且計(jì)時(shí)時(shí)間短，難以滿足需要。本設(shè)計(jì)采用可編程芯片和VHDL語(yǔ)言進(jìn)行軟硬件設(shè)計(jì)

2010-06-14 標(biāo)簽：LED VHDL語(yǔ)言定時(shí)器 2371 0

VHDL語(yǔ)言應(yīng)用實(shí)例指導(dǎo)

VHDL語(yǔ)言應(yīng)用實(shí)例指導(dǎo) VHDL中的標(biāo)識(shí)符可以是常數(shù)、變量、信號(hào)、端口、子程序或參數(shù)的名字。使用標(biāo)識(shí)符要遵守如下法則

2009-03-20 標(biāo)簽：VHDL語(yǔ)言 2245 0

VHDL的基本描述語(yǔ)句設(shè)計(jì)

實(shí)驗(yàn)六、VHDL的基本描述語(yǔ)句設(shè)計(jì)一? 實(shí)驗(yàn)?zāi)康?掌握VHDL語(yǔ)言的基本結(jié)構(gòu)及設(shè)計(jì)的輸入方法。2掌握VHDL語(yǔ)言的基本描述語(yǔ)句的使用方法。二? 實(shí)驗(yàn)設(shè)備

2009-03-13 標(biāo)簽：VHDL語(yǔ)言 VHDL 2229 0

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Protues

Protues

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Proteus軟件是英國(guó)Lab Center Electronics公司出版的EDA工具軟件（該軟件中國(guó)總代理為廣州風(fēng)標(biāo)電子技術(shù)有限公司）。它不僅具有其它EDA工具軟件的仿真功能，還能仿真單片機(jī)及外圍器件。
靜電防護(hù)

靜電防護(hù)

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為防止靜電積累所引起的人身電擊、火災(zāi)和爆炸、電子器件失效和損壞，以及對(duì)生產(chǎn)的不良影響而采取的防范措施。其防范原則主要是抑制靜電的產(chǎn)生，加速靜電泄漏，進(jìn)行靜電中和等。
Altium Designer

Altium Designer

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FPGA芯片

FPGA芯片

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FPGA（Field－Programmable Gate Array），即現(xiàn)場(chǎng)可編程門陣列，它是在PAL、GAL、CPLD等可編程器件的基礎(chǔ)上進(jìn)一步發(fā)展的產(chǎn)物。
ArduBlock

ArduBlock

+關(guān)注

ArduBlock軟件是Arduino官方編程環(huán)境的第三方軟件，目前必須依附于Arduino軟件下運(yùn)行，區(qū)別于Arduino文本式編程環(huán)境，ArduBlock是以圖形化積木搭建的方式編程的，這樣的方式會(huì)使編程的可視化和交互性加強(qiáng)，編程門檻降低，即使沒(méi)有編程經(jīng)驗(yàn)的人也可以嘗試給Arduino控制器編寫程序。
AD10

AD10

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識(shí)別

識(shí)別

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FPGA開(kāi)發(fā)板

FPGA開(kāi)發(fā)板

+關(guān)注

FPGA開(kāi)發(fā)板在基于MCU、定制ASIC和體積龐大的電線束來(lái)實(shí)現(xiàn)引擎及控制電子的系統(tǒng)方案已發(fā)展至接近其技術(shù)和應(yīng)用極限，汽車工業(yè)正面臨新的設(shè)計(jì)挑戰(zhàn)。過(guò)去汽車電子產(chǎn)品的開(kāi)發(fā)周期是漫長(zhǎng)的，而許多汽車制造商現(xiàn)正致力于在更短的時(shí)間內(nèi)，裝備消費(fèi)者所需的新一代汽車。
PCB封裝

PCB封裝

+關(guān)注

pcb封裝就是把實(shí)際的電子元器件，芯片等的各種參數(shù)（比如元器件的大小，長(zhǎng)寬，直插，貼片，焊盤的大小，管腳的長(zhǎng)寬，管腳的間距等）用圖形方式表現(xiàn)出來(lái)，以便可以在畫pcb圖時(shí)進(jìn)行調(diào)用。
QUARTUS II

QUARTUS II

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Quartus II 是Altera公司推出的綜合性CPLD/FPGA開(kāi)發(fā)軟件，軟件支持原理圖、VHDL、VerilogHDL以及AHDL（Altera Hardware 支持Description Language）等多種設(shè)計(jì)輸入形式，內(nèi)嵌自有的綜合器以及仿真器，可以完成從設(shè)計(jì)輸入到硬件配置的完整PLD設(shè)計(jì)流程。
語(yǔ)音交互

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PCB封裝庫(kù)

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AD09

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PDN

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QuickPcb

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Artix-7

Artix-7

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　　Artix-7 系列：相對(duì)于 Spartan-6 系列而言，Artix-7 系列功耗降低了一半，成本降低了 35%，采用小型化封裝、統(tǒng)一的 Virtex 系列架構(gòu)，能滿足低成本大批量市場(chǎng)的性能要求，這也正是此前 ASSP、ASIC 和低成本 FPGA 所針對(duì)的市場(chǎng)領(lǐng)域。
VHDL代碼

VHDL代碼

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Protel 99 se

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powerlink

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candence

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面包板

面包板

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面包板是由于板子上有很多小插孔，專為電子電路的無(wú)焊接實(shí)驗(yàn)設(shè)計(jì)制造的。由于各種電子元器件可根據(jù)需要隨意插入或拔出，免去了焊接，節(jié)省了電路的組裝時(shí)間，而且元件可以重復(fù)使用，所以非常適合電子電路的組裝、調(diào)試和訓(xùn)練。
AXI

AXI

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AXI是一種總線協(xié)議，該協(xié)議是ARM公司提出的AMBA3.0協(xié)議中最重要的部分，是一種面向高性能、高帶寬、低延遲的片內(nèi)總線。它的地址/控制和數(shù)據(jù)相位是分離的，支持不對(duì)齊的數(shù)據(jù)傳輸，同時(shí)在突發(fā)傳輸中，只需要首地址，同時(shí)分離的讀寫數(shù)據(jù)通道、并支持Outstanding傳輸訪問(wèn)和亂序訪問(wèn)，并更加容易進(jìn)行時(shí)序收斂。AXI是AMBA中一個(gè)新的高性能協(xié)議。
特性阻抗

特性阻抗

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特性阻抗又稱特征阻抗，它不是直流電阻，屬于長(zhǎng)線傳輸中的概念。特性阻抗是射頻傳輸線影響無(wú)線電波電壓、電流的幅值和相位變化的固有特性，等于各處的電壓與電流的比值，用V/I表示。在射頻電路中，電阻、電容、電感都會(huì)阻礙交變電流的流動(dòng)，合稱阻抗。電阻是吸收電磁能量的，理想電容和電感不消耗電磁能量。
時(shí)鐘源

時(shí)鐘源

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時(shí)鐘源用來(lái)為環(huán)形脈沖發(fā)生器提供頻率穩(wěn)定且電平匹配的方波時(shí)鐘脈沖信號(hào)。它通常由石英晶體振蕩器和與非門組成的正反饋振蕩電路組成，其輸出送至環(huán)形脈沖發(fā)生器。
AD采樣

AD采樣

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　　AD轉(zhuǎn)換采樣頻率指完成一次從模擬轉(zhuǎn)換到數(shù)字的AD轉(zhuǎn)換所需時(shí)間的倒數(shù)，模擬量可以是電壓、電流等電信號(hào)，也可以是壓力、溫度、濕度、位移、聲音等非電信號(hào)；而AD分辨率指數(shù)字量變化一個(gè)最小量時(shí)模擬信號(hào)的變化量。
驅(qū)動(dòng)電流

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Kintex-7

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　　Kintex-7系列：Kintex-7 系列是一種新型 FPGA，能以不到 Virtex-6 系列一半的價(jià)格實(shí)現(xiàn)與其相當(dāng)性能，性價(jià)比提高了一倍，功耗降低了一半。
Protel DXP

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FPGA教程

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紅外觸摸屏

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