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Xilinx是全球領(lǐng)先的可編程邏輯完整解決方案的供應(yīng)商。Xilinx研發(fā)、制造并銷售范圍廣泛的高級(jí)集成電路、軟件設(shè)計(jì)工具以及作為預(yù)定義系統(tǒng)級(jí)功能的IP(Intellectual Property)核。
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RGB Spectrum 是尖端視頻/圖形處理器和決策支持系統(tǒng)的領(lǐng)先廠商,為計(jì)算機(jī)及視頻信號(hào)的顯示,記錄和傳輸提供創(chuàng)新解決方案。公司產(chǎn)品包括多顯示器,視...
一款Xilinx FPGA的CNN加速器IP—AIScale
隨著人工智能(AI)的不斷發(fā)展,它已經(jīng)從早期的人工特征工程進(jìn)化到現(xiàn)在可以從海量數(shù)據(jù)中學(xué)習(xí),機(jī)器視覺、語音識(shí)別以及自然語言處理等領(lǐng)域都取得了重大突破。CN...
FDRE代表一個(gè)單D型觸發(fā)器,含的有五個(gè)信號(hào)分別為: 數(shù)據(jù)(data,D)、時(shí)鐘使能(Clock enable,CE)、時(shí)鐘(Clock)、同步復(fù)位(...
Zynq-7000可擴(kuò)展處理平臺(tái)的詳細(xì)介紹
在2011 ARM Techcon上,來自Xilinx 的高級(jí)經(jīng)理Stephane為我們?cè)敿?xì)介紹了Zynq-7000可擴(kuò)展處理平臺(tái)。此平臺(tái)將雙ARM c...
Xilinx Zynq系統(tǒng)如何實(shí)現(xiàn)IEEE1588協(xié)議
IEEE1588/PTP 協(xié)議是實(shí)時(shí)工業(yè)軟件的一個(gè)重要的協(xié)議,本博文討論該協(xié)議在Xilinx Zynq 系統(tǒng)·上如何實(shí)現(xiàn)IEEE1588 協(xié)議。
基于ZYNQ7000的交叉編譯工具鏈Q(jìng)t+OpenCV+ffmpeg等庫支持總結(jié)
最近剛剛接觸XILINX的ZYNQ板,剛接觸沒有十天。XILINX定位它為SOC,我也很認(rèn)同,起碼比TI定位MPU為SOC強(qiáng)很多。
在FPGA芯片生產(chǎn)的時(shí)候就已經(jīng)寫死在芯片的eFuse寄存器中,具有不可修改的屬性,因?yàn)槭褂玫氖侨蹟嗉夹g(shù)。
基于PCIE(mcap)的部分可重構(gòu)實(shí)現(xiàn)方案
本博文主要是對(duì)基于PCIE(mcap)的部分可重構(gòu)實(shí)現(xiàn)的步驟做一個(gè)簡(jiǎn)單的演示,如有錯(cuò)誤之處,歡迎批評(píng)指正。值得說明的是,基于PCIE的部分可重構(gòu)需在ul...
全球第一款28nm產(chǎn)品— Kintex-7 FPGA的 10Gbps 眼圖演示
Kintex-7 器件將同賽靈思 ISE? 13 設(shè)計(jì)套件、AMBA? 4 高級(jí)可擴(kuò)展接口 (AXI?)總線協(xié)議兼容 IP 和目標(biāo)參考設(shè)計(jì)一并提供,所有...
Xilinx推出新品小型產(chǎn)品的Artix-7 FPGA,我們將為大家講述:Artix-7 功耗優(yōu)勢(shì)演示。
Xilinx DPD 解決方案使用經(jīng)驗(yàn)(四)
Xilinx DPD 解決方案的Microblaze每執(zhí)行一次Control_mode(通俗的講,就是命令),都會(huì)返回一個(gè)CommandStatus.
為何要選擇Zynq-7000 All Programmable SoC
Zynq-7000 AP SoC作為業(yè)界第一款SoC產(chǎn)品,完美集成了雙核ARM Cortex-A9處理器與賽靈思28 nm FPGA。本視頻向您展示了Z...
Xilinx 7FPGA XADC如何獲取模擬信號(hào)的信息
Xilinx 7系列FPGA全系內(nèi)置了一個(gè)ADC,稱呼為XADC。 這個(gè)XADC,內(nèi)部是兩個(gè)1mbps的ADC,可以采集模擬信號(hào)轉(zhuǎn)為數(shù)字信號(hào)送給FPGA...
【PlanAhead教程】-6 IO Pin Planning
教您如使用PlanAhead 13.1進(jìn)行設(shè)計(jì)應(yīng)用,通過一個(gè)設(shè)計(jì)程序,來體驗(yàn)PlanAhead的功能強(qiáng)大
手把手教你動(dòng)態(tài)編輯Xilinx FPGA內(nèi)LUT內(nèi)容
在7系列FPGA中,將近2/3的SLICE是SLICEL,其余的是SLICEM[1],也就是說,F(xiàn)PGA內(nèi)2/3的資源在bitstream文件下載后,其...
CLB是xilinx基本邏輯單元,每個(gè)CLB包含兩個(gè)slices,每個(gè)slices由4個(gè)(A,B,C,D)6輸入LUT和8個(gè)寄存器組成。
Xilinx Floating-Point 浮點(diǎn)IP加減法的仿真驗(yàn)證案例
作者:OpenSLee 1、float IP的創(chuàng)建 搜索float雙擊Floating-point 1 Operation Selection 我們這里...
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