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如果PCB上線條的厚度增大或者寬度增加，單位長(zhǎng)度電容增加，特性阻抗就變小。同樣，走線和返回平面間距離減小，電容增大，特性阻抗也減小。...
1. 由于電源電壓和相關(guān)的邏輯電路門限降低了- 1伏不是常見(jiàn)的電壓，但卻可以減少噪音。特別是處理器和大電流密度的設(shè)備會(huì)吸引幾安培的電源電流的情況下。 2. LVDS 和千兆位以太網(wǎng)都含有DC端接傳輸線跡線阻抗過(guò)高會(huì)導(dǎo)致接收器產(chǎn)生常見(jiàn)的模式問(wèn)題。 3. 精密跡線串聯(lián)會(huì)使信號(hào)大幅衰減 ...
在基于信號(hào)完整性計(jì)算機(jī)分析的PCB設(shè)計(jì)方法中，最為核心的部分就是pcb板級(jí)信號(hào)完整性模型的建立，這是與傳統(tǒng)的設(shè)計(jì)方法的區(qū)別之處。SI模型的正確性將決定設(shè)計(jì)的正確性，而SI模型的可建立性則決定了這種設(shè)計(jì)方法的可行性。...
信號(hào)完整性的問(wèn)題主要包括傳輸線效應(yīng)，如反射、時(shí)延、振鈴、信號(hào)的過(guò)程與下沖以及信號(hào)之間的串?dāng)_等，涉及傳輸線上的信號(hào)質(zhì)量及信號(hào)定時(shí)的準(zhǔn)確性。 良好的信號(hào)質(zhì)量是確保穩(wěn)定時(shí)序的關(guān)鍵。由于反射和串?dāng)_造成的信號(hào)質(zhì)量問(wèn)題都很可能帶來(lái)時(shí)序的偏移和紊亂。例如，串?dāng)_會(huì)影響信號(hào)的傳播延遲，導(dǎo)致在時(shí)鐘的上升沿或下降沿...
信號(hào)完整性主要有反射、振鈴、地彈和串?dāng)_等現(xiàn)象。PCB板上的走線可等效為圖1所示的串聯(lián)和并聯(lián)的電容、電阻和電感結(jié)構(gòu)。串聯(lián)電阻的典型值0.25D.／R-4）。55DJft，并聯(lián)電阻阻值通常很高。將寄生電阻、電容和電感加到實(shí)際的PCB連線中之后，連線上的最終阻抗稱為特征阻抗zo。...
需要注意的是，具體設(shè)計(jì)時(shí)，若利用Orcad進(jìn)行電路前期設(shè)計(jì)，則必須將Orcad生成的文件轉(zhuǎn)換為APD軟件的mcm文件。但由于轉(zhuǎn)換后的mcm文件存在類似brd的問(wèn)題，因此，采用Concept HDL軟件來(lái)導(dǎo)出網(wǎng)表文件，然后提取網(wǎng)線拓?fù)浣Y(jié)構(gòu)進(jìn)行仿真。為減少仿真時(shí)間，采用分模塊仿真方法。...
第一步是盡量減少通孔根的長(zhǎng)度。作為一個(gè)經(jīng)驗(yàn)法則，通孔根的長(zhǎng)度，以密耳為單位，應(yīng)小于300 mils/BR，Br是Gbps的速率。 第二個(gè)步驟是將孔路徑中的穿透部分使其接近線的阻抗，通常為100歐姆。不同導(dǎo)通孔的阻抗差通常都低于100歐姆，因此，在可能的情況下，盡量減少其直徑，增加間距，清孔，增...
隨著數(shù)據(jù)通信速度提高到3Gbps以上，信號(hào)完整性對(duì)于數(shù)據(jù)傳輸?shù)捻樌M(jìn)行至關(guān)重要。電路板設(shè)計(jì)人員試圖消除高速信號(hào)路徑上的每一個(gè)阻抗失配，因?yàn)檫@些阻抗失配會(huì)產(chǎn)生信號(hào)抖動(dòng)并降低數(shù)據(jù)眼的張開程度——從而不僅縮短數(shù)據(jù)傳輸?shù)淖畲缶嚯x，而且還將諸如SONET（同步光網(wǎng)絡(luò)）或XAUI（10Gb附屬單元接口）等通用抖...
華為的PI仿真初期與cadence也有著很緊密的聯(lián)系。SQPI是陳蘭兵在CADENCE主導(dǎo)開發(fā)的一個(gè)項(xiàng)目并選華為作為試用客戶，經(jīng)過(guò)華為內(nèi)部的優(yōu)化及各種關(guān)鍵技術(shù)的鉆研，最后華為成功應(yīng)用了SQPI，可惜CADENCE就缺少最后一步?jīng)]有把這個(gè)軟件大面積推廣開來(lái)，也許是算法上對(duì)單板一些特殊的情況沒(méi)有處理好，...
DDR3內(nèi)存與DDR2內(nèi)存相似包含控制器和存儲(chǔ)器2個(gè)部分，都采用源同步時(shí)序，即選通信號(hào)(時(shí)鐘)不是獨(dú)立的時(shí)鐘源發(fā)送，而是由驅(qū)動(dòng)芯片發(fā)送。它比DR2有更高的數(shù)據(jù)傳輸率，最高可達(dá)1866Mbps；DDR3還采用8位預(yù)取技術(shù)，明顯提高了存儲(chǔ)帶寬；其工作電壓為1.5V，保證相同頻率下功耗更低。...
對(duì)于電源噪聲的起因我們通過(guò)一個(gè)與非門電路圖進(jìn)行分析。圖1中的電路圖為一個(gè)三輸入與非門的結(jié)構(gòu)圖，因?yàn)榕c非門屬于數(shù)字器件，它是通過(guò)“1”和“0”電平的切換來(lái)工作的。隨著IC技術(shù)的不斷提高，數(shù)字器件的切換速度也越來(lái)越快，這就引進(jìn)了更多的高頻分量，同時(shí)回路中的電感在高頻下就很容易引起電源波動(dòng)。...
氨基磺酸鎳廣泛用來(lái)作為金屬化孔電鍍和印制插頭接觸片上的襯底鍍層。所獲得的淀積層的內(nèi)應(yīng)力低、硬度高，且具有極為優(yōu)越的延展性。將一種去應(yīng)力劑加入鍍液中，所得到的鍍層將稍有一點(diǎn)應(yīng)力。有多種不同配方的氨基磺酸鹽鍍液，典型的氨基磺酸鎳鍍液配方如下表。由于鍍層的應(yīng)力低，所以獲得廣泛的應(yīng)用，但氨基磺酸鎳穩(wěn)定性差，...
因此如果疊加足夠多的諧波，我們就可以近似的合成出方波。圖2是疊加到217次諧波后的波形。已經(jīng)非常近似方波了，不用關(guān)心角上的那些毛刺，那是著名的吉博斯現(xiàn)象，這種仿真必然會(huì)有的，但不影響對(duì)問(wèn)題的理解。這里我們疊加諧波的最高頻率達(dá)到了21.7GHz。...
理解臨界長(zhǎng)度的最好方法就是從時(shí)間角度來(lái)分析。信號(hào)在pcb走線上傳輸需要一定的時(shí)間，普通FR4板材上傳輸時(shí)間約為每納秒6英寸，當(dāng)然表層走線和內(nèi)層走線速度稍有差別。當(dāng)走線上存在阻抗突變就會(huì)發(fā)生信號(hào)反射，這和走線長(zhǎng)度無(wú)關(guān)。但是，如果走線很短，在源端信號(hào)還沒(méi)上升到高電平時(shí)，反射信號(hào)就已經(jīng)回到源端，那么發(fā)射信...
STAR WANG是個(gè)很有激情及想法的人，他總會(huì)給人正能量。項(xiàng)目從開始的“自動(dòng)布線”最后演變?yōu)椤耙?guī)則驅(qū)動(dòng)設(shè)計(jì)”的理念與他有很大的關(guān)系。那時(shí)候部門的學(xué)習(xí)研究風(fēng)氣很盛，并且也是出成果最多的時(shí)候，部門進(jìn)來(lái)的人要本科以上，PCB設(shè)計(jì)水平從那個(gè)時(shí)候起，經(jīng)過(guò)多年的積累及共享，互連的設(shè)計(jì)仿真水平進(jìn)入了一個(gè)快速上升...
信號(hào)上升時(shí)間并不是信號(hào)從低電平上升到高電平所經(jīng)歷的時(shí)間，而是其中的一部分。業(yè)界對(duì)它的定義尚未統(tǒng)一，最好的辦法就是跟隨上游的芯片廠商的定義，畢竟這些巨頭有話語(yǔ)權(quán)。通常有兩種：第一種定義為10-90上升時(shí)間，即信號(hào)從高電平的10%上升到90%所經(jīng)歷的時(shí)間。另一種是20-80上升時(shí)間，即信號(hào)從高電平的20...
設(shè)計(jì)RF電路時(shí)，電源電路的設(shè)計(jì)和電路板布局常常被留到了高頻信號(hào)通路的設(shè)計(jì)完成之后。對(duì)于沒(méi)有經(jīng)過(guò)認(rèn)真考慮的設(shè)計(jì)，電路周圍的電源電壓很容易產(chǎn)生錯(cuò)誤的輸出和噪聲，這會(huì)進(jìn)一步影響到RF電路的性能。合理分配PCB的板層、采用星型拓?fù)涞腣cc引線，并在Vcc引腳加上適當(dāng)?shù)娜ヱ铍娙?，將有助于改善系統(tǒng)的性能，獲得最...
無(wú)線信號(hào)是如今的許多嵌入式系統(tǒng)中必備的部分，移動(dòng)終端的制造商正在討論媒體匯聚，消費(fèi)者可以在筆記本、移動(dòng)電話、便攜式數(shù)字電視或者PDA進(jìn)行網(wǎng)頁(yè)瀏覽或者觀看賽事實(shí)況。...
處理高速電子系統(tǒng)的信號(hào)完整性問(wèn)題一直是比較難于處理的，特別是越來(lái)越多的芯片的工作頻率超過(guò)了100 MHz，信號(hào)的邊沿越來(lái)越陡（已達(dá)到ps級(jí)） ，這些高速器件性能的提高更增加了系統(tǒng)設(shè)計(jì)的難度。同時(shí)，高速系統(tǒng)的體積不斷減小使得PCB板的密度迅速提高。信號(hào)完整性問(wèn)題已經(jīng)成為新一代高速產(chǎn)品設(shè)計(jì)中越來(lái)越值得注...
飛針測(cè)試是一個(gè)檢查PCB電性功能的方法（開短路測(cè)試）之一。飛測(cè)試機(jī)是一個(gè)在制造環(huán)境測(cè)試PCB的系統(tǒng)。不是使用在傳統(tǒng)的在線測(cè)試機(jī)上所有的傳統(tǒng)針床（bed-of-nails）界面，飛針測(cè)試使用四到八個(gè)獨(dú)立控制的探針，移動(dòng)到測(cè)試中的元件。在測(cè)單元（UUT， unit under test）通過(guò)皮帶或者其它...
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