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傳統(tǒng)的數(shù)據(jù)鏈存在著誤碼率高、衰落大、干擾嚴(yán)重等問題，即使采用高效的信息壓縮編碼技術(shù)仍難以滿足高光譜、激光雷達(dá)、合成孔徑雷達(dá)等一系列高分載荷數(shù)據(jù)傳輸?shù)膸捯?。針對現(xiàn)有技術(shù)的不足，本設(shè)計中通過引進(jìn)美軍成熟先進(jìn)的VPX總線，構(gòu)建新一代的數(shù)據(jù)通信平臺，實現(xiàn)由傳統(tǒng)到高速、寬帶、多功能、通用性強的通信平臺的跨...
西安某汽車電子有限公司生產(chǎn)的XLM油泵支架產(chǎn) 品功能測試臺設(shè)計中，有一項針對高度阻值（TSG）的 功能測試。該測試內(nèi)容要求阻值電壓采樣與液位高度進(jìn) 行一一對應(yīng)。使用傳統(tǒng)的采集方式難以保證采集的可靠 性?；柙撛O(shè)計要求，本文提出了一種采用LabVIEW FPGA的數(shù)據(jù)傳輸技術(shù)，該技術(shù)能夠在高速采樣的前...
FPGA是一種集成電路，包含許多（64至10，000多個）相同的邏輯單元，可以將它們視為標(biāo)準(zhǔn)組件。每個邏輯單元可以獨立承擔(dān)一組有限的個性中的任何一個。單個單元通過電線矩陣互連和可編程開關(guān)。通過為每個單元指定簡單的邏輯功能并有選擇地閉合互連矩陣中的開關(guān)來實現(xiàn)用戶的設(shè)計，通過將這些基本模塊組合以創(chuàng)建...
目前微電子技術(shù)已經(jīng)發(fā)展到 SOC 階段，即集成系統(tǒng)（Integrated System）階段，相對于集成電路（IC）的設(shè)計思想有著革命性的變化。SOC 是一個復(fù)雜的系統(tǒng)，它將一個完整產(chǎn)品的功能集成在一個芯片上，包括核心處理器、存儲單元、硬件加速單元以及眾多的外部設(shè)備接口等，具有設(shè)計周期長、實現(xiàn)成本高...
通常情況下，時鐘的分頻在FPGA設(shè)計中占有重要的地位，在此就簡單列出分頻電路設(shè)計的思考思路。...
液晶顯示已成為目前平板電視與計算機顯示終端的主流，液晶顯示器的研究設(shè)計、生產(chǎn)、檢驗等部門甚至消費者需要用一些定量或定性的方法和指標(biāo)去檢驗液晶顯示器的質(zhì)量和特性。...
通用異步收發(fā)器（Universal Asynchronous Receiver／Transmitter，UART）可以和各種標(biāo)準(zhǔn)串行接口，如RS232和RS485等進(jìn)行全雙工異步通信，具有傳輸距離遠(yuǎn)、成本低、可靠性高等優(yōu)點。一般UART由專用芯片來實現(xiàn)，但專用芯片引腳都較多，內(nèi)含許多輔助功能，在實際...
在嵌入式系統(tǒng)或移動設(shè)備上使用SD卡，接口的構(gòu)建和文件系統(tǒng)實現(xiàn)是必須解決的問題。本文探討在CycloneII平臺為基礎(chǔ)的嵌入式系統(tǒng)上，實現(xiàn)SD卡接口和文件系統(tǒng)的實現(xiàn)方法。...
隨著高速數(shù)字系統(tǒng)的發(fā)展，高速串行數(shù)據(jù)被廣泛使用，內(nèi)嵌高速串行接口的FPGA也得到大量應(yīng)用，相應(yīng)的高速串行信號質(zhì)量的測試也越來越頻繁和重要。通常用示波器觀察信號波形、眼圖、抖動來衡量信號的質(zhì)量，Xilinx提供的IBERT（Integrated Bit Error Ratio Tester）作為一種高...
在這種方法中面積的復(fù)制可以換取速度的提高。支持的速度越高，就意味著可以實現(xiàn)更高的產(chǎn)品性能。一些注重產(chǎn)品性能的應(yīng)用領(lǐng)域可以采用并行處理技術(shù)，實現(xiàn)面積換速度。...
近幾年來，由于現(xiàn)場可編程門陣列（FPGA）的使用非常靈活，又可以無限次的編程，已受到越來越多的電子編程者的喜愛，很多朋友都想學(xué)習(xí)一些FPGA入門知識準(zhǔn)備進(jìn)行這個行業(yè)，現(xiàn)在關(guān)于FPGA入門知識的書籍、論壇、教程等種類繁多各式各樣。下面筆者也通過搜尋一些關(guān)于FPGA入門知識的資料供大家學(xué)習(xí)和參考。...
與處理器不同，F(xiàn)PGA本質(zhì)上是真正并行的，因此不同的處理操作不必爭奪相同的資源。每個獨立的處理任務(wù)都分配給芯片的專用部分，并且可以自主運行，而不受其他邏輯塊的影響。因此，當(dāng)您添加更多處理時，應(yīng)用程序一部分的性能不會受到影響。...
本文為您分享基于C66x+FPGA的SRIO開發(fā)視頻教程，適用于創(chuàng)龍TMS320C6678、TMS320C665x、Kintex-7、Artix-7平臺。...
在進(jìn)行硬件單元電路設(shè)計時，必須明確對各單元電路的具體要求，詳細(xì)擬定出單元電路的性能指標(biāo)，認(rèn)真考慮各單元電路之間的相互聯(lián)系，注意前后級單元電路之間信號的傳遞方式和匹配。...
時間數(shù)字轉(zhuǎn)換（tdc）技術(shù)原本是實驗核物理中的課題，隨著科學(xué)技術(shù)的不斷發(fā)展，精密時間測量數(shù)字化技術(shù)在高能物理、雷達(dá)、激光和聲納測距、通信測向、遙感成像等都應(yīng)用了高分辨率的tdc技術(shù)，全數(shù)字集成電路的工藝簡單，造價較低，設(shè)計難度較小，是電路設(shè)計人員追求的目標(biāo)，因此，全數(shù)字的tdc也成為研究人員關(guān)注的問...
在數(shù)字系統(tǒng)設(shè)計中，根據(jù)不同的設(shè)計需要，經(jīng)常會遇到偶數(shù)分頻、奇數(shù)分頻、半整數(shù)分頻等，有的還要求等占空比。在基于cpld（復(fù)雜可編程邏輯器件）的數(shù)字系統(tǒng)設(shè)計中，很容易實現(xiàn)由計數(shù)器或其級聯(lián)構(gòu)成各種形式的偶數(shù)分頻及非等占空比的奇數(shù)分頻，但對等占空比的奇數(shù)分頻及半整數(shù)分頻的實現(xiàn)較為困難。...
時鐘是整個電路最重要、最特殊的信號，系統(tǒng)內(nèi)大部分器件的動作都是在時鐘的跳變沿上進(jìn)行， 這就要求時鐘信號時延差要非常小， 否則就可能造成時序邏輯狀態(tài)出錯。...
在復(fù)位電路中，由于復(fù)位信號是異步的，因此，有些設(shè)計采用同步復(fù)位電路進(jìn)行復(fù)位，并且絕大多數(shù)資料對于同步復(fù)位電路都認(rèn)為不會發(fā)生亞穩(wěn)態(tài)，其實不然，同步電路也會發(fā)生亞穩(wěn)態(tài)，只是幾率小于異步復(fù)位電路。...
當(dāng)檢測到上升沿時, pos_edge信號輸出一個時鐘周期的高電平; 檢測到下降沿時，neg_edge輸出一個時鐘周期的高電平。...
案例說明 1. Kintex-7 FPGA使用SRIO IP核作為Initiator，通過AD9613模塊采集AD數(shù)據(jù)。AD9613采樣率為250MSPS，雙通道12bit，12bit按照16bit發(fā)送，因此數(shù)據(jù)量為16bit * 2 * 250M = 8Gbps； 2. AD數(shù)據(jù)通過SRIO由Ki...
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