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• 采用ispLSI1016芯片實(shí)現(xiàn)4×5鍵盤(pán)控制器設(shè)計(jì)

  無(wú)論在任何計(jì)算機(jī)系統(tǒng)中，鍵盤(pán)都是最重要的輸入設(shè)備，但是普通鍵盤(pán)不能滿(mǎn)足機(jī)載要求。在新一代電子航空?qǐng)D導(dǎo)航系統(tǒng)中，用Lattice公司的ispLSI1016設(shè)計(jì)了一個(gè)4×5鍵盤(pán)控制器（以下簡(jiǎn)稱(chēng)KBC），經(jīng)實(shí)際應(yīng)用，該鍵盤(pán)控制器通用性較強(qiáng)。圖1是其鍵盤(pán)和顯示器外觀示意圖。...

  2592次閱讀 · 0評(píng)論 芯片控制器鍵盤(pán)
  

• 基于Neuron芯片和CPLD器件實(shí)現(xiàn)在系統(tǒng)編程的軟件設(shè)計(jì)

  在系統(tǒng)編程ISP（In System Programming）是指在用戶(hù)設(shè)計(jì)的目標(biāo)系統(tǒng)或印刷電路板上為重新配置邏輯，或?qū)崿F(xiàn)新的功能而對(duì)器件進(jìn)行編程或反復(fù)編程。隨著EDA工具的普及和ISP器件的日益成熟，ISP技術(shù)也得到了越來(lái)越廣泛的應(yīng)用。ISP技術(shù)的應(yīng)用使得硬件設(shè)計(jì)軟件化，其顯著優(yōu)勢(shì)體現(xiàn)在：簡(jiǎn)化生產(chǎn)...

  988次閱讀 · 0評(píng)論 芯片cpld總線(xiàn)
  

• 利用半拍錯(cuò)位同步法消除異步電路的亞穩(wěn)態(tài)

  當(dāng)今的數(shù)字系統(tǒng)往往是圍繞CPLD/ FPGA 進(jìn)行設(shè)計(jì)的， 首選的方案是采用同步時(shí)序電路設(shè)計(jì) ， 也稱(chēng)作單時(shí)鐘系統(tǒng)， 電路中所有觸發(fā)器的時(shí)鐘輸入端共享同一個(gè)時(shí)鐘， 每個(gè)觸發(fā)器的狀態(tài)變化都是在時(shí)鐘的上升沿（ 或下降沿） 完成的， 與時(shí)鐘脈沖信號(hào)同步。...

  2083次閱讀 · 0評(píng)論 fpgacpld觸發(fā)器

• 基于EP1C6Q240器件和BF533處理器實(shí)現(xiàn)汽車(chē)智能終端系統(tǒng)的設(shè)計(jì)

  基于BF533的智能車(chē)載終端整合了高性能處理器、全球定位系統(tǒng)、全球移動(dòng)通信系統(tǒng)GSM/GPRS、藍(lán)牙耳機(jī)、TFT-LCD顯示器、CMOS攝像頭、FPGA邏輯接口、計(jì)算機(jī)網(wǎng)絡(luò)等資源。主要實(shí)現(xiàn)的功能指標(biāo)有：...

  1119次閱讀 · 0評(píng)論 處理器fpga服務(wù)器
  

• 采用TMS320VC5402和UDA1341TS轉(zhuǎn)換器實(shí)現(xiàn)列車(chē)語(yǔ)音記錄設(shè)備的設(shè)計(jì)

  列車(chē)運(yùn)行監(jiān)控記錄裝置在鐵路的安全運(yùn)輸過(guò)程中發(fā)揮了巨大的作用，但不足的是沒(méi)有語(yǔ)音記錄功能。為了解決這個(gè)問(wèn)題，按照鐵道部的技術(shù)要求，本文研究開(kāi)發(fā)了一種新型列車(chē)語(yǔ)音記錄設(shè)備。該設(shè)備主要用于對(duì)乘務(wù)員機(jī)車(chē)聯(lián)控進(jìn)行錄音，并可協(xié)同監(jiān)控裝置分析行車(chē)事故，為機(jī)務(wù)部門(mén)和運(yùn)輸部門(mén)的科學(xué)管理提供新的技術(shù)手段。鑒于常見(jiàn)設(shè)備的...

  941次閱讀 · 0評(píng)論 轉(zhuǎn)換器cpld控制器
  

• 基于FPGA參考設(shè)計(jì)解決方案降低汽車(chē)電子制造的復(fù)雜性

  汽車(chē)娛樂(lè)電子推動(dòng)了功能和容量的快速發(fā)展，促使設(shè)計(jì)人員在性能、成本和靈活性上做出綜合考慮。與其他汽車(chē)電子領(lǐng)域不同，多媒體圖形應(yīng)用高度可視化，其需求多變，在許多情況下甚至還沒(méi)有建立標(biāo)準(zhǔn)。汽車(chē)設(shè)計(jì)人員需要一個(gè)能夠提供最靈活、性能最佳而成本可控的解決方案?？删幊踢壿嫞貏e是現(xiàn)場(chǎng)可編程門(mén)陣列（FPGA）便是這...

  1044次閱讀 · 0評(píng)論 fpga集成電路汽車(chē)電子
  

• 安路科技-用FPGA實(shí)現(xiàn)海量智能互聯(lián)應(yīng)用

  機(jī)器學(xué)習(xí)和邊緣AI算法的發(fā)展日新月異，其發(fā)展速度呈指數(shù)形式上升，比互聯(lián)網(wǎng)+的時(shí)代發(fā)展還要快得多，向智能邊緣，智能路由以及云端部署新算法的速度將成為幫助客戶(hù)成功的關(guān)鍵。...

  1563次閱讀 · 0評(píng)論 fpga物聯(lián)網(wǎng)安路科技

• 采用單片機(jī)和CPLD器件實(shí)現(xiàn)仿人手臂形假肢控制系統(tǒng)的設(shè)計(jì)

  假肢是人體缺損肢體的替代物，用以彌補(bǔ)缺損肢體的形狀和功能。本文針對(duì)失去整個(gè)手臂的情況，設(shè)計(jì)出一種仿人手臂形假肢的控制系統(tǒng)。使用者可以補(bǔ)償部分缺失的功能，達(dá)到生活自理甚至于可以從事基本勞動(dòng)，減少身心痛苦，同時(shí)也相應(yīng)地解放了護(hù)理工作用。在設(shè)計(jì)中，采用C8051F020單片機(jī)作為主控制器，并通過(guò)CPLD（...

  1384次閱讀 · 0評(píng)論 單片機(jī)cpld控制系統(tǒng)
  

• 采用TMS320LF2407A和EP1C6Q240C8實(shí)現(xiàn)噴氣織機(jī)引緯控制系統(tǒng)方案設(shè)計(jì)

  噴氣織機(jī)的引緯控制系統(tǒng)直接決定著噴氣織機(jī)的運(yùn)行效率、能耗、產(chǎn)品質(zhì)量、平均無(wú)故障時(shí)間等關(guān)鍵性的指標(biāo)，是噴氣織機(jī)整個(gè)電控系統(tǒng)的核心之一。市場(chǎng)上現(xiàn)存的噴氣織機(jī)的引緯控制系統(tǒng)一般都是利用處理器和硬件電路兩部分配合實(shí)現(xiàn)［2］，即引緯角度信號(hào)由處理器通過(guò)軟件比較產(chǎn)生，單穩(wěn)態(tài)信號(hào)產(chǎn)生部分和電磁閥驅(qū)動(dòng)部分則由電子元...

  2096次閱讀 · 0評(píng)論 dspfpga控制系統(tǒng)
  

• 采用FPGA/CPLD可編程邏輯器件實(shí)現(xiàn)內(nèi)河航標(biāo)監(jiān)控系統(tǒng)的設(shè)計(jì)

  內(nèi)河水運(yùn)是國(guó)家綜合運(yùn)輸體系和水資源綜合利用的重要組成部分，是實(shí)現(xiàn)經(jīng)濟(jì)社會(huì)可持續(xù)發(fā)展的重要戰(zhàn)略資源。航標(biāo)是內(nèi)河航道的基礎(chǔ)助航設(shè)施，傳統(tǒng)的航標(biāo)管理模式落后，標(biāo)準(zhǔn)化程度低，實(shí)時(shí)性、安全性能差，已無(wú)法滿(mǎn)足當(dāng)前日益繁忙的航道運(yùn)輸所提出的高質(zhì)量安全航行的需求。...

  1083次閱讀 · 0評(píng)論 fpgacpld可編程邏輯
  

• 基于片上可編程系統(tǒng)解決方案實(shí)現(xiàn)視頻編解碼IP核的設(shè)計(jì)

  SOPC是Altera公司提出的片上可編程系統(tǒng)解決方案，它將CPU、存儲(chǔ)器、I/O接口、DSP模塊以及鎖相環(huán)的系統(tǒng)設(shè)計(jì)所必需的模塊集成到一塊FPGA上，構(gòu)成一個(gè)可編程的片上系統(tǒng)，使設(shè)計(jì)的電路在其規(guī)模、可靠性、體積、功耗、功能、上市周期、開(kāi)發(fā)周期、產(chǎn)品維護(hù)以及硬件升級(jí)等多方面實(shí)現(xiàn)最優(yōu)化。...

  1036次閱讀 · 0評(píng)論 控制器總線(xiàn)ip核
  

• 基于FPGA的VHDL語(yǔ)言設(shè)計(jì)控制器SJA1000的IP軟核設(shè)計(jì)

  分析了CAN控制器SJA1000的特點(diǎn)及CAN協(xié)議通信格式。設(shè)計(jì)了控制器SJA1000的IP軟核，能為應(yīng)用提供一個(gè)性能優(yōu)良的、易于移植的控制器SJA1000，實(shí)現(xiàn)了對(duì)步進(jìn)電機(jī)的控制。...

  3367次閱讀 · 0評(píng)論 fpga控制器ip核
  

• 基于Nios II系統(tǒng)實(shí)現(xiàn)LCD顯示控制IP核的設(shè)計(jì)

  基于NiosII 軟核的SOPC（System ON Programmable Chip）是Altera 公司提出的片上可編程系統(tǒng)解決方案，它將CPU、存儲(chǔ)器、I/O接口、DSP 模塊以及鎖相環(huán)（PLL）的系統(tǒng)設(shè)計(jì)所必須的模塊集成到一片F(xiàn)PGA 上，構(gòu)成一個(gè)可編程的片上系統(tǒng)，使所設(shè)計(jì)的電路在其規(guī)模、...

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• 采用可編程器件CPLD實(shí)現(xiàn)ARINC429收發(fā)電路與接口板的通信設(shè)計(jì)

  PC104總線(xiàn)系統(tǒng)是一種新型的計(jì)算機(jī)測(cè)控平臺(tái)，作為嵌入式PC的一種，在軟件與硬件上與標(biāo)準(zhǔn)的臺(tái)式PC（PC/AT）體系結(jié)構(gòu)完全兼容，它具有如下優(yōu)點(diǎn)：體積小、十分緊湊，并采用模塊化結(jié)構(gòu)，功耗低，總線(xiàn)易于擴(kuò)充，緊固堆疊方式安裝，適合于制作高密度、小體積、便攜式測(cè)試設(shè)備，因此在軍用航空設(shè)備上有著廣泛的應(yīng)用，...

  2597次閱讀 · 0評(píng)論 cpld嵌入式接口
  

• 基于EZ-USB系列芯片和FPGA器件實(shí)現(xiàn)數(shù)據(jù)采集系統(tǒng)的設(shè)計(jì)

  通用串行總線(xiàn)（USB）支持熱插撥，真正的即插即用。USB1.1在全速傳輸時(shí)可以達(dá)到12Mbps的傳輸速率；低速傳輸時(shí)傳輸速率可達(dá)1.5Mbps。USB電纜線(xiàn)只有4根，兩根是電源線(xiàn)，傳送5V電源，可用來(lái)向設(shè)備供電；另外兩根是信號(hào)線(xiàn)，用來(lái)傳輸串行數(shù)據(jù)。與傳統(tǒng)的RS－232串口比較，USB具有傳輸速度更快...

  1619次閱讀 · 0評(píng)論 fpga芯片數(shù)據(jù)采集
  

• 直接時(shí)鐘控制技術(shù)方案應(yīng)用于存儲(chǔ)器中的設(shè)計(jì)及實(shí)現(xiàn)

  大多數(shù)存儲(chǔ)器接口都是源同步接口，從外部存儲(chǔ)器器件傳出的數(shù)據(jù)和時(shí)鐘/ 選通脈沖是邊沿對(duì)齊的。在 Virtex-4 器件采集這一數(shù)據(jù)，需要延遲時(shí)鐘/ 選通脈沖或數(shù)據(jù)。利用直接時(shí)鐘控制技術(shù)，數(shù)據(jù)經(jīng)延遲，并與內(nèi)部 FPGA 時(shí)鐘實(shí)現(xiàn)中心對(duì)齊。在這個(gè)方案中，內(nèi)部 FPGA時(shí)鐘采集傳出的數(shù)據(jù)。存儲(chǔ)器傳出的時(shí)鐘/...

  1109次閱讀 · 0評(píng)論 fpga存儲(chǔ)器脈沖
  

• 利用QuartusⅡ開(kāi)發(fā)工具實(shí)現(xiàn)6路PWM輸出接口的設(shè)計(jì)

  在許多嵌入式系統(tǒng)的實(shí)際應(yīng)用中，需要擴(kuò)展FP-GA（現(xiàn)場(chǎng)可編程門(mén)陣列）模塊，將CPU實(shí)現(xiàn)有困難或?qū)崿F(xiàn)效率低的部分用FPGA實(shí)現(xiàn)，如數(shù)字信號(hào)處理、硬件數(shù)字濾波器、各種算法等，或者利用FPGA來(lái)擴(kuò)展I／O接口，如實(shí)現(xiàn)多路PWM（脈寬調(diào)制）輸出、實(shí)現(xiàn)PCI接口擴(kuò)展等。通過(guò)合理的系統(tǒng)軟硬件功能劃分，結(jié)合優(yōu)秀高...

  2835次閱讀 · 0評(píng)論 fpgacpupwm
  

• 基于NIOS處理器實(shí)現(xiàn)A/D數(shù)據(jù)采集電路的控制接口邏輯設(shè)計(jì)

  在FPGA系統(tǒng)中，實(shí)現(xiàn)對(duì)外部A/D數(shù)據(jù)采集電路的控制接口邏輯，由于其邏輯功能不是很復(fù)雜，因此可采用自定義的方式。采用這種方法進(jìn)行設(shè)計(jì)有兩種途徑。①?gòu)能浖先?shí)現(xiàn)。這種方案將NIOS處理器作為一個(gè)主控制器，通過(guò)編寫(xiě)程序來(lái)控制數(shù)據(jù)轉(zhuǎn)換電路。由于NIOS處理器的工作頻率相對(duì)于外部設(shè)備來(lái)說(shuō)要高出許多，故此種...

  1045次閱讀 · 0評(píng)論 處理器fpga數(shù)據(jù)采集
  

• 采用FPGA與嵌入式CPU大容量數(shù)據(jù)存儲(chǔ)實(shí)現(xiàn)航空視頻采集記錄系統(tǒng)設(shè)計(jì)

  在航空視頻采集記錄系統(tǒng)中，攝像頭把載機(jī)任務(wù)系統(tǒng)的實(shí)時(shí)畫(huà)面視頻數(shù)據(jù)按預(yù)定格式組幀，通過(guò)LVDS信號(hào)總線(xiàn)傳輸給視頻采集模塊；經(jīng)過(guò)視頻采集模塊對(duì)LVDS信號(hào)電平進(jìn)行變換處理后，將單端視頻數(shù)字信號(hào)送給可編程邏輯器件（FPGA）進(jìn)行視頻解碼處理。解碼后的數(shù)字視頻，一方面通過(guò)SAA7121視頻編碼器直接送給監(jiān)視...

  1222次閱讀 · 0評(píng)論 fpgacpu存儲(chǔ)嵌入式CPU
  

• 采用CPLD器件實(shí)現(xiàn)PXI觸發(fā)總線(xiàn)接口的設(shè)計(jì)方案

  pxi是pci extensiON for inSTrumentation的縮寫(xiě)，是為了將pci總線(xiàn)擴(kuò)展到測(cè)試儀器領(lǐng)域而推出的以pci計(jì)算機(jī)局部總線(xiàn)為基礎(chǔ)的模塊儀器結(jié)構(gòu)。pxi相對(duì)于cpci系統(tǒng)的一個(gè)重要特點(diǎn)是定義了8根觸發(fā)總線(xiàn)，這可以實(shí)現(xiàn)系統(tǒng)中各模塊間的同步和通信。...

  2118次閱讀 · 0評(píng)論 cpld總線(xiàn)
  
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