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      XILINX開發(fā)者社區(qū)

      文章：144 被閱讀：30.1w 粉絲數(shù)：13 關注數(shù)：0 點贊數(shù)：3

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      Vivado無法選中開發(fā)板的常見原因及解決方法

      在使用 AMD Vivado Design Suite 對開發(fā)板（Evaluation Board）....
      的頭像 XILINX開發(fā)者社區(qū) 發(fā)表于 07-15 10:19 ?429次閱讀
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      AMD Power Design Manager 2025.1現(xiàn)已推出

      AMD Power Design Manager 2025.1 版（PDM）現(xiàn)已推出——增加了對第二....
      的頭像 XILINX開發(fā)者社區(qū) 發(fā)表于 07-09 14:33 ?278次閱讀

      AMD FPGA異步模式與同步模式的對比

      本文講述了AMD UltraScale /UltraScale+ FPGA 原生模式下，異步模式與同....
      的頭像 XILINX開發(fā)者社區(qū) 發(fā)表于 07-07 13:47 ?490次閱讀

      如何在Unified IDE中創(chuàng)建視覺庫HLS組件

      最近我們分享了開發(fā)者分享｜AMD Vitis HLS 系列 1 - AMD Vivado IP 流程....
      的頭像 XILINX開發(fā)者社區(qū) 發(fā)表于 07-02 10:55 ?492次閱讀
      如何在Unified IDE中創(chuàng)建視覺庫HLS組件

      全新AMD Vitis統(tǒng)一軟件平臺2025.1版本發(fā)布

      全新 AMD Vitis 統(tǒng)一軟件平臺 2025.1 版正式上線！此最新版本為使用 AMD Vers....
      的頭像 XILINX開發(fā)者社區(qū) 發(fā)表于 06-24 11:44 ?501次閱讀

      使用AMD Vitis Unified IDE創(chuàng)建HLS組件

      這篇文章在開發(fā)者分享｜AMD Vitis HLS 系列 1 - AMD Vivado IP 流程（V....
      的頭像 XILINX開發(fā)者社區(qū) 發(fā)表于 06-20 10:06 ?998次閱讀
      使用AMD Vitis Unified IDE創(chuàng)建HLS組件

      AMD Vivado Design Suite 2025.1現(xiàn)已推出

      AMD Vivado Design Suite 2025.1 現(xiàn)已推出，支持 AMD Spartan....
      的頭像 XILINX開發(fā)者社區(qū) 發(fā)表于 06-16 15:16 ?551次閱讀

      如何使用AMD Vitis HLS創(chuàng)建HLS IP

      本文逐步演示了如何使用 AMD Vitis HLS 來創(chuàng)建一個 HLS IP，通過 AXI4 接口從....
      的頭像 XILINX開發(fā)者社區(qū) 發(fā)表于 06-13 09:50 ?668次閱讀
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      ATS失效請求報文問題的故障排除步驟

      本篇文章提供了解決 ATS 失效請求報文問題的故障排除步驟，主要聚焦在 CQ 接口上未顯示主機發(fā)送的....
      的頭像 XILINX開發(fā)者社區(qū) 發(fā)表于 06-09 15:17 ?594次閱讀
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      利用AMD VERSAL自適應SoC的設計基線策略

      您是否準備將設計遷移到 AMD Versal 自適應 SoC？設計基線是一種行之有效的時序收斂方法，....
      的頭像 XILINX開發(fā)者社區(qū) 發(fā)表于 06-04 11:40 ?265次閱讀

      AMD Versal Adaptive SoC Clock Wizard AXI DRP示例

      本文將使用 Clocking Wizard 文檔 PG321 中的“通過 AXI4-Lite 進行動....
      的頭像 XILINX開發(fā)者社區(qū) 發(fā)表于 05-27 10:42 ?508次閱讀
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      如何使用One Spin檢查AMD Vivado Design Suite Synth的結果

      本文講述了如何使用 One Spin 檢查 AMD Vivado Design Suite Synt....
      的頭像 XILINX開發(fā)者社區(qū) 發(fā)表于 05-19 14:22 ?512次閱讀
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      AMD Vivado Design Tool綜合中的門控時鐘轉換

      傳統(tǒng)上，使用門控時鐘是 ASIC 設計中降低系統(tǒng)功耗的常見方法。通過門控時鐘，可在非必要時阻止整組寄....
      的頭像 XILINX開發(fā)者社區(qū) 發(fā)表于 05-14 09:05 ?1612次閱讀
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      在任何平臺上使用PetaLinux的先決條件

      本篇文章介紹了在任何平臺上使用 PetaLinux 的先決條件。PetaLinux 是一種嵌入式 L....
      的頭像 XILINX開發(fā)者社區(qū) 發(fā)表于 04-24 10:40 ?590次閱讀
      在任何平臺上使用PetaLinux的先決條件

      關于eDP的介紹

      最新的 DisplayPort TX/RX 1.4 Subsystem IP v3.1 支持 eDP....
      的頭像 XILINX開發(fā)者社區(qū) 發(fā)表于 03-13 14:52 ?812次閱讀
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      如何修改DisplayPort EDID

      在最新的 DisplayPort 1.4 RX Subsystem IP GUI 界面，修改 Dis....
      的頭像 XILINX開發(fā)者社區(qū) 發(fā)表于 03-06 10:23 ?819次閱讀
      如何修改DisplayPort EDID

      AMD Versal自適應SoC器件Advanced Flow概覽（下）

      在 AMD Vivado Design Suite 2024.2 版本中，Advanced Flow....
      的頭像 XILINX開發(fā)者社區(qū) 發(fā)表于 01-23 09:33 ?721次閱讀
      AMD Versal自適應SoC器件Advanced Flow概覽（下）

      AMD Versal自適應SoC器件Advanced Flow概覽（上）

      在最新發(fā)布的 AMD Vivado Design Suite 2024.2 中，引入的新特性之一是啟....
      的頭像 XILINX開發(fā)者社區(qū) 發(fā)表于 01-17 10:09 ?676次閱讀
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      PAM4 PRBS測試簡介

      本文為 AMD Versal 自適應 SoC 器件和 AMD UltraScale Plus 的 P....
      的頭像 XILINX開發(fā)者社區(qū) 發(fā)表于 01-15 10:55 ?1790次閱讀
      PAM4 PRBS測試簡介

      AMD Versal自適應SoC DDRMC如何使用Micron仿真模型進行仿真

      AMD Versal 自適應 SoC 器件上 DDR4 硬核控制器 DDRMC 跑仿真時，按照 IP....
      的頭像 XILINX開發(fā)者社區(qū) 發(fā)表于 01-10 13:33 ?969次閱讀
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      如何在同一塊開發(fā)板上測試GT遠端環(huán)回

      環(huán)回（loopback）是 GT 的一種特殊配置模式?？梢园寻l(fā)送端的數(shù)據(jù)直通過自身 PMA 層或對方....
      的頭像 XILINX開發(fā)者社區(qū) 發(fā)表于 01-08 16:02 ?962次閱讀
      如何在同一塊開發(fā)板上測試GT遠端環(huán)回

      如何通過PMC_GPIO喚醒AMD Versal? Adaptive SoC Linux系統(tǒng)

      在功耗敏感的系統(tǒng)里，我們通常會在系統(tǒng)空閑的時候將系統(tǒng)休眠，然后可以通過一些外設的輸入來喚醒系統(tǒng)，比如....
      的頭像 XILINX開發(fā)者社區(qū) 發(fā)表于 12-17 10:07 ?841次閱讀
      如何通過PMC_GPIO喚醒AMD Versal? Adaptive SoC Linux系統(tǒng)

      CPM PCIE做RC時如何完成對復位信號的控制

      PCI Express 是一種即插即用協(xié)議，主機在啟動時將枚舉 PCIe 設備。此過程包括主機從讀....
      的頭像 XILINX開發(fā)者社區(qū) 發(fā)表于 12-04 16:28 ?1474次閱讀
      CPM PCIE做RC時如何完成對復位信號的控制

      如何在Petalinux下Patch u-boot源碼

      在軟件開發(fā)過程中我們經常遇到用 Patch 來傳遞和更新代碼的場景。本文以一個端到端的例子來演示在 ....
      的頭像 XILINX開發(fā)者社區(qū) 發(fā)表于 12-04 16:26 ?1800次閱讀
      如何在Petalinux下Patch u-boot源碼

      AMD Vitis Unified Software Platform 2024.2發(fā)布

      近日，全新 AMD Vitis Unified Software Platform 2024.2 版....
      的頭像 XILINX開發(fā)者社區(qū) 發(fā)表于 11-27 15:47 ?748次閱讀

      AMD Vivado Design Suite 2024.2全新推出

      AMD Vivado Design Suite 2024.2 全新推出，使用 AMD Versal ....
      的頭像 XILINX開發(fā)者社區(qū) 發(fā)表于 11-22 13:54 ?1058次閱讀

      AMD Versal自適應SoC GTM如何用XSIM仿真和觀察PAM4信號

      PAM4(4-Level Pulse Amplitude Modulation) 的全稱是四電平脈沖....
      的頭像 XILINX開發(fā)者社區(qū) 發(fā)表于 11-22 13:49 ?932次閱讀
      AMD Versal自適應SoC GTM如何用XSIM仿真和觀察PAM4信號

      U50的AMD Vivado Design Tool flow設置

      AMD Alveo 加速卡使用有兩種流程，AMD Vitis Software Platform f....
      的頭像 XILINX開發(fā)者社區(qū) 發(fā)表于 11-13 10:14 ?870次閱讀
      U50的AMD Vivado Design Tool flow設置

      AMD Alveo V80計算加速器網絡研討會

      歡迎參加本次網絡研討會，我們將深入探討 AMD Alveo V80 計算加速器如何幫助您處理高性能計....
      的頭像 XILINX開發(fā)者社區(qū) 發(fā)表于 11-08 09:35 ?639次閱讀

      AMD第二代Versal自適應SoC的主要特色

      AMD 第二代 AMD Versal AI Edge 和 Versal Prime 系列助力 AI ....
      的頭像 XILINX開發(fā)者社區(qū) 發(fā)表于 09-18 10:14 ?1034次閱讀