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集成電路設(shè)計(jì)

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集成電路設(shè)計(jì)（Integrated circuit design， IC design），亦可稱之為超大規(guī)模集成電路設(shè)計(jì)（VLSI design），是指以集成電路、超大規(guī)模集成電路為目標(biāo)的設(shè)計(jì)流程。集成電路設(shè)計(jì)涉及對電子器件（例如晶體管、電阻器、電容器等）、器件間互連線模型的建立。

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集成電路設(shè)計(jì)資訊

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