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標簽 > PLL電路
PLL 電路的工作原理是將外部信號的相位與壓控晶體振蕩器 （VCXO） 產生的時鐘信號的相位進行比較。然后，電路調整振蕩器時鐘信號的相位以匹配參考信號的相位。因此，原始參考信號和新信號彼此精確地同相。
一個鎖相環(huán)PLL電路通常由以下模塊組成：
1）鑒相鑒頻器PFD（Phase Frequency Detector）：對輸入的基準信號（來自頻率穩(wěn)定的晶振）和反饋回路的信號進行頻率的比較，輸出一個代表兩者相位差異的信號。
2）低通濾波器LPF（Low-Pass Filter）：將PFD中生成的差異信號的高頻成分濾除，保留直流部分。
3）壓控振蕩器VCXO（Voltage Controlled Oscillator）：根據輸入電壓，輸出對應頻率的周期信號。利用變容二極管（偏置電壓的變化會改變耗盡層的厚度，從而影響電容大?。┡c電感構成的LC諧振電路構成，提高變容二極管的逆向偏壓，二極管內耗盡層變大，電容變小，LC電路的諧振頻率提高，反之，降低逆向偏壓時，二極管內電容變大，頻率降低。
4）反饋回路FL（Feedback Loop）：通常由一個分頻器實現(xiàn)。將VCXO的輸出降低到與基準信號相同級別的頻率才能在PFD中比較
每個時刻均需要兩個晶閘管同時導通，形成向負載供電的回路，其中一個晶閘管是共陰極組的，一個是共陽極組的，且不能為同一組的晶閘管。
PCIe接口全稱PCI Express，由PCI-SIG組織發(fā)布的用于替代PCI總路線的新一代高速串行總線與接口。
集成電路設計行業(yè)專業(yè)性強、復雜程度高、迭代速度快，具有較高的技術門檻。
盡管基本PLL自其出現(xiàn)之日起幾乎保持原樣，但是使用不同技術制作及滿足不同應用要求的PLL的實現(xiàn)一直給設計者提出挑戰(zhàn)。
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