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如果采用MAC模式，DSP48則非常適用，因為DSP48 Slice內(nèi)含輸入寄存器、輸出寄存器和加法器單元。實現(xiàn)31抽頭MAC引擎需要的資源包括一個DSP48、一個18kb塊RAM（block RAM）和9個邏輯片。另外，還需要一些邏輯片用于采樣、系數(shù)地址生成和控制。如果FPGA內(nèi)置有600MHz的...
在數(shù)據(jù)串并轉(zhuǎn)換的過程中， 必須用到寄存器來存放臨時數(shù)據(jù)。一般情況下，發(fā)送數(shù)據(jù)需要1 個發(fā)送寄存器，接收數(shù)據(jù)需要1個接收寄存器，則至少需要2 個寄存器。在SPI 總線中，每發(fā)送1個數(shù)據(jù)位則發(fā)送寄存器多出1 個空閑位， 正好可以在半個周期后用來接收1 個數(shù)據(jù)位。為了減少資源消耗，可以用1 個移位寄存器來...
隨著時代和技術(shù)的發(fā)展，對于數(shù)據(jù)總線帶寬的要求越來越高，現(xiàn)有的總線標(biāo)準(zhǔn)越來越難以滿足實際應(yīng)用中對高總線速率的要求。先進(jìn)的總線技術(shù)對于解決系統(tǒng)的瓶頸，提高系統(tǒng)性能起著至關(guān)重要的作用，同時為了實現(xiàn)批量數(shù)據(jù)的傳輸，IEEE又公布了支持更高傳輸速率的IEEE Std 1394b-2002（簡稱1394b）串行...
近年來，F(xiàn)PGA技術(shù)發(fā)展迅速，片內(nèi)集成了PLL、硬件乘法器、存儲器，具有了實現(xiàn)優(yōu)秀算法的充足資源。許多航空電子嵌入式圖像處理系統(tǒng)是由固定的視頻源和顯示設(shè)備組成，系統(tǒng)中圖像縮放的倍率是固定的。文中針對此展開重點研究，基于FPGA硬件，實現(xiàn)固定倍率的圖像縮放。...
用三段式描述狀態(tài)機(jī)的好處，國內(nèi)外各位大牛都已經(jīng)說的很多了，大致可歸為以下三點：...
汽車制造商們堅持不懈地改進(jìn)車內(nèi)舒適性、安全性、便利性、工作效能和娛樂性，反過來，這些努力又推動了各種車內(nèi)數(shù)字技術(shù)的應(yīng)用。...
FPGA 設(shè)計人員在滿足關(guān)鍵時序余量的同時力爭實現(xiàn)更高性能，在這種情況下，存儲器接口的設(shè)計是一個一向構(gòu)成艱難而耗時的挑戰(zhàn)。Xilinx FPGA 提供 I/O 模塊和邏輯資源，從而使接口設(shè)計變得更簡單、更可靠。盡管如此，I/O 模塊以及額外的邏輯還是需要由設(shè)計人員在源 RTL 代碼中配置、驗證、執(zhí)...
FPGA的可靠復(fù)位是保證系統(tǒng)能夠正常工作的必要條件，本文對FPGA設(shè)計中常用的復(fù)位設(shè)計方法進(jìn)行了分類、分析和比較，并針對各種復(fù)位方式的特點，提出了如何提高復(fù)位設(shè)計可靠性的方法。...
從最近一段時間工作和學(xué)習(xí)的成果中，我總結(jié)了如下幾種進(jìn)行時序約束的方法。按照從易到難的順序排列如下：...
蜂鳴器是一種一體化結(jié)構(gòu)的電子訊響器，采用直流電壓供電，廣泛應(yīng)用于計算機(jī)、打印機(jī)、復(fù)印機(jī)、報警器、電子玩具、汽車電子設(shè)備、電話機(jī)、定時器等電子產(chǎn)品中作發(fā)聲器件。在一般設(shè)計中，可利用蜂鳴器檢測有些按鍵是否按下，或者有些功能是否正常等，當(dāng)然如果足夠浪漫，也可以讓蜂鳴器演奏音樂。 簡單蜂鳴器電路圖 本設(shè)計使...
隨著集成電路工藝技術(shù)的不斷發(fā)展，集成電路的特征設(shè)計尺寸進(jìn)入到深亞微米，芯片規(guī)模擴(kuò)大到百萬門級，從計算量、后端布局布線（placement&routing，P&R）工具、內(nèi)存占用、運行時間、設(shè)計時序收斂性等方面考慮，扁平化的后端實現(xiàn)方式已變得難以承受，近年來，層次化的設(shè)計方式被廣泛采用，以實現(xiàn)大規(guī)模...
具有嵌入式處理器的平臺FPGA提供很大的靈活性、集成度和高性能。目前，在單個可編程邏輯器件中開發(fā)極其復(fù)雜且高度定制化的嵌入式系統(tǒng)已成為可能。隨著芯片性能的不斷增加，如何使設(shè)計方法始終高效、多產(chǎn)，成為人們面臨的主要挑戰(zhàn)。嵌入式系統(tǒng)開發(fā)的關(guān)鍵活動之一是板級支持包（BSP）。利用BSP，可以使嵌入式軟件...
隨著計算機(jī)和通信的發(fā)展，信息傳輸過程中信息安全的重要性越來越受到人們的重視。在信息傳輸過程中，人們普遍采用將待傳輸?shù)男畔⒓用苓M(jìn)行傳輸，然后在收端進(jìn)行解密還原信息。對信息的加解密通常采用兩種方法：軟件加解密和硬件加解密。軟件加解密實現(xiàn)簡單，但須對密碼算法進(jìn)行多重保護(hù)存放且加解密速度較慢，而硬件加解密可...
隨著電力電子技術(shù)、微電子技術(shù)及交流伺服控制理論的發(fā)展，交流伺服驅(qū)動已經(jīng)具有可與直流伺服驅(qū)動相比擬的性能，并且交流伺服傳動技術(shù)已廣泛應(yīng)用于印刷、數(shù)控機(jī)床、食品包裝、紡織、塑料、電子半導(dǎo)體等行業(yè) 。交流伺服傳動系統(tǒng)的電機(jī)一般又分為交流永磁同步電機(jī)和鼠籠式交流異步電動機(jī)，在小功率范圍交流永磁同步伺服系統(tǒng)有...
FPGA是英文FieldProgrammableGateArray的縮寫，即現(xiàn)場可編程門陣列，它是在PAL、GAL、EPLD等可編程器件的基礎(chǔ)上進(jìn)一步發(fā)展的產(chǎn)物。它是作為專用集成電路（ASIC）領(lǐng)域中的一種半定制電路而出現(xiàn)的，既解決了定制電路的不足，又克服了原有可編程器件門電路數(shù)有限的缺點...
在演算法交易領(lǐng)域的最新進(jìn)展是導(dǎo)入一些更低延遲的解決方案，其中最佳的方式是使用FPGA搭建的客制硬體。這些FPGA硬體可說是硬編碼ASIC的極致性能和CPU的靈活度之間的橋梁，提供大量的資源且可加以配置，使其得以較軟體解決方案更大幅縮短往返交易延遲。...
英國南開普敦大學(xué)Reed研究組最近在arXiv貼出了一篇硅光的研究進(jìn)展 arXiv 1807.01656, “Towards an optical FPGA - Programmable silicon photonic circuits“。...
盡管FPGA的配置模式各不相同，但整個配置過程中FPGA的工作流程是一致的，分為三個部分：設(shè)置、加載、啟動。...
基于FPGA的期貨行情數(shù)據(jù)加速處理過程中，不同的消息類型采用并行處理的方式，并且每一次的處理結(jié)果需要使用內(nèi)存來緩存一次行情數(shù)據(jù)信息。行情數(shù)據(jù)信息容量巨大，片上存儲難以滿足需求，采用DDR3 SDRAM成為首選方法。但由于DDR3只有一套數(shù)據(jù)訪問通道，不能滿足多個通道同時訪問的需求。此前的對于SDRA...
隨著數(shù)字時代的到來，越來越多的領(lǐng)域采用集成電路來設(shè)計電路，F(xiàn)PGA/CPLD等EDA設(shè)計更為廣大硬件工程師所接受。其模塊化設(shè)計為設(shè)計人員帶來了很多方便，節(jié)約了系統(tǒng)的開發(fā)時間，使設(shè)計人員只需要調(diào)用這些模塊或者IP核，然后組合起來就可以實現(xiàn)一個簡單的功能。全數(shù)字鎖相環(huán)（DPLL）就是其中一個典型的例子。...
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