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電子發(fā)燒友網(wǎng)技術(shù)文庫(kù)為您提供最新技術(shù)文章，最實(shí)用的電子技術(shù)文章，是您了解電子技術(shù)動(dòng)態(tài)的最佳平臺(tái)。

• 系統(tǒng)演示平臺(tái)便于快速進(jìn)行原型制作與評(píng)估

  SDP上提供ADI公司系列產(chǎn)品的元件和實(shí)驗(yàn)室電路評(píng)估板，并隨時(shí)更新。由于之前使用過(guò)該平臺(tái)，對(duì)其有一定的認(rèn)知，用戶很容易在熟悉的環(huán)境中評(píng)估新類別的元件。SDP連接至FPGA評(píng)估與原型制作平臺(tái)，可以輕松創(chuàng)建并演示采用ADI元件通信的定制FPGA嵌入式設(shè)計(jì)。...

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• 西門子S7-200PLC內(nèi)存結(jié)構(gòu)分析

  這個(gè)EEPROM存儲(chǔ)器存放程序的地方對(duì)我們來(lái)說(shuō)不必太深究，但有一塊特殊的區(qū)域我們要知道，以后編程可能會(huì)用的到。就是EEPROM存儲(chǔ)器除了存儲(chǔ)程序以外，還留了一塊區(qū)域，專門用來(lái)存放我們PLC斷電以后需要長(zhǎng)久保存的數(shù)據(jù)。上面我們講到在RAM存儲(chǔ)器里的數(shù)據(jù)斷電后是保存不住的，不幸的是我們的程序運(yùn)行時(shí)，運(yùn)算...

  5667次閱讀 · 0評(píng)論 西門子s7-200plc

• FPGA的FIFO實(shí)現(xiàn)過(guò)程

  FIFO隊(duì)列有兩個(gè)位置指示指針。一個(gè)是寫指針，指向隊(duì)列的第一個(gè)存儲(chǔ)單元。一個(gè)讀指針，指向隊(duì)列的最后一個(gè)存儲(chǔ)單元。當(dāng)有寫命令的時(shí)候，數(shù)據(jù)寫入寫指針指向的存儲(chǔ)單元，然后指針加一。當(dāng)有讀命令的時(shí)候，讀指針加一，在讀出讀指針指向的存儲(chǔ)單元的數(shù)據(jù)。這里讀命令，指針要加一，是定義讀數(shù)據(jù)，是讀出讀指針的下一個(gè)存儲(chǔ)...

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• Xilinx不同F(xiàn)PGA集成的GTx及性能

  GTx接收和發(fā)送方向均由PCS和PMA兩部分組成，PCS提供豐富的物理編碼層特性，如8b/10b編碼等；PMA部分為模擬電路，提供高性能的串行接口特性，如預(yù)加重與均衡。...

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• Xilinx支持Serial RapidIO Gen2核可應(yīng)用在Rapid IO交換設(shè)計(jì)中

  Rapid IO協(xié)議由于無(wú)主機(jī)，且各設(shè)備之間可以并行交換信息，所以廣泛應(yīng)用于對(duì)交換速率要求高，且交互復(fù)雜的應(yīng)用中。Xilinx現(xiàn)在有支持Serial RapidIO Gen2的核，可以應(yīng)用在此場(chǎng)景中，但Xilinx 的 Rapid IO 核對(duì)外接口僅有 AXI 流接口 ， 且對(duì)各類數(shù)據(jù)流的處理需要外...

  8079次閱讀 · 0評(píng)論 xilinx可編程邏輯io端口

• FPGA設(shè)計(jì)過(guò)程中定點(diǎn)小數(shù)計(jì)算要注意些什么

  兩個(gè)FIX_32_30相乘得到的數(shù)據(jù)是 FIX_64_60，我們發(fā)現(xiàn)這個(gè)結(jié)果最大值為-1~+1，所以只需要保留兩位整數(shù)位即可（其中一位為符號(hào)位）即通過(guò)截位使其變成FIX_32_30，所以 temp 為 sin*cos [61:20]。...

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• FPGA設(shè)計(jì)的創(chuàng)新調(diào)試手段

  EXOSTIV Probe從各方面都優(yōu)于傳統(tǒng)調(diào)試方案，它支持Xilinx所有系列，采用高速SerDes接口實(shí)現(xiàn)數(shù)據(jù)采集和通信，EXOSTIV Probe能夠采集多達(dá)32768個(gè)內(nèi)部信號(hào)節(jié)點(diǎn)，此外EXOSTIV IP提供動(dòng)態(tài)多路復(fù)用控制功能，能夠動(dòng)態(tài)采集更多的數(shù)據(jù)集而不需要重新進(jìn)行編譯。...

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• Xilinx基于ARM的Zynq-7000和Zynq UltraScale+ MPSoC及RFSoC器件是否存在安全漏洞

  本文試圖搞清楚在 Xilinx 基于 ARM 的 Zynq-7000、Zynq UltraScale+ MPSoC 和 Zynq UltraScale+ RFSoC 器件中是否存在任何漏洞。...

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• 數(shù)字信號(hào)處理架構(gòu)下FPGA，ARM，DSP的對(duì)比

  信號(hào)處理系統(tǒng)一般不單單是模擬信號(hào)或者數(shù)字信號(hào)，一般兩者都會(huì)有。信號(hào)的處理關(guān)注的是信號(hào)以及信號(hào)所包含的信息的表示、變換及運(yùn)算。...

  5089次閱讀 · 0評(píng)論 dspfpgaarm數(shù)字信號(hào)處理
  

• 通過(guò)Xilinx FFT IP核的使用實(shí)現(xiàn)OFDM

  由于OFDM接收機(jī)中大多是數(shù)據(jù)串并轉(zhuǎn)換后的連續(xù)低速并行數(shù)據(jù)流輸入FFT，故這里采用流水線結(jié)構(gòu)。之后根據(jù)OFDM子載波數(shù)選擇變換長(zhǎng)度。該IP核僅支持50MHZ采樣率數(shù)據(jù)的流水線處理，如果數(shù)高速通信場(chǎng)合，可以再次將數(shù)據(jù)串并轉(zhuǎn)換用多個(gè)FFT IP核并行運(yùn)算，也就是FPGA設(shè)計(jì)中常用的“面積換速度”。...

  2184次閱讀 · 0評(píng)論 fpgaofdmxilinx
  

• FPGA工程開發(fā)中仿真的重要性

  很多初學(xué)者入門FPGA的時(shí)候所學(xué)習(xí)的編程例子都是很簡(jiǎn)單的，比如流水燈、數(shù)碼管點(diǎn)亮之類的。這種入門級(jí)別的例子有個(gè)特點(diǎn)，代碼量少，邏輯簡(jiǎn)單，分析容易。而且大家剛開始都是照著書本抄一遍的，基本上都是沒(méi)有什么問(wèn)題的。一上板子就發(fā)現(xiàn)效果出來(lái)了。...

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• AXI STREAM FIFO如何設(shè)置雙時(shí)鐘

  IP核的全稱是： AXI4-STREAM FIFO 設(shè)置注意事項(xiàng)：一定要選擇異步時(shí)鐘，也就是雙時(shí)鐘，如下： 關(guān)于其他配置： TLAST 一般要選擇的，作為邊界界定。其他可以不選。深度不必太深，因?yàn)橹黄鸬酱┰綍r(shí)鐘區(qū)域的作用。...

  5562次閱讀 · 0評(píng)論 異步時(shí)鐘
  

• Xilinx IP核配置,一步一步驗(yàn)證Xilinx Serdes GTX最高8.0Gbps

  之前用serdes一直都是跑的比較低速的應(yīng)用，3.125Gbps，按照官方文檔一步一步來(lái)都沒(méi)出過(guò)什么問(wèn)題，這次想驗(yàn)證一下K7系列GTX最高線速8Gbps，看看xilinx的FPGA是不是如官方文檔所說(shuō)。...

  11127次閱讀 · 0評(píng)論 fpgaxilinxIP核

• Xilinx FPGA中SRL原理

  基于SRL16的分布式RAM不再支持V5、S6和V6等器件，但是SRL16是所有XIlinx器件都支持的，并且在設(shè)計(jì)中應(yīng)用非常頻繁，因此可通過(guò)調(diào)用原語(yǔ)的方法來(lái)調(diào)用SRL16E甚至SRL32E來(lái)實(shí)現(xiàn)原來(lái)ISE分布式RAM IP核的設(shè)計(jì)。...

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• 雙口RAM概述及Vivado RAM IP核應(yīng)用

  雙口RAM概述 雙口RAM（dual port RAM）在異構(gòu)系統(tǒng)中應(yīng)用廣泛，通過(guò)雙口RAM，不同硬件架構(gòu)的芯片可以實(shí)現(xiàn)數(shù)據(jù)的交互，從而實(shí)現(xiàn)通信。...

  13723次閱讀 · 0評(píng)論 雙口ramvivado

• FPGA基礎(chǔ)知識(shí)之IIC協(xié)議讀寫解析

  很多數(shù)字傳感器、數(shù)字控制的芯片（DDS、串行ADC、串行DAC）都是通過(guò)IIC總線來(lái)和控制器通信的。不過(guò)IIC協(xié)議仍然是一種慢速的通信方式，標(biāo)準(zhǔn)IIC速率為100kbit/s，快速模式速率為400kbit/s。本文致力于講述如何用計(jì)數(shù)器控制和分頻時(shí)鐘控制兩種方式完成IIC的讀寫操作。 IIC協(xié)議 ?...

  8608次閱讀 · 0評(píng)論 fpgaiic協(xié)議
  

• 淺談UART通信協(xié)議 UART接收數(shù)據(jù)時(shí)序設(shè)計(jì)

  UART通信的一幀一般由11到12位數(shù)據(jù)組成。1bit的起始位，檢測(cè)為低電平表示數(shù)據(jù)開始傳輸；緊接著8bits的數(shù)據(jù)；然后是1bit的奇偶校驗(yàn)位，可以是奇校驗(yàn)或者偶校驗(yàn)；最后是1bit或2bits的停止位，必須為高電平，表示一個(gè)字符數(shù)據(jù)的傳輸結(jié)束。...

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• 一種可選的PLC編程方法，支持機(jī)械工程的模塊化

  博世力士樂(lè)在他的伺服驅(qū)動(dòng)器IndraDrive上擴(kuò)展了軌跡運(yùn)動(dòng)控制功能模塊 “SMC for IndraDrive”。這意味著，現(xiàn)在博世力士樂(lè)的多軸系統(tǒng)在編程與調(diào)試環(huán)節(jié)所需要的時(shí)間大大減少了。作為一種可選的PLC編程方法，力士樂(lè)解決方案SMC使得軸耦合，軸同步和順序化運(yùn)動(dòng)序列的實(shí)現(xiàn)速度更快。這套控制...

  2294次閱讀 · 0評(píng)論 plc可編程邏輯模塊化

• PLC很難學(xué) PLC怎么學(xué)容易

  除了要有編程環(huán)境外，就需要有工程范例。其實(shí)工程范例很容易獲得，我們可以找任意一本描述電動(dòng)機(jī)控制的書籍，把其中所有的各種控制電動(dòng)機(jī)的方式，當(dāng)然是用繼電器和接觸器構(gòu)成的，我們把這些機(jī)電控制方式全部編寫成PLC控制方式。幾個(gè)范例編完，基本上就明白了。...

  25183次閱讀 · 0評(píng)論 plciec61131
  

• FPGA與CPLD特性對(duì)比 哪類器件更適合你

  PLD和FPGA都是由邏輯陣列模塊構(gòu)成的，但是CPLD LAB基于乘積和宏單元，而FPGA LAB使用基于LUT的邏輯單元。CPLD LAB圍繞中心全局互連排列，隨著器件中邏輯數(shù)量的增加，呈指數(shù)增長(zhǎng)。...

  3450次閱讀 · 0評(píng)論 fpgacpld
  
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