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標簽 > vhdl
VHDL全名Very-High-Speed Integrated Circuit Hardware Description Language,誕生于1982年。1987年底,VHDL被IEEE和美國國防部確認為標準硬件描述語言 。
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通過FPGA與VHDL設計三線制同步串行通信控制器并進行功能仿真
同步串行通信在航天工程領域中有著廣泛的應用,其中,三線制同步串行通信以其連線少、操作方便、通信速度快等特點,被成功應用在與外圍串行設備的數據通信中。
利用FPGA與VHDL語言實現(xiàn)多按鍵狀態(tài)識別系統(tǒng)設計
FPGA采用Altera公司EPF10K30ATC144,該器件內核采用3.3 V供電,端口電壓為3.3V可承受5 V輸入高電平,其工作頻率高達100 ...
采用VHDL語言實現(xiàn)SDRAM與雙口RAM的數據傳輸系統(tǒng)設計
我們的任務是設計一個通用微處理器,它要具有語音、數據、圖像等多種處理功能,并具有RS232、USB等多種接口,另外由于多個通道的數據都需要進行緩存和處理...
FPGA從實現(xiàn)粘合邏輯逐步發(fā)展成為設計平臺的核心,在電子、通信以及航空航天等領域得到了廣泛應用。本人最近實現(xiàn)的中頻軟件無線電硬件平臺,就以FPGA為核心...
基于FPGA硬件實現(xiàn)H.264變換量化整體結構的設計方案
H.264高效的編碼效率是以其高復雜性為代價的,因此制約了它在高分辨率、實時處理等方面的應用。而FPGA器件采用流水控制策略和并行處理方式,可為H.26...
基于VHDL語言和FPGA開發(fā)板實現(xiàn)數字秒表的設計
應用VHDL語言設計數字系統(tǒng),很多設計工作可以在計算機上完成,從而縮短了系統(tǒng)的開發(fā)時間,提高了工作效率。本文介紹一種以FPGA為核心,以VHDL為開發(fā)工...
基于QuartusⅡ開發(fā)環(huán)境與VHDL語言的16路可調彩燈控制器的設計
QuartusⅡ是Altera公司在21世紀初推出的FPGA/CPLD集成開發(fā)環(huán)境,是Altera公司前一代FPGA/CPLD集成開發(fā)環(huán)境Max+Plu...
采用VHDL預言實現(xiàn)基于Petri網的并行控制器設計并進行仿真驗證
Petri網是離散事件系統(tǒng)建模的重要工具,本文使用硬件描述語言VHDL實現(xiàn)了基于Petri網的并行控制器。文中通過一個液位控制系統(tǒng)實例具體介紹了這一方法...
本文介紹如何利用VHDL硬件描述語言設計一個具有年、月、日、星期、時、分、秒計時顯示功能,時間調整功能和整點報時功能的數字日歷。在QuartusⅡ開發(fā)環(huán)...
采用VHDL語言實現(xiàn)數據采集與控制系統(tǒng)軟IP核的設計
現(xiàn)代模擬仿真技術廣泛應用在系統(tǒng)設計、系統(tǒng)分析以及教育訓練中。在模擬過程中,存在大量向前端模擬裝置或仿真模塊發(fā)送指令數據,以及從模擬工作設備上讀取狀態(tài)參量...
2019-05-03 標簽:fpga控制系統(tǒng)vhdl 2555 0
采用VHDL語言實現(xiàn)線性分組碼編/譯碼器的設計與仿真驗證
在通信系統(tǒng)中,由于信道存在大量的噪聲和干擾,使得經信道傳輸后的接收碼與發(fā)送碼之間存在差異,出現(xiàn)誤碼。在數字通信系統(tǒng)中常采用差錯控制信道編碼技術,以此來減...
用FPGA器件與VHDL語言實現(xiàn)曼徹斯特碼編解碼器的設計
曼徹斯特碼編碼、解碼器是1553B總線接口中不可缺少的重要組成部分。曼徹斯特碼編解碼器設計的好壞直接影響總線接口的性能。本文介紹的是MIL-STD-15...
采用VHDL語言和PLD的可控納秒級脈沖信號發(fā)生器的設計
設計采用的XILINX公司的復雜可編程邏輯器件(CPLD)幾乎可適用于所有的門陣列和各種規(guī)模的數字集成電路,他以其編程方便、集成度高、速度快、價格低等特...
基于VHDL、FPGA實現(xiàn)智能控制器的設計與開環(huán)測試
隨著市場需求的增長,超大規(guī)模集成電路的集成度和工藝水平不斷提高,在一個芯片上完成系統(tǒng)級的設計已成為可能。FPGA固有的并行運算處理能力,使得它能夠提供各...
采用VHDL語言與FPGA芯片實現(xiàn)平均值相位差計的設計
相位差的測量在研究網絡特性中具有重要作用,如何快速、精確地測量相位差已成為生產科研中的重要課題。測量相位差的方法很多,有集成電路設計的,也有采用數字信號...
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