verilog

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Verilog HDL是一種硬件描述語言（HDL:Hardware Description Language），以文本形式來描述數(shù)字系統(tǒng)硬件的結(jié)構(gòu)和行為的語言，用它可以表示邏輯電路圖、邏輯表達(dá)式，還可以表示數(shù)字邏輯系統(tǒng)所完成的邏輯功能。

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verilog技術(shù)

偶數(shù)分頻/奇數(shù)分頻/分?jǐn)?shù)分頻詳解

　時(shí)鐘分頻電路(分頻器)在IC設(shè)計(jì)中經(jīng)常會用到，其目的是產(chǎn)生不同頻率的時(shí)鐘，滿足系統(tǒng)的需要。比如一個(gè)系統(tǒng)，常規(guī)操作都是在1GHz時(shí)鐘下完成，突然要執(zhí)行...

2023-04-25 標(biāo)簽：分頻器 Verilog 時(shí)鐘 9929 0

FPGA的入門基礎(chǔ)知識詳細(xì)說明

本文檔的主要內(nèi)容詳細(xì)介紹的是FPGA的入門基礎(chǔ)知識詳細(xì)說明。

2020-12-20 標(biāo)簽：FPGA Verilog 觸發(fā)器 9848 0

FPGA中的testbench介紹

跟大家解釋一點(diǎn)，所有testbench本質(zhì)上都是串行執(zhí)行，因?yàn)樵贑PU環(huán)境下，沒有可靠并行執(zhí)行的能力。所有并行的語句，比如兩個(gè)always模塊，fork...

2018-10-10 標(biāo)簽：FPGA verilog 9815 0

SystemVerilog中bind用法總結(jié)+送實(shí)驗(yàn)源碼和腳本

bind是systemverilog中一個(gè)重要的知識點(diǎn)，很多時(shí)候能夠在驗(yàn)證中發(fā)揮重要的作用，今天就針對這個(gè)知識點(diǎn)做一個(gè)梳理，希望能幫助到大家。

2023-01-11 標(biāo)簽：Verilog System 源碼 9488 0

常用串行總線(二)——SPI協(xié)議(Verilog實(shí)現(xiàn))

SPI(Serial Perripheral Interface, 串行外圍設(shè)備接口)是 Motorola 公司推出的一種同步串行接口技術(shù)。SPI 總線...

2023-01-06 標(biāo)簽：接口 Verilog SPI 9415 0

SystemVerilog實(shí)用知識點(diǎn)：覆蓋率之Function Coverage

SystemVerilog是一名芯片驗(yàn)證工程師，必須掌握的一門語言，其中Function Coverage是必須要懂的知識點(diǎn)之一；

2023-06-04 標(biāo)簽：Verilog 時(shí)鐘 DUT 9051 0

verilog仿真工具編譯

Icarus Verilog（以下簡稱iverilog ）號稱“全球第四大”數(shù)字芯片仿真器，也是一個(gè)完全開源的仿真器。

2022-08-15 標(biāo)簽：Verilog 編譯仿真工具 8723 0

Verilog如何編程?Verilog編程知識點(diǎn)總結(jié)

FPGA的設(shè)計(jì)就是將自己想要實(shí)現(xiàn)的邏輯通過計(jì)算機(jī)能夠理解的語言描述出來，并讓計(jì)算機(jī)根據(jù)FPGA內(nèi)部的資源生成

2019-01-01 標(biāo)簽：FPGA Verilog 編程 8643 1

如何把二進(jìn)制轉(zhuǎn)換為格雷碼？格雷碼是如何判斷讀空寫滿呢？

在傳遞讀寫時(shí)鐘域的指針使用格雷碼來傳遞，如何把二進(jìn)制轉(zhuǎn)換為格雷碼，格雷碼是如何判斷讀空寫滿呢？

2018-09-15 標(biāo)簽：二進(jìn)制 verilog 格雷碼 8536 0

組合邏輯概述

根據(jù)狄摩根定律第二條，就可以將積之和布爾表達(dá)式轉(zhuǎn)化成和之積形式；根據(jù)狄摩根定律第一條，就可以將和之積布爾表達(dá)式轉(zhuǎn)化成積之和形式。

2018-09-10 標(biāo)簽：邏輯電路 Verilog 8210 0

詳解Verilog賦值語句、塊語句、條件語句

不可綜合語句經(jīng)常用在測試文件中，未注明的語句均是可綜合的

2023-07-02 標(biāo)簽：IC 電路設(shè)計(jì)Verilog 8032 0

帶你了解SystemVerilog中的關(guān)聯(lián)數(shù)組

在SystemVerilog中，我們知道可以使用動(dòng)態(tài)數(shù)組實(shí)現(xiàn)數(shù)組元素個(gè)數(shù)的動(dòng)態(tài)分配，即隨用隨分

2023-06-09 標(biāo)簽：仿真器 Verilog C語言 8004 0

verilog中阻塞賦值和非阻塞賦值的區(qū)別

阻塞賦值操作符用等號(即 = )表示?！白枞笔侵冈谶M(jìn)程語句（initial和always）中，當(dāng)前的賦值語句阻斷了其后的語句，也就是說后面的語句必須等...

2022-12-19 標(biāo)簽：Verilog 阻塞 7973 0

采用FPGA和單片機(jī)結(jié)合的等精度原理的測量頻率實(shí)現(xiàn)

傳統(tǒng)測量頻率的方法主要有直接測量法、分頻測量法、測周法等，這些方法往往只適用于測量一段頻率，當(dāng)被測信號的頻率發(fā)生變化時(shí)，測量的精度就會下降。

2018-09-17 標(biāo)簽：fpga 單片機(jī)Verilog 7959 0

d觸發(fā)器verilog描述

觸發(fā)器是一個(gè)具有記憶功能的，具有兩個(gè)穩(wěn)定狀態(tài)的信息存儲器件，是構(gòu)成多種時(shí)序電路的最基本邏輯單元，也是數(shù)字邏輯電路中一種重要的單元電路。在數(shù)字系統(tǒng)和計(jì)算機(jī)...

2017-12-12 標(biāo)簽：verilog d觸發(fā)器 7959 0

FPGA數(shù)字圖像處理基礎(chǔ)：色彩空間轉(zhuǎn)換(Verilog)

色彩本質(zhì)上是不同頻率的光，人眼對于不同頻率光線的不同感受產(chǎn)生主觀感知，從而得以區(qū)分不同的顏色。盡管從客觀上而言，色彩僅僅是不同頻率的光，但從視覺角度而言...

2023-02-17 標(biāo)簽：fpga 色彩 RGB 7541 0

FPGA設(shè)計(jì)中的HLS 工具應(yīng)用

在集成電路行業(yè)飛速發(fā)展的今天，縮短產(chǎn)品開發(fā)的周期而又不犧牲驗(yàn)證過程，這不可避免地成為了商業(yè)市場的一個(gè)關(guān)鍵因素。Xilinx Vivado High Le...

2018-06-04 標(biāo)簽：fpga verilog hls 7534 0

Verilog/VHDL語法學(xué)習(xí)是掌握基本代碼設(shè)計(jì)的技能以及經(jīng)驗(yàn)總結(jié)

無論是VHDL還是Verilog，建議初學(xué)者先掌握其中一門。

2017-12-19 標(biāo)簽：fpga verilog vhdl 7382 0

多輸入門、多輸出門和三態(tài)門詳解

門級建模，是使用基本的邏輯單元，例如與門，與非門等，進(jìn)行更低級抽象層次上的設(shè)計(jì)。與行為級建模相比，門級建模更注重硬件的實(shí)現(xiàn)方法，即通過連接一些基本門電路...

2023-03-30 標(biāo)簽：Verilog 三態(tài)門門控時(shí)鐘 7351 0

淺談Verilog復(fù)雜時(shí)序邏輯電路設(shè)計(jì)實(shí)踐

筆試時(shí)也很常見。［例1］一個(gè)簡單的狀態(tài)機(jī)設(shè)計(jì)－－序列檢測器序列檢測器是時(shí)序數(shù)字電路設(shè)計(jì)中經(jīng)典的教學(xué)范例，下面我們將用Verilog HDL語言來描...

2021-08-10 標(biāo)簽：Verilog HDL 讀寫器 7298 0

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Protues

Protues

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Proteus軟件是英國Lab Center Electronics公司出版的EDA工具軟件（該軟件中國總代理為廣州風(fēng)標(biāo)電子技術(shù)有限公司）。它不僅具有其它EDA工具軟件的仿真功能，還能仿真單片機(jī)及外圍器件。
靜電防護(hù)

靜電防護(hù)

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為防止靜電積累所引起的人身電擊、火災(zāi)和爆炸、電子器件失效和損壞，以及對生產(chǎn)的不良影響而采取的防范措施。其防范原則主要是抑制靜電的產(chǎn)生，加速靜電泄漏，進(jìn)行靜電中和等。
Altium Designer

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FPGA芯片

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FPGA（Field－Programmable Gate Array），即現(xiàn)場可編程門陣列，它是在PAL、GAL、CPLD等可編程器件的基礎(chǔ)上進(jìn)一步發(fā)展的產(chǎn)物。
ArduBlock

ArduBlock

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ArduBlock軟件是Arduino官方編程環(huán)境的第三方軟件，目前必須依附于Arduino軟件下運(yùn)行，區(qū)別于Arduino文本式編程環(huán)境，ArduBlock是以圖形化積木搭建的方式編程的，這樣的方式會使編程的可視化和交互性加強(qiáng)，編程門檻降低，即使沒有編程經(jīng)驗(yàn)的人也可以嘗試給Arduino控制器編寫程序。
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識別

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FPGA開發(fā)板

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FPGA開發(fā)板在基于MCU、定制ASIC和體積龐大的電線束來實(shí)現(xiàn)引擎及控制電子的系統(tǒng)方案已發(fā)展至接近其技術(shù)和應(yīng)用極限，汽車工業(yè)正面臨新的設(shè)計(jì)挑戰(zhàn)。過去汽車電子產(chǎn)品的開發(fā)周期是漫長的，而許多汽車制造商現(xiàn)正致力于在更短的時(shí)間內(nèi)，裝備消費(fèi)者所需的新一代汽車。
PCB封裝

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pcb封裝就是把實(shí)際的電子元器件，芯片等的各種參數(shù)（比如元器件的大小，長寬，直插，貼片，焊盤的大小，管腳的長寬，管腳的間距等）用圖形方式表現(xiàn)出來，以便可以在畫pcb圖時(shí)進(jìn)行調(diào)用。
QUARTUS II

QUARTUS II

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Quartus II 是Altera公司推出的綜合性CPLD/FPGA開發(fā)軟件，軟件支持原理圖、VHDL、VerilogHDL以及AHDL（Altera Hardware 支持Description Language）等多種設(shè)計(jì)輸入形式，內(nèi)嵌自有的綜合器以及仿真器，可以完成從設(shè)計(jì)輸入到硬件配置的完整PLD設(shè)計(jì)流程。
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　　Artix-7 系列：相對于 Spartan-6 系列而言，Artix-7 系列功耗降低了一半，成本降低了 35%，采用小型化封裝、統(tǒng)一的 Virtex 系列架構(gòu)，能滿足低成本大批量市場的性能要求，這也正是此前 ASSP、ASIC 和低成本 FPGA 所針對的市場領(lǐng)域。
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面包板是由于板子上有很多小插孔，專為電子電路的無焊接實(shí)驗(yàn)設(shè)計(jì)制造的。由于各種電子元器件可根據(jù)需要隨意插入或拔出，免去了焊接，節(jié)省了電路的組裝時(shí)間，而且元件可以重復(fù)使用，所以非常適合電子電路的組裝、調(diào)試和訓(xùn)練。
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AXI是一種總線協(xié)議，該協(xié)議是ARM公司提出的AMBA3.0協(xié)議中最重要的部分，是一種面向高性能、高帶寬、低延遲的片內(nèi)總線。它的地址/控制和數(shù)據(jù)相位是分離的，支持不對齊的數(shù)據(jù)傳輸，同時(shí)在突發(fā)傳輸中，只需要首地址，同時(shí)分離的讀寫數(shù)據(jù)通道、并支持Outstanding傳輸訪問和亂序訪問，并更加容易進(jìn)行時(shí)序收斂。AXI是AMBA中一個(gè)新的高性能協(xié)議。
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特性阻抗又稱特征阻抗，它不是直流電阻，屬于長線傳輸中的概念。特性阻抗是射頻傳輸線影響無線電波電壓、電流的幅值和相位變化的固有特性，等于各處的電壓與電流的比值，用V/I表示。在射頻電路中，電阻、電容、電感都會阻礙交變電流的流動(dòng)，合稱阻抗。電阻是吸收電磁能量的，理想電容和電感不消耗電磁能量。
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時(shí)鐘源用來為環(huán)形脈沖發(fā)生器提供頻率穩(wěn)定且電平匹配的方波時(shí)鐘脈沖信號。它通常由石英晶體振蕩器和與非門組成的正反饋振蕩電路組成，其輸出送至環(huán)形脈沖發(fā)生器。
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　　AD轉(zhuǎn)換采樣頻率指完成一次從模擬轉(zhuǎn)換到數(shù)字的AD轉(zhuǎn)換所需時(shí)間的倒數(shù)，模擬量可以是電壓、電流等電信號，也可以是壓力、溫度、濕度、位移、聲音等非電信號；而AD分辨率指數(shù)字量變化一個(gè)最小量時(shí)模擬信號的變化量。
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Kintex-7

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　　Kintex-7系列：Kintex-7 系列是一種新型 FPGA，能以不到 Virtex-6 系列一半的價(jià)格實(shí)現(xiàn)與其相當(dāng)性能，性價(jià)比提高了一倍，功耗降低了一半。
Protel DXP

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