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FPGA設(shè)計(jì)論壇

文章:441 被閱讀:124.8w 粉絲數(shù):68 關(guān)注數(shù):0 點(diǎn)贊數(shù):24

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為什么研究浮點(diǎn)加法運(yùn)算,對(duì)FPGA實(shí)現(xiàn)方法很有必要?

點(diǎn)擊上方 藍(lán)字 關(guān)注我們 現(xiàn)代信號(hào)處理技術(shù)通常都需要進(jìn)行大量高速浮點(diǎn)運(yùn)算。由于浮點(diǎn)數(shù)系統(tǒng)操作比較復(fù)雜....
的頭像 FPGA設(shè)計(jì)論壇 發(fā)表于 09-22 10:40 ?1491次閱讀
為什么研究浮點(diǎn)加法運(yùn)算,對(duì)FPGA實(shí)現(xiàn)方法很有必要?

基于FPGA的高速串行傳輸系統(tǒng)設(shè)計(jì)

點(diǎn)擊上方 藍(lán)字 關(guān)注我們 隨著網(wǎng)絡(luò)技術(shù)的不斷發(fā)展,數(shù)據(jù)交換、數(shù)據(jù)傳輸流量越來(lái)越大。尤其像雷達(dá),氣象、....
的頭像 FPGA設(shè)計(jì)論壇 發(fā)表于 09-21 11:05 ?4064次閱讀
基于FPGA的高速串行傳輸系統(tǒng)設(shè)計(jì)

如何使用FPGA器件和USB通訊實(shí)現(xiàn)高速數(shù)據(jù)傳輸顯示系統(tǒng)的設(shè)計(jì)

點(diǎn)擊上方 藍(lán)字 關(guān)注我們 本文設(shè)計(jì)的基于FPGA和USB的高速數(shù)據(jù)傳輸、記錄系統(tǒng)不但具有體積小、功耗....
的頭像 FPGA設(shè)計(jì)論壇 發(fā)表于 09-20 10:00 ?3264次閱讀
如何使用FPGA器件和USB通訊實(shí)現(xiàn)高速數(shù)據(jù)傳輸顯示系統(tǒng)的設(shè)計(jì)

基于FPGA的攝像機(jī)傳感器接口

點(diǎn)擊上方 藍(lán)字 關(guān)注我們 圖像傳感器可以說(shuō)是在數(shù)字視頻或靜止相機(jī)中視頻或靜止圖像處理流水線的最重要部....
的頭像 FPGA設(shè)計(jì)論壇 發(fā)表于 09-19 11:55 ?1191次閱讀
基于FPGA的攝像機(jī)傳感器接口

CMOS圖像傳感器的FPGA邏輯設(shè)計(jì)解析

點(diǎn)擊上方 藍(lán)字 關(guān)注我們 CMOS 圖像傳感器 是近些年發(fā)展較快的一種新型圖像傳感器。CMOS圖像傳....
的頭像 FPGA設(shè)計(jì)論壇 發(fā)表于 09-19 10:15 ?2061次閱讀
CMOS圖像傳感器的FPGA邏輯設(shè)計(jì)解析

等效時(shí)間采樣原理及基于FPGA的實(shí)現(xiàn)

經(jīng)常涉及對(duì)寬帶模擬信號(hào)進(jìn)行數(shù)據(jù)采集和存儲(chǔ),以便計(jì)算機(jī)進(jìn)一步進(jìn)行數(shù)據(jù)處理。為了對(duì)高速模擬信號(hào)進(jìn)行不失真....
的頭像 FPGA設(shè)計(jì)論壇 發(fā)表于 09-15 09:45 ?2352次閱讀
等效時(shí)間采樣原理及基于FPGA的實(shí)現(xiàn)

基于千兆網(wǎng)的FPGA多通道數(shù)據(jù)采集系統(tǒng)設(shè)計(jì)

點(diǎn)擊上方 藍(lán)字 關(guān)注我們 FPGA 豐富的邏輯資源、充沛的I/O引腳以及較低的功耗,被廣泛應(yīng)用于 嵌....
的頭像 FPGA設(shè)計(jì)論壇 發(fā)表于 09-13 15:10 ?980次閱讀
基于千兆網(wǎng)的FPGA多通道數(shù)據(jù)采集系統(tǒng)設(shè)計(jì)

FPGA算法映射要點(diǎn)

將圖像處理的算法轉(zhuǎn)換為FPGA系統(tǒng)設(shè)計(jì)的過(guò)程稱為算法映射,CPU并行算法的實(shí)現(xiàn)與FPGA并行算法的實(shí)....
的頭像 FPGA設(shè)計(jì)論壇 發(fā)表于 09-11 10:45 ?893次閱讀
FPGA算法映射要點(diǎn)

FPGA學(xué)習(xí)-異步復(fù)位,同步釋放

點(diǎn)擊上方 藍(lán)字 關(guān)注我們 系統(tǒng)的復(fù)位對(duì)于系統(tǒng)穩(wěn)定工作至關(guān)重要,最佳的復(fù)位方式為:異步復(fù)位,同步釋放。....
的頭像 FPGA設(shè)計(jì)論壇 發(fā)表于 09-09 14:15 ?1630次閱讀
FPGA學(xué)習(xí)-異步復(fù)位,同步釋放

攝像頭圖像采集基礎(chǔ)知識(shí)總結(jié)

目前FPGA用于圖像采集 傳輸 處理 顯示應(yīng)用越來(lái)越多,主要原因是圖像處理領(lǐng)域的火熱以及FPGA強(qiáng)大....
的頭像 FPGA設(shè)計(jì)論壇 發(fā)表于 09-08 14:15 ?2134次閱讀
攝像頭圖像采集基礎(chǔ)知識(shí)總結(jié)

FPGA常見(jiàn)面試題總結(jié)

點(diǎn)擊上方 藍(lán)字 關(guān)注我們 1 數(shù)字IC(ASIC)設(shè)計(jì)流程: IC設(shè)計(jì)分為前端和后端。前端設(shè)計(jì)主要將....
的頭像 FPGA設(shè)計(jì)論壇 發(fā)表于 09-07 12:35 ?1797次閱讀

用FPGA進(jìn)行基本運(yùn)算和特殊函數(shù)定點(diǎn)運(yùn)算

FPGA以擅長(zhǎng)高速并行數(shù)據(jù)處理而聞名,從有線/無(wú)線通信到圖像處理中各種DSP算法,再到現(xiàn)今火爆的AI....
的頭像 FPGA設(shè)計(jì)論壇 發(fā)表于 09-05 11:45 ?733次閱讀

FPGA學(xué)習(xí)-序列檢測(cè)器

點(diǎn)擊上方 藍(lán)字 關(guān)注我們 一、前言 在數(shù)字電路中,序列檢測(cè)器(Sequence Detector)是....
的頭像 FPGA設(shè)計(jì)論壇 發(fā)表于 08-29 10:20 ?1763次閱讀
FPGA學(xué)習(xí)-序列檢測(cè)器

基于FPGA的高速ADC接口設(shè)計(jì)

點(diǎn)擊上方 藍(lán)字 關(guān)注我們 ADC硬件特性分析 首先必須通過(guò)datasheet分析其核心參數(shù)、接口定義....
的頭像 FPGA設(shè)計(jì)論壇 發(fā)表于 08-28 14:30 ?2278次閱讀

幀同步系統(tǒng)的工作原理及如何基于FPGA實(shí)現(xiàn)其設(shè)計(jì)

1、 引言 數(shù)字通信時(shí),一般以一定數(shù)目的碼元組成一個(gè)個(gè)“字”或“句”,即組成一個(gè)個(gè)“幀”進(jìn)行傳輸,因....
的頭像 FPGA設(shè)計(jì)論壇 發(fā)表于 08-27 19:55 ?4187次閱讀
幀同步系統(tǒng)的工作原理及如何基于FPGA實(shí)現(xiàn)其設(shè)計(jì)

SoC FPGA與MCU主要優(yōu)勢(shì)和劣勢(shì)對(duì)比

MCU 對(duì)應(yīng)用主導(dǎo)地位的挑戰(zhàn)已經(jīng)開(kāi)始。具有片上固定功能處理子系統(tǒng)的現(xiàn)場(chǎng)可編程邏輯器件?(FPGA),....
的頭像 FPGA設(shè)計(jì)論壇 發(fā)表于 08-26 10:45 ?3058次閱讀
SoC FPGA與MCU主要優(yōu)勢(shì)和劣勢(shì)對(duì)比

基于FPGA的CNN加速項(xiàng)目案例解析

人工智能(AI)長(zhǎng)期以來(lái)一直是科幻作家和學(xué)者的主題。將人腦的復(fù)雜性復(fù)制到計(jì)算機(jī)中的挑戰(zhàn)催生了新一代的....
的頭像 FPGA設(shè)計(jì)論壇 發(fā)表于 08-25 12:30 ?1308次閱讀

關(guān)于FPGA設(shè)計(jì)中多時(shí)鐘域和異步信號(hào)處理有關(guān)的問(wèn)題

有一個(gè)有趣的現(xiàn)象,眾多數(shù)字設(shè)計(jì)特別是與FPGA設(shè)計(jì)相關(guān)的教科書(shū)都特別強(qiáng)調(diào)整個(gè)設(shè)計(jì)最好采用唯一的時(shí)鐘域....
的頭像 FPGA設(shè)計(jì)論壇 發(fā)表于 08-23 16:10 ?788次閱讀

基于FPGA協(xié)處理器的算法及總線連接

當(dāng)今的設(shè)計(jì)工程師受到面積、功率和成本的約束,不能采用GHz級(jí)的計(jì)算機(jī)實(shí)現(xiàn)嵌入式設(shè)計(jì)。在嵌入式系統(tǒng)中,....
的頭像 FPGA設(shè)計(jì)論壇 發(fā)表于 08-22 18:50 ?1024次閱讀

riscv的fpga實(shí)現(xiàn)案例 基于RISC-V加速器實(shí)現(xiàn)現(xiàn)場(chǎng)可編程門(mén)陣列 CNN異構(gòu)的控制方案

現(xiàn)場(chǎng)可編程門(mén)陣列(FPGA)具有低功耗、高性能和靈活性的特點(diǎn)。FPGA神經(jīng)網(wǎng)絡(luò)加速的研究正在興起,但....
的頭像 FPGA設(shè)計(jì)論壇 發(fā)表于 08-21 10:30 ?2980次閱讀
riscv的fpga實(shí)現(xiàn)案例  基于RISC-V加速器實(shí)現(xiàn)現(xiàn)場(chǎng)可編程門(mén)陣列 CNN異構(gòu)的控制方案

在設(shè)計(jì)中擴(kuò)展串行端口的入門(mén)知識(shí)

? ? 即使USB出現(xiàn),串行端口也不會(huì)消亡。對(duì)于術(shù)語(yǔ)“串行端口”,我們通常指的是或多或少符合RS-2....
的頭像 FPGA設(shè)計(jì)論壇 發(fā)表于 08-18 17:25 ?773次閱讀

在設(shè)計(jì)中擴(kuò)展串行端口的入門(mén)知識(shí)分享

即使USB出現(xiàn),串行端口也不會(huì)消亡。對(duì)于術(shù)語(yǔ)“串行端口”,我們通常指的是或多或少符合RS-232 標(biāo)....
的頭像 FPGA設(shè)計(jì)論壇 發(fā)表于 08-18 17:24 ?1636次閱讀
在設(shè)計(jì)中擴(kuò)展串行端口的入門(mén)知識(shí)分享

4 實(shí)例

1 Overview 與傳統(tǒng)的并行實(shí)現(xiàn)方法相比,基于串行I/O的設(shè)計(jì)具有很多優(yōu)勢(shì),包括:器件引腳數(shù)較....
的頭像 FPGA設(shè)計(jì)論壇 發(fā)表于 08-16 14:10 ?689次閱讀

使用高速NOR閃存配置FPGA

點(diǎn)擊上方 藍(lán)字 關(guān)注我們 NOR閃存已作為FPGA(現(xiàn)場(chǎng)可編程門(mén)列陣)的配置器件被廣泛部署。其為FP....
的頭像 FPGA設(shè)計(jì)論壇 發(fā)表于 08-15 13:55 ?828次閱讀
使用高速NOR閃存配置FPGA

在FPGA中實(shí)現(xiàn)MCU內(nèi)核的快速運(yùn)行

點(diǎn)擊上方 藍(lán)字 關(guān)注我們 有時(shí), 微控制器 本身可以完全吸收設(shè)計(jì)的所有功能要求。對(duì)于絕大多數(shù)嵌入式系....
的頭像 FPGA設(shè)計(jì)論壇 發(fā)表于 08-14 10:25 ?1259次閱讀
在FPGA中實(shí)現(xiàn)MCU內(nèi)核的快速運(yùn)行

FPGA芯片結(jié)構(gòu)介紹及工作原理解析

點(diǎn)擊上方 藍(lán)字 關(guān)注我們 ?FPGA工作原理與簡(jiǎn)介 ? ? 如前所述,F(xiàn)PGA是在PAL、GAL、E....
的頭像 FPGA設(shè)計(jì)論壇 發(fā)表于 08-12 14:45 ?1970次閱讀
FPGA芯片結(jié)構(gòu)介紹及工作原理解析

將 FPGA 嵌入 DSP 驅(qū)動(dòng)的軟件無(wú)線電應(yīng)用中

點(diǎn)擊上方 藍(lán)字 關(guān)注我們 ?隨著軟件定義無(wú)線電平臺(tái)在軍事航空航天領(lǐng)域以及近在一些消費(fèi)無(wú)線電和 電子 ....
的頭像 FPGA設(shè)計(jì)論壇 發(fā)表于 08-11 10:45 ?1437次閱讀
將 FPGA 嵌入 DSP 驅(qū)動(dòng)的軟件無(wú)線電應(yīng)用中

多相結(jié)構(gòu)采樣率變換器的FPGA實(shí)現(xiàn)

點(diǎn)擊上方 藍(lán)字 關(guān)注我們 FPGA(Field-Programmable Gate Array),即....
的頭像 FPGA設(shè)計(jì)論壇 發(fā)表于 08-08 18:05 ?1123次閱讀
多相結(jié)構(gòu)采樣率變換器的FPGA實(shí)現(xiàn)

使用MATLAB和Simulink創(chuàng)建FPGA原型的最佳方法

芯片設(shè)計(jì)和驗(yàn)證工程師通常要為在硅片上實(shí)現(xiàn)的每一行RTL代碼寫(xiě)出多達(dá)10行測(cè)試平臺(tái)代碼。驗(yàn)證任務(wù)在設(shè)計(jì)....
的頭像 FPGA設(shè)計(jì)論壇 發(fā)表于 08-06 10:49 ?1987次閱讀
使用MATLAB和Simulink創(chuàng)建FPGA原型的最佳方法

在FPGA上建立MATLAB和Simulink算法原型

點(diǎn)擊上方 藍(lán)字 關(guān)注我們 芯片設(shè)計(jì)和驗(yàn)證工程師通常要為在硅片上實(shí)現(xiàn)的每一行RTL代碼寫(xiě)出多達(dá)10行測(cè)....
的頭像 FPGA設(shè)計(jì)論壇 發(fā)表于 08-06 10:45 ?774次閱讀
在FPGA上建立MATLAB和Simulink算法原型